From d90aa92f90a8695354c8afad33383f8971971820 Mon Sep 17 00:00:00 2001
From: Bdale Garbee <bdale@gag.com>
Date: Tue, 25 Jun 2019 17:19:29 -0600
Subject: [PATCH] more metadata updates

---
 telelco.sch | 228 ----------------------------------------------------
 1 file changed, 228 deletions(-)

diff --git a/telelco.sch b/telelco.sch
index e0db99b..e569f36 100644
--- a/telelco.sch
+++ b/telelco.sch
@@ -38,8 +38,6 @@ T 61300 69200 5 10 0 1 0 6 1
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 T 61300 69200 5 10 0 1 0 6 1
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-loadstatus=throughhole
 }
 C 61400 69200 1 0 1 gnd.sym
 C 51500 72900 1 0 0 3.3V-plus.sym
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 C 45200 69500 1 270 0 capacitor.sym
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 C 46600 68300 1 0 0 gnd.sym
 C 45300 68300 1 0 0 gnd.sym
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 C 46300 68800 1 0 0 gnd.sym
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 C 54300 72200 1 0 0 capacitor.sym
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 C 52200 72800 1 0 0 inductor.sym
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 C 46000 65500 1 0 0 gnd.sym
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 C 60500 67600 1 180 0 resistor.sym
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 N 59600 68300 57600 68300 4
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-T 80800 70500 5 10 0 0 0 0 1
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 T 80800 70500 5 10 0 0 0 0 1
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 T 80800 70500 5 10 0 0 0 0 1
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-T 80800 70500 5 10 0 0 0 0 1
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 T 80800 70500 5 10 0 0 0 0 1
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@@ -332,8 +308,6 @@ vendor=digikey
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 T 80800 70500 5 10 0 0 0 0 1
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-T 80800 70500 5 10 0 0 0 0 1
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 T 80800 70500 5 10 0 0 0 0 1
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 N 54900 48100 54900 47700 4
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 C 53950 44750 1 90 0 resistor.sym
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@@ -594,8 +564,6 @@ T 54050 44950 5 10 1 1 0 0 1
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 N 53850 45850 53850 45650 4
 N 53850 45750 55450 45750 4
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-T 49600 47900 5 10 0 0 0 0 1
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 C 61400 56800 1 180 1 led.sym
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@@ -674,8 +638,6 @@ T 61400 56800 5 10 0 0 0 0 1
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 C 61400 57200 1 180 1 led.sym
 {
@@ -687,8 +649,6 @@ T 61400 57200 5 10 0 0 0 0 1
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 C 61400 57600 1 180 1 led.sym
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 C 60500 54000 1 180 0 resistor.sym
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 }
 C 60500 56400 1 180 0 resistor.sym
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-loadstatus=smt
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 C 60500 56800 1 180 0 resistor.sym
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 }
 C 60500 57200 1 180 0 resistor.sym
 {
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 T 60500 57200 5 10 0 0 180 0 1
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-T 60500 57200 5 10 0 0 180 0 1
-loadstatus=smt
 }
 C 60500 57600 1 180 0 resistor.sym
 {
@@ -765,8 +715,6 @@ T 59700 57600 5 10 1 1 0 0 1
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-T 60500 57600 5 10 0 0 180 0 1
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 N 57600 53900 59600 53900 4
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@@ -814,8 +762,6 @@ value=Debug
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 T 42300 55200 5 10 0 0 0 0 1
-loadstatus=throughhole
-T 42300 55200 5 10 0 0 0 0 1
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 }
 C 42200 56200 1 0 0 gnd.sym
@@ -853,8 +799,6 @@ T 45500 46600 5 10 1 1 0 0 1
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 T 46300 46500 5 10 0 0 0 0 1
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-T 46300 46500 5 10 0 1 0 0 1
-loadstatus=smt
 }
 N 46100 46500 46100 45700 4
 N 51800 48100 51800 47100 4
@@ -870,8 +814,6 @@ T 52900 47100 5 10 1 1 0 0 1
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-T 52400 47600 5 10 0 0 0 0 1
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 T 52400 47600 5 10 0 1 0 0 1
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@@ -886,8 +828,6 @@ T 48495 48695 5 10 1 1 0 0 1
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 T 49400 48700 5 10 1 1 0 0 1
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@@ -902,8 +842,6 @@ T 51100 46900 5 10 1 1 0 0 1
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 }
 N 50600 47700 50900 47700 4
 N 50900 47700 50900 47500 4
@@ -920,8 +858,6 @@ T 51900 46300 5 10 1 1 0 0 1
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-T 52000 46200 5 10 0 1 0 0 1
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 }
 C 46700 47200 1 90 0 resistor.sym
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-T 46700 47200 5 10 0 0 90 0 1
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 C 48800 45700 1 90 0 resistor.sym
 {
@@ -946,8 +880,6 @@ T 49100 46100 5 10 1 1 180 0 1
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-T 48800 45700 5 10 0 0 90 0 1
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 }
 N 46900 47300 48200 47300 4
 N 47800 47300 47800 47100 4
@@ -962,8 +894,6 @@ refdes=J1
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 T 43845 59895 5 10 0 1 0 6 1
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-T 43845 59895 5 10 0 1 0 6 1
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 T 43845 59895 5 10 0 1 0 6 1
 value=Header-5
@@ -1046,8 +976,6 @@ T 45800 61200 5 10 1 1 0 0 1
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-T 54400 47300 5 10 0 1 0 0 1
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 }
 C 45200 60600 1 0 0 resistor.sym
 {
@@ -1059,8 +987,6 @@ T 45200 60600 5 10 0 0 0 0 1
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 }
 N 45200 61100 44200 61100 4
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@@ -1084,8 +1010,6 @@ T 53400 72500 5 10 1 1 0 0 1
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 C 52700 72200 1 0 0 gnd.sym
 N 57600 68700 59500 68700 4
@@ -1128,8 +1052,6 @@ T 51400 72000 5 10 0 0 0 0 1
 footprint=0402
 T 50700 72200 5 10 1 1 0 0 1
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-T 44100 58725 5 10 0 1 0 0 1
-loadstatus=smt
 }
 C 50900 72000 1 90 0 capacitor.sym
 {
@@ -1143,8 +1065,6 @@ T 50900 72000 5 10 0 0 0 0 1
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 T 50200 72200 5 10 1 1 0 0 1
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-T 44100 58725 5 10 0 1 0 0 1
-loadstatus=smt
 }
 C 50400 72000 1 90 0 capacitor.sym
 {
@@ -1158,8 +1078,6 @@ T 50400 72000 5 10 0 0 0 0 1
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 T 49700 72200 5 10 1 1 0 0 1
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-T 44100 58725 5 10 0 1 0 0 1
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 }
 C 49900 72000 1 90 0 capacitor.sym
 {
@@ -1173,8 +1091,6 @@ T 49900 72000 5 10 0 0 0 0 1
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 T 49200 72200 5 10 1 1 0 0 1
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-T 44100 58725 5 10 0 1 0 0 1
-loadstatus=smt
 }
 N 51200 72000 49700 72000 4
 C 51100 71700 1 0 0 gnd.sym
@@ -1246,8 +1162,6 @@ T 48100 51500 5 10 0 0 0 0 1
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 T 55700 71600 5 10 1 1 0 0 1
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-T 48100 51500 5 10 0 0 0 0 1
-loadstatus=smt
 }
 N 48100 54300 46800 54300 4
 {
@@ -1387,8 +1301,6 @@ T 61300 68800 5 10 0 0 0 0 1
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 T 61400 68200 5 10 0 0 0 0 1
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-T 61400 68200 5 10 0 0 0 0 1
-loadstatus=throughhole
 T 60950 68350 5 10 1 1 0 0 1
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 }
@@ -1400,8 +1312,6 @@ T 61300 68400 5 10 0 0 0 0 1
 device=LED
 T 61400 67800 5 10 0 0 0 0 1
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-T 61400 67800 5 10 0 0 0 0 1
-loadstatus=throughhole
 T 60950 67950 5 10 1 1 0 0 1
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 }
@@ -1413,8 +1323,6 @@ T 61300 68000 5 10 0 0 0 0 1
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 T 60950 67550 5 10 1 1 0 0 1
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 }
@@ -1431,8 +1339,6 @@ T 59700 68050 5 10 1 1 0 0 1
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 T 59600 67800 5 10 0 1 0 0 1
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-T 59600 67800 5 10 0 1 0 0 1
-loadstatus=smt
 }
 N 57600 67900 59600 67900 4
 {
@@ -1457,8 +1363,6 @@ T 80200 50400 5 10 1 1 0 0 1
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 T 79900 50700 5 10 0 0 0 0 1
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-T 79900 50700 5 10 0 0 0 0 1
-loadstatus=throughhole
 T 79900 50700 5 10 0 1 0 0 1
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 }
@@ -1480,8 +1384,6 @@ T 77700 56800 5 10 1 1 0 0 1
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 T 77300 57600 5 10 0 0 0 0 1
 footprint=0402
-T 77300 57600 5 10 0 1 0 0 1
-loadstatus=smt
 }
 C 76000 57600 1 270 0 capacitor.sym
 {
@@ -1495,8 +1397,6 @@ T 75700 56800 5 10 1 1 0 0 1
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 T 76000 57600 5 10 0 0 0 0 1
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-T 76000 57600 5 10 0 1 0 0 1
-loadstatus=smt
 }
 C 77400 56400 1 0 0 gnd.sym
 C 76100 56400 1 0 0 gnd.sym
@@ -1513,8 +1413,6 @@ T 69500 51800 5 10 0 1 0 0 1
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-T 69500 51800 5 10 0 1 0 0 1
-loadstatus=smt
 }
 C 73000 51700 1 0 0 gnd.sym
 C 73700 51000 1 90 0 inductor.sym
@@ -1529,8 +1427,6 @@ T 73800 51200 5 10 1 1 0 0 1
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 T 73700 51000 5 10 0 1 0 0 1
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-loadstatus=smt
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 C 73700 49900 1 90 0 resistor.sym
 {
@@ -1542,8 +1438,6 @@ T 73800 50000 5 10 1 1 0 0 1
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 }
 C 75000 49900 1 90 0 capacitor.sym
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@@ -1557,8 +1451,6 @@ T 75000 50000 5 10 1 1 0 0 1
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-T 75000 49900 5 10 0 1 0 0 1
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 C 75000 48800 1 90 0 capacitor.sym
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@@ -1572,8 +1464,6 @@ T 74900 49000 5 10 1 1 0 0 1
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-T 75000 48800 5 10 0 1 0 0 1
-loadstatus=smt
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 C 73800 48800 1 90 0 capacitor.sym
 {
@@ -1587,8 +1477,6 @@ T 73800 49000 5 10 1 1 0 0 1
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-T 73800 48800 5 10 0 1 0 0 1
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 N 73600 51000 73600 50800 4
 N 73600 50900 74800 50900 4
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-T 74300 51700 5 10 0 1 0 0 1
-loadstatus=smt
 }
 C 76500 51000 1 0 0 capacitor.sym
 {
@@ -1627,8 +1513,6 @@ T 77100 50900 5 10 1 1 0 0 1
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-T 76500 51000 5 10 0 1 0 0 1
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 }
 C 78000 51900 1 90 0 capacitor.sym
 {
@@ -1642,8 +1526,6 @@ T 78000 52000 5 10 1 1 0 0 1
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-T 78000 51900 5 10 0 1 0 0 1
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 }
 C 76500 51800 1 0 0 inductor.sym
 {
@@ -1657,8 +1539,6 @@ T 77000 52100 5 10 1 1 0 0 1
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-T 76500 51800 5 10 0 1 0 0 1
-loadstatus=smt
 }
 N 76500 51900 75200 51900 4
 N 76400 51900 76400 51200 4
@@ -1679,8 +1559,6 @@ T 78000 51000 5 10 1 1 0 0 1
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 T 77800 51100 5 10 0 1 0 0 1
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-T 77800 51100 5 10 0 1 0 0 1
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 }
 C 78900 51100 1 0 0 inductor.sym
 {
@@ -1694,8 +1572,6 @@ T 79100 51000 5 10 1 1 0 0 1
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-T 78900 51100 5 10 0 1 0 0 1
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 }
 C 76100 53800 1 90 0 inductor.sym
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@@ -1709,8 +1585,6 @@ T 76100 54000 5 10 1 1 0 0 1
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-T 76100 53800 5 10 0 1 0 0 1
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 C 79000 49900 1 90 0 capacitor.sym
 {
@@ -1724,8 +1598,6 @@ T 79500 50200 5 10 1 1 180 0 1
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-T 79000 49900 5 10 0 1 0 0 1
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 }
 C 78900 51600 1 0 0 capacitor.sym
 {
@@ -1765,8 +1637,6 @@ T 77100 54900 5 10 1 1 0 0 1
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 }
 C 76600 53100 1 0 0 inductor.sym
 {
@@ -1780,8 +1650,6 @@ T 77100 53300 5 10 1 1 0 0 1
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-T 76600 53100 5 10 0 1 0 0 1
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 C 77900 52800 1 90 0 inductor.sym
 {
@@ -1795,8 +1663,6 @@ T 77900 52800 5 10 0 1 0 0 1
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 }
 C 76600 53600 1 0 0 capacitor.sym
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@@ -1810,8 +1676,6 @@ T 77100 54100 5 10 1 1 0 0 1
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-T 76600 53600 5 10 0 1 0 0 1
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 }
 N 76500 55400 76500 54700 4
 N 76600 55400 76500 55400 4
@@ -1840,8 +1704,6 @@ T 74000 54100 5 10 1 1 0 0 1
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-T 73400 53800 5 10 0 1 0 0 1
-loadstatus=smt
 }
 C 75100 54000 1 90 0 capacitor.sym
 {
@@ -1855,8 +1717,6 @@ T 75100 54200 5 10 1 1 0 0 1
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-T 75100 54000 5 10 0 1 0 0 1
-loadstatus=smt
 }
 C 73400 55000 1 0 0 capacitor.sym
 {
@@ -1870,8 +1730,6 @@ T 74000 55300 5 10 1 1 0 0 1
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-T 73400 55000 5 10 0 1 0 0 1
-loadstatus=smt
 }
 N 74900 54000 74300 54000 4
 N 74300 55200 74300 54800 4
@@ -1896,8 +1754,6 @@ T 75700 55700 5 10 1 1 0 0 1
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-T 75100 55400 5 10 0 1 0 0 1
-loadstatus=smt
 }
 C 73300 55800 1 0 0 capacitor.sym
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@@ -1911,8 +1767,6 @@ T 73900 56100 5 10 1 1 0 0 1
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-T 73300 55800 5 10 0 1 0 0 1
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 }
 C 74300 56200 1 0 0 capacitor.sym
 {
@@ -1926,8 +1780,6 @@ T 74900 56500 5 10 1 1 0 0 1
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-T 74300 56200 5 10 0 1 0 0 1
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 }
 C 74300 57000 1 0 0 capacitor.sym
 {
@@ -1941,8 +1793,6 @@ T 74900 57300 5 10 1 1 0 0 1
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 }
 N 73100 55600 75100 55600 4
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@@ -1997,8 +1847,6 @@ T 77100 55700 5 10 1 1 0 0 1
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-T 76600 55200 5 10 0 1 0 0 1
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 }
 C 69000 51300 1 90 0 resistor.sym
 {
@@ -2010,8 +1858,6 @@ T 69400 51600 5 10 1 1 180 0 1
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-T 69000 51300 5 10 0 1 0 0 1
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 }
 C 68300 55500 1 90 0 capacitor.sym
 {
@@ -2025,8 +1871,6 @@ T 68300 55500 5 10 0 0 90 0 1
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 }
 C 68800 51000 1 0 0 gnd.sym
 N 69500 56400 68100 56400 4
@@ -2046,8 +1890,6 @@ T 68100 57500 5 10 0 0 90 0 1
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 T 67800 57700 5 10 1 1 180 0 1
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-loadstatus=smt
 }
 C 67800 57200 1 0 0 gnd.sym
 C 67200 56800 1 0 0 3.3V-plus.sym
@@ -2063,8 +1905,6 @@ T 67600 55900 5 10 0 0 90 0 1
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 }
 C 67300 55600 1 0 0 gnd.sym
 C 68100 52800 1 0 0 3.3V-plus.sym
@@ -2080,8 +1920,6 @@ T 68500 51900 5 10 0 0 90 0 1
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 }
 C 68200 51600 1 0 0 gnd.sym
 C 67200 53600 1 0 0 3.3V-plus.sym
@@ -2097,8 +1935,6 @@ T 67600 52700 5 10 0 0 90 0 1
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 }
 C 67300 52400 1 0 0 gnd.sym
 N 69500 52800 68300 52800 4
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 }
 C 44400 43600 1 180 1 conn-6.sym
 {
@@ -2205,8 +2039,6 @@ T 61100 61600 5 10 0 0 0 0 1
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