From 4feac4f3a6ef7546d9e8f67441d36fdf940bb03f Mon Sep 17 00:00:00 2001 From: maartenbrock Date: Wed, 8 Feb 2006 22:23:29 +0000 Subject: [PATCH] * support/regression/ports/mcs51-xstack-auto/spec.mk: forgot -I(...)/mcs51 * all.dsp: corrected several bin paths * device/include/mcs51/c8051f120.h, * device/include/mcs51/c8051f300.h, * device/include/mcs51/c8051f310.h: used () with __at and renamed IDLE,STOP to PCON_IDLE,PCON_STOP * device/include/mcs51/c8051f320.h: see above, also added sfr16 definitions * device/lib/printf_large.c (output_float): fixed bug 1388703 * support/regression/tests/bug1057979.c: added test for bug 1388703 git-svn-id: https://sdcc.svn.sourceforge.net/svnroot/sdcc/trunk/sdcc@4033 4a8a32a2-be11-0410-ad9d-d568d2c75423 --- ChangeLog | 15 +- all.dsp | 14 +- device/include/mcs51/c8051f120.h | 768 +++++++++--------- device/include/mcs51/c8051f300.h | 356 ++++---- device/include/mcs51/c8051f310.h | 498 ++++++------ device/include/mcs51/c8051f320.h | 552 +++++++------ device/lib/printf_large.c | 13 +- .../ports/mcs51-xstack-auto/spec.mk | 2 +- support/regression/tests/bug1057979.c | 10 +- 9 files changed, 1137 insertions(+), 1091 deletions(-) diff --git a/ChangeLog b/ChangeLog index 0fc20305..b1b72ff2 100644 --- a/ChangeLog +++ b/ChangeLog @@ -1,3 +1,16 @@ +2006-02-08 Maarten Brock + + * support/regression/ports/mcs51-xstack-auto/spec.mk: forgot -I(...)/mcs51 + * all.dsp: corrected several bin paths + * device/include/mcs51/c8051f120.h, + * device/include/mcs51/c8051f300.h, + * device/include/mcs51/c8051f310.h: used () with __at and renamed IDLE,STOP + to PCON_IDLE,PCON_STOP + * device/include/mcs51/c8051f320.h: see above, also added sfr16 definitions + * device/lib/printf_large.c (output_float): fixed bug 1388703 + * support/regression/tests/bug1057979.c: added test for bug 1388703 + + 2006-02-08 Raphael Neider * src/pic/pcode.c (pciTRIS): fixed typo, @@ -84,7 +97,7 @@ 2006-01-18 Bernhard Held * src/SDCCast.c (backPatchLabels): fixed bug #1408066: made it - inifinitely recurseable, added static + inifinitely recurseable, added static * support/regression/tests/bug-1408066.c: added 2006-01-17 Bernhard Held diff --git a/all.dsp b/all.dsp index 538bb36b..f6e41444 100644 --- a/all.dsp +++ b/all.dsp @@ -221,7 +221,7 @@ SOURCE=".\bin_vc\link-gbz80.exe" # Begin Custom Build InputPath=".\bin_vc\link-gbz80.exe" -".\bin\link-gbz80.exe" : $(SOURCE) "$(INTDIR)" "$(OUTDIR)" +"bin\link-gbz80.exe" : $(SOURCE) "$(INTDIR)" "$(OUTDIR)" copy bin_vc\link-gbz80.exe bin /y > nul # End Custom Build @@ -232,7 +232,7 @@ InputPath=".\bin_vc\link-gbz80.exe" # Begin Custom Build InputPath=".\bin_vc\link-gbz80.exe" -".\bin\link-gbz80.exe" : $(SOURCE) "$(INTDIR)" "$(OUTDIR)" +"bin\link-gbz80.exe" : $(SOURCE) "$(INTDIR)" "$(OUTDIR)" copy bin_vc\link-gbz80.exe bin /y > nul # End Custom Build @@ -249,7 +249,7 @@ SOURCE=".\bin_vc\link-hc08.exe" # Begin Custom Build InputPath=".\bin_vc\link-hc08.exe" -".\bin\link-hc08.exe" : $(SOURCE) "$(INTDIR)" "$(OUTDIR)" +"bin\link-hc08.exe" : $(SOURCE) "$(INTDIR)" "$(OUTDIR)" copy bin_vc\link-hc08.exe bin /y > nul # End Custom Build @@ -260,7 +260,7 @@ InputPath=".\bin_vc\link-hc08.exe" # Begin Custom Build InputPath=".\bin_vc\link-hc08.exe" -".\bin\link-hc08.exe" : $(SOURCE) "$(INTDIR)" "$(OUTDIR)" +"bin\link-hc08.exe" : $(SOURCE) "$(INTDIR)" "$(OUTDIR)" copy bin_vc\link-hc08.exe bin /y > nul # End Custom Build @@ -278,7 +278,7 @@ SOURCE=".\bin_vc\link-z80.exe" # Begin Custom Build InputPath=".\bin_vc\link-z80.exe" -".\bin\link-z80.exe" : $(SOURCE) "$(INTDIR)" "$(OUTDIR)" +"bin\link-z80.exe" : $(SOURCE) "$(INTDIR)" "$(OUTDIR)" copy bin_vc\link-z80.exe bin /y > nul # End Custom Build @@ -289,7 +289,7 @@ InputPath=".\bin_vc\link-z80.exe" # Begin Custom Build InputPath=".\bin_vc\link-z80.exe" -".\bin\link-z80.exe" : $(SOURCE) "$(INTDIR)" "$(OUTDIR)" +"bin\link-z80.exe" : $(SOURCE) "$(INTDIR)" "$(OUTDIR)" copy bin_vc\link-z80.exe bin /y > nul # End Custom Build @@ -405,7 +405,7 @@ InputPath=.\bin_vc\sdcpp.exe # Begin Custom Build InputPath=.\bin_vc\sdcpp.exe -".bin\sdcpp.exe" : $(SOURCE) "$(INTDIR)" "$(OUTDIR)" +"bin\sdcpp.exe" : $(SOURCE) "$(INTDIR)" "$(OUTDIR)" copy bin_vc\sdcpp.exe bin /y > nul # End Custom Build diff --git a/device/include/mcs51/c8051f120.h b/device/include/mcs51/c8051f120.h index b43b8b6a..661ac954 100644 --- a/device/include/mcs51/c8051f120.h +++ b/device/include/mcs51/c8051f120.h @@ -25,471 +25,471 @@ /* BYTE Registers */ /* All Pages */ -__sfr __at 0x80 P0 ; /* PORT 0 */ -__sfr __at 0x81 SP ; /* STACK POINTER */ -__sfr __at 0x82 DPL ; /* DATA POINTER - LOW BYTE */ -__sfr __at 0x83 DPH ; /* DATA POINTER - HIGH BYTE */ -__sfr __at 0x84 SFRPAGE ; /* SFR PAGE SELECT */ -__sfr __at 0x85 SFRNEXT ; /* SFR STACK NEXT PAGE */ -__sfr __at 0x86 SFRLAST ; /* SFR STACK LAST PAGE */ -__sfr __at 0x87 PCON ; /* POWER CONTROL */ -__sfr __at 0x90 P1 ; /* PORT 1 */ -__sfr __at 0xA0 P2 ; /* PORT 2 */ -__sfr __at 0xA8 IE ; /* INTERRUPT ENABLE */ -__sfr __at 0xB0 P3 ; /* PORT 3 */ -__sfr __at 0xB1 PSBANK ; /* FLASH BANK SELECT */ -__sfr __at 0xB8 IP ; /* INTERRUPT PRIORITY */ -__sfr __at 0xD0 PSW ; /* PROGRAM STATUS WORD */ -__sfr __at 0xE0 ACC ; /* ACCUMULATOR */ -__sfr __at 0xE6 EIE1 ; /* EXTERNAL INTERRUPT ENABLE 1 */ -__sfr __at 0xE7 EIE2 ; /* EXTERNAL INTERRUPT ENABLE 2 */ -__sfr __at 0xF0 B ; /* B REGISTER */ -__sfr __at 0xF6 EIP1 ; /* EXTERNAL INTERRUPT PRIORITY REGISTER 1 */ -__sfr __at 0xF7 EIP2 ; /* EXTERNAL INTERRUPT PRIORITY REGISTER 2 */ -__sfr __at 0xFF WDTCN ; /* WATCHDOG TIMER CONTROL */ +__sfr __at (0x80) P0 ; /* PORT 0 */ +__sfr __at (0x81) SP ; /* STACK POINTER */ +__sfr __at (0x82) DPL ; /* DATA POINTER - LOW BYTE */ +__sfr __at (0x83) DPH ; /* DATA POINTER - HIGH BYTE */ +__sfr __at (0x84) SFRPAGE ; /* SFR PAGE SELECT */ +__sfr __at (0x85) SFRNEXT ; /* SFR STACK NEXT PAGE */ +__sfr __at (0x86) SFRLAST ; /* SFR STACK LAST PAGE */ +__sfr __at (0x87) PCON ; /* POWER CONTROL */ +__sfr __at (0x90) P1 ; /* PORT 1 */ +__sfr __at (0xA0) P2 ; /* PORT 2 */ +__sfr __at (0xA8) IE ; /* INTERRUPT ENABLE */ +__sfr __at (0xB0) P3 ; /* PORT 3 */ +__sfr __at (0xB1) PSBANK ; /* FLASH BANK SELECT */ +__sfr __at (0xB8) IP ; /* INTERRUPT PRIORITY */ +__sfr __at (0xD0) PSW ; /* PROGRAM STATUS WORD */ +__sfr __at (0xE0) ACC ; /* ACCUMULATOR */ +__sfr __at (0xE6) EIE1 ; /* EXTERNAL INTERRUPT ENABLE 1 */ +__sfr __at (0xE7) EIE2 ; /* EXTERNAL INTERRUPT ENABLE 2 */ +__sfr __at (0xF0) B ; /* B REGISTER */ +__sfr __at (0xF6) EIP1 ; /* EXTERNAL INTERRUPT PRIORITY REGISTER 1 */ +__sfr __at (0xF7) EIP2 ; /* EXTERNAL INTERRUPT PRIORITY REGISTER 2 */ +__sfr __at (0xFF) WDTCN ; /* WATCHDOG TIMER CONTROL */ /* Page 0x00 */ -__sfr __at 0x88 TCON ; /* TIMER CONTROL */ -__sfr __at 0x89 TMOD ; /* TIMER MODE */ -__sfr __at 0x8A TL0 ; /* TIMER 0 - LOW BYTE */ -__sfr __at 0x8B TL1 ; /* TIMER 1 - LOW BYTE */ -__sfr __at 0x8C TH0 ; /* TIMER 0 - HIGH BYTE */ -__sfr __at 0x8D TH1 ; /* TIMER 1 - HIGH BYTE */ -__sfr __at 0x8E CKCON ; /* TIMER 0/1 CLOCK CONTROL */ -__sfr __at 0x8F PSCTL ; /* FLASH WRITE/ERASE CONTROL */ -__sfr __at 0x91 SSTA0 ; /* UART 0 STATUS */ -__sfr __at 0x98 SCON0 ; /* UART 0 CONTROL */ -__sfr __at 0x98 SCON ; /* UART 0 CONTROL */ -__sfr __at 0x99 SBUF0 ; /* UART 0 BUFFER */ -__sfr __at 0x99 SBUF ; /* UART 0 BUFFER */ -__sfr __at 0x9A SPI0CFG ; /* SPI 0 CONFIGURATION */ -__sfr __at 0x9B SPI0DAT ; /* SPI 0 DATA */ -__sfr __at 0x9D SPI0CKR ; /* SPI 0 CLOCK RATE CONTROL */ -__sfr __at 0xA1 EMI0TC ; /* EMIF TIMING CONTROL */ -__sfr __at 0xA2 EMI0CN ; /* EMIF CONTROL */ -__sfr __at 0xA2 _XPAGE ; /* XDATA/PDATA PAGE */ -__sfr __at 0xA3 EMI0CF ; /* EMIF CONFIGURATION */ -__sfr __at 0xA9 SADDR0 ; /* UART 0 SLAVE ADDRESS */ -__sfr __at 0xB7 FLSCL ; /* FLASH SCALE */ -__sfr __at 0xB9 SADEN0 ; /* UART 0 SLAVE ADDRESS MASK */ -__sfr __at 0xBA AMX0CF ; /* ADC 0 MUX CONFIGURATION */ -__sfr __at 0xBB AMX0SL ; /* ADC 0 MUX CHANNEL SELECTION */ -__sfr __at 0xBC ADC0CF ; /* ADC 0 CONFIGURATION */ -__sfr __at 0xBE ADC0L ; /* ADC 0 DATA - LOW BYTE */ -__sfr __at 0xBF ADC0H ; /* ADC 0 DATA - HIGH BYTE */ -__sfr __at 0xC0 SMB0CN ; /* SMBUS 0 CONTROL */ -__sfr __at 0xC1 SMB0STA ; /* SMBUS 0 STATUS */ -__sfr __at 0xC2 SMB0DAT ; /* SMBUS 0 DATA */ -__sfr __at 0xC3 SMB0ADR ; /* SMBUS 0 SLAVE ADDRESS */ -__sfr __at 0xC4 ADC0GTL ; /* ADC 0 GREATER-THAN REGISTER - LOW BYTE */ -__sfr __at 0xC5 ADC0GTH ; /* ADC 0 GREATER-THAN REGISTER - HIGH BYTE */ -__sfr __at 0xC6 ADC0LTL ; /* ADC 0 LESS-THAN REGISTER - LOW BYTE */ -__sfr __at 0xC7 ADC0LTH ; /* ADC 0 LESS-THAN REGISTER - HIGH BYTE */ -__sfr __at 0xC8 TMR2CN ; /* TIMER 2 CONTROL */ -__sfr __at 0xC9 TMR2CF ; /* TIMER 2 CONFIGURATION */ -__sfr __at 0xCA RCAP2L ; /* TIMER 2 CAPTURE REGISTER - LOW BYTE */ -__sfr __at 0xCB RCAP2H ; /* TIMER 2 CAPTURE REGISTER - HIGH BYTE */ -__sfr __at 0xCC TMR2L ; /* TIMER 2 - LOW BYTE */ -__sfr __at 0xCC TL2 ; /* TIMER 2 - LOW BYTE */ -__sfr __at 0xCD TMR2H ; /* TIMER 2 - HIGH BYTE */ -__sfr __at 0xCD TH2 ; /* TIMER 2 - HIGH BYTE */ -__sfr __at 0xCF SMB0CR ; /* SMBUS 0 CLOCK RATE */ -__sfr __at 0xD1 REF0CN ; /* VOLTAGE REFERENCE 0 CONTROL */ -__sfr __at 0xD2 DAC0L ; /* DAC 0 REGISTER - LOW BYTE */ -__sfr __at 0xD3 DAC0H ; /* DAC 0 REGISTER - HIGH BYTE */ -__sfr __at 0xD4 DAC0CN ; /* DAC 0 CONTROL */ -__sfr __at 0xD8 PCA0CN ; /* PCA 0 COUNTER CONTROL */ -__sfr __at 0xD9 PCA0MD ; /* PCA 0 COUNTER MODE */ -__sfr __at 0xDA PCA0CPM0 ; /* PCA 0 MODULE 0 CONTROL */ -__sfr __at 0xDB PCA0CPM1 ; /* PCA 0 MODULE 1 CONTROL */ -__sfr __at 0xDC PCA0CPM2 ; /* PCA 0 MODULE 2 CONTROL */ -__sfr __at 0xDD PCA0CPM3 ; /* PCA 0 MODULE 3 CONTROL */ -__sfr __at 0xDE PCA0CPM4 ; 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/* PCA 0 MODULE 0 CAPTURE/COMPARE - HIGH BYTE */ -__sfr __at 0xFD PCA0CPL1 ; /* PCA 0 MODULE 1 CAPTURE/COMPARE - LOW BYTE */ -__sfr __at 0xFE PCA0CPH1 ; /* PCA 0 MODULE 1 CAPTURE/COMPARE - HIGH BYTE */ +__sfr __at (0x88) TCON ; /* TIMER CONTROL */ +__sfr __at (0x89) TMOD ; /* TIMER MODE */ +__sfr __at (0x8A) TL0 ; /* TIMER 0 - LOW BYTE */ +__sfr __at (0x8B) TL1 ; /* TIMER 1 - LOW BYTE */ +__sfr __at (0x8C) TH0 ; /* TIMER 0 - HIGH BYTE */ +__sfr __at (0x8D) TH1 ; /* TIMER 1 - HIGH BYTE */ +__sfr __at (0x8E) CKCON ; /* TIMER 0/1 CLOCK CONTROL */ +__sfr __at (0x8F) PSCTL ; /* FLASH WRITE/ERASE CONTROL */ +__sfr __at (0x91) SSTA0 ; /* UART 0 STATUS */ +__sfr __at (0x98) SCON0 ; /* UART 0 CONTROL */ +__sfr __at (0x98) SCON ; /* UART 0 CONTROL */ +__sfr __at (0x99) SBUF0 ; /* UART 0 BUFFER */ +__sfr __at (0x99) SBUF ; /* UART 0 BUFFER */ +__sfr __at (0x9A) SPI0CFG ; /* SPI 0 CONFIGURATION */ +__sfr __at (0x9B) SPI0DAT ; /* SPI 0 DATA */ +__sfr __at (0x9D) SPI0CKR ; /* SPI 0 CLOCK RATE CONTROL */ +__sfr __at (0xA1) EMI0TC ; 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/* ADC 2 MUX CONFIGURATION */ -__sfr __at 0xBB AMX2SL ; /* ADC 2 MUX CHANNEL SELECTION */ -__sfr __at 0xBC ADC2CF ; /* ADC 2 CONFIGURATION */ -__sfr __at 0xBE ADC2 ; /* ADC 2 DATA */ -__sfr __at 0xC4 ADC2GT ; /* ADC 2 GREATER-THAN REGISTER */ -__sfr __at 0xC6 ADC2LT ; /* ADC 2 LESS-THAN REGISTER */ -__sfr __at 0xC8 TMR4CN ; /* TIMER 4 CONTROL */ -__sfr __at 0xC9 TMR4CF ; /* TIMER 4 CONFIGURATION */ -__sfr __at 0xCA RCAP4L ; /* TIMER 4 CAPTURE REGISTER - LOW BYTE */ -__sfr __at 0xCB RCAP4H ; /* TIMER 4 CAPTURE REGISTER - HIGH BYTE */ -__sfr __at 0xCC TMR4L ; /* TIMER 4 - LOW BYTE */ -__sfr __at 0xCD TMR4H ; /* TIMER 4 - HIGH BYTE */ -__sfr __at 0xE8 ADC2CN ; /* ADC 2 CONTROL */ +__sfr __at (0x88) CPT1CN ; /* COMPARATOR 1 CONTROL */ +__sfr __at (0x89) CPT1MD ; /* COMPARATOR 1 CONFIGURATION */ +__sfr __at (0xBA) AMX2CF ; /* ADC 2 MUX CONFIGURATION */ +__sfr __at (0xBB) AMX2SL ; /* ADC 2 MUX CHANNEL SELECTION */ +__sfr __at (0xBC) ADC2CF ; /* ADC 2 CONFIGURATION */ +__sfr __at (0xBE) ADC2 ; /* ADC 2 DATA */ +__sfr __at (0xC4) ADC2GT ; /* ADC 2 GREATER-THAN REGISTER */ +__sfr __at (0xC6) ADC2LT ; /* ADC 2 LESS-THAN REGISTER */ +__sfr __at (0xC8) TMR4CN ; /* TIMER 4 CONTROL */ +__sfr __at (0xC9) TMR4CF ; /* TIMER 4 CONFIGURATION */ +__sfr __at (0xCA) RCAP4L ; /* TIMER 4 CAPTURE REGISTER - LOW BYTE */ +__sfr __at (0xCB) RCAP4H ; /* TIMER 4 CAPTURE REGISTER - HIGH BYTE */ +__sfr __at (0xCC) TMR4L ; /* TIMER 4 - LOW BYTE */ +__sfr __at (0xCD) TMR4H ; /* TIMER 4 - HIGH BYTE */ +__sfr __at (0xE8) ADC2CN ; /* ADC 2 CONTROL */ /* Page 0x03 */ -__sfr __at 0x91 MAC0BL ; /* MAC0 B Register Low Byte */ -__sfr __at 0x92 MAC0BH ; /* MAC0 B Register High Byte */ -__sfr __at 0x93 MAC0ACC0 ; /* MAC0 Accumulator Byte 0 (LSB) */ -__sfr __at 0x94 MAC0ACC1 ; /* MAC0 Accumulator Byte 1 */ -__sfr __at 0x95 MAC0ACC2 ; /* MAC0 Accumulator Byte 2 */ -__sfr __at 0x96 MAC0ACC3 ; /* MAC0 Accumulator Byte 3 (MSB) */ -__sfr __at 0x97 MAC0OVR ; /* MAC0 Accumulator Overflow */ -__sfr __at 0xC0 MAC0STA ; /* MAC0 Status Register */ -__sfr __at 0xC1 MAC0AL ; /* MAC0 A Register Low Byte */ -__sfr __at 0xC2 MAC0AH ; /* MAC0 A Register High Byte */ -__sfr __at 0xC3 MAC0CF ; /* MAC0 Configuration */ -__sfr __at 0xCE MAC0RNDL ; /* MAC0 Rounding Register Low Byte */ -__sfr __at 0xCF MAC0RNDH ; /* MAC0 Rounding Register High Byte */ +__sfr __at (0x91) MAC0BL ; /* MAC0 B Register Low Byte */ +__sfr __at (0x92) MAC0BH ; /* MAC0 B Register High Byte */ +__sfr __at (0x93) MAC0ACC0 ; /* MAC0 Accumulator Byte 0 (LSB) */ +__sfr __at (0x94) MAC0ACC1 ; /* MAC0 Accumulator Byte 1 */ +__sfr __at (0x95) MAC0ACC2 ; /* MAC0 Accumulator Byte 2 */ +__sfr __at (0x96) MAC0ACC3 ; /* MAC0 Accumulator Byte 3 (MSB) */ +__sfr __at (0x97) MAC0OVR ; /* MAC0 Accumulator Overflow */ +__sfr __at (0xC0) MAC0STA ; /* MAC0 Status Register */ +__sfr __at (0xC1) MAC0AL ; /* MAC0 A Register Low Byte */ +__sfr __at (0xC2) MAC0AH ; /* MAC0 A Register High Byte */ +__sfr __at (0xC3) MAC0CF ; /* MAC0 Configuration */ +__sfr __at (0xCE) MAC0RNDL ; /* MAC0 Rounding Register Low Byte */ +__sfr __at (0xCF) MAC0RNDH ; /* MAC0 Rounding Register High Byte */ /* Page 0x0F */ -__sfr __at 0x88 FLSTAT ; /* FLASH STATUS */ -__sfr __at 0x89 PLL0CN ; /* PLL 0 CONTROL */ -__sfr __at 0x8A OSCICN ; /* INTERNAL OSCILLATOR CONTROL */ -__sfr __at 0x8B OSCICL ; /* INTERNAL OSCILLATOR CALIBRATION */ -__sfr __at 0x8C OSCXCN ; /* EXTERNAL OSCILLATOR CONTROL */ -__sfr __at 0x8D PLL0DIV ; /* PLL 0 DIVIDER */ -__sfr __at 0x8E PLL0MUL ; /* PLL 0 MULTIPLIER */ -__sfr __at 0x8F PLL0FLT ; /* PLL 0 FILTER */ -__sfr __at 0x96 SFRPGCN ; /* SFR PAGE CONTROL */ -__sfr __at 0x97 CLKSEL ; /* SYSTEM CLOCK SELECT */ -__sfr __at 0x9A CCH0MA ; /* CACHE MISS ACCUMULATOR */ -__sfr __at 0x9C P4MDOUT ; /* PORT 4 OUTPUT MODE */ -__sfr __at 0x9D P5MDOUT ; /* PORT 5 OUTPUT MODE */ -__sfr __at 0x9E P6MDOUT ; /* PORT 6 OUTPUT MODE */ -__sfr __at 0x9F P7MDOUT ; /* PORT 7 OUTPUT MODE */ -__sfr __at 0xA1 CCH0CN ; /* CACHE CONTROL */ -__sfr __at 0xA2 CCH0TN ; /* CACHE TUNING REGISTER */ -__sfr __at 0xA3 CCH0LC ; /* CACHE LOCK */ -__sfr __at 0xA4 P0MDOUT ; /* PORT 0 OUTPUT MODE */ -__sfr __at 0xA5 P1MDOUT ; /* PORT 1 OUTPUT MODE */ -__sfr __at 0xA6 P2MDOUT ; /* PORT 2 OUTPUT MODE CONFIGURATION */ -__sfr __at 0xA7 P3MDOUT ; /* PORT 3 OUTPUT MODE CONFIGURATION */ -__sfr __at 0xAD P1MDIN ; /* PORT 1 INPUT MODE */ -__sfr __at 0xB7 FLACL ; /* FLASH ACCESS LIMIT */ -__sfr __at 0xC8 P4 ; /* PORT 4 */ -__sfr __at 0xD8 P5 ; /* PORT 5 */ -__sfr __at 0xE1 XBR0 ; /* CROSSBAR CONFIGURATION REGISTER 0 */ -__sfr __at 0xE2 XBR1 ; /* CROSSBAR CONFIGURATION REGISTER 1 */ -__sfr __at 0xE3 XBR2 ; /* CROSSBAR CONFIGURATION REGISTER 2 */ -__sfr __at 0xE8 P6 ; /* PORT 6 */ -__sfr __at 0xF8 P7 ; /* PORT 7 */ +__sfr __at (0x88) FLSTAT ; /* FLASH STATUS */ +__sfr __at (0x89) PLL0CN ; /* PLL 0 CONTROL */ +__sfr __at (0x8A) OSCICN ; /* INTERNAL OSCILLATOR CONTROL */ +__sfr __at (0x8B) OSCICL ; /* INTERNAL OSCILLATOR CALIBRATION */ +__sfr __at (0x8C) OSCXCN ; /* EXTERNAL OSCILLATOR CONTROL */ +__sfr __at (0x8D) PLL0DIV ; /* PLL 0 DIVIDER */ +__sfr __at (0x8E) PLL0MUL ; /* PLL 0 MULTIPLIER */ +__sfr __at (0x8F) PLL0FLT ; /* PLL 0 FILTER */ +__sfr __at (0x96) SFRPGCN ; /* SFR PAGE CONTROL */ +__sfr __at (0x97) CLKSEL ; /* SYSTEM CLOCK SELECT */ +__sfr __at (0x9A) CCH0MA ; /* CACHE MISS ACCUMULATOR */ +__sfr __at (0x9C) P4MDOUT ; /* PORT 4 OUTPUT MODE */ +__sfr __at (0x9D) P5MDOUT ; /* PORT 5 OUTPUT MODE */ +__sfr __at (0x9E) P6MDOUT ; /* PORT 6 OUTPUT MODE */ +__sfr __at (0x9F) P7MDOUT ; /* PORT 7 OUTPUT MODE */ +__sfr __at (0xA1) CCH0CN ; /* CACHE CONTROL */ +__sfr __at (0xA2) CCH0TN ; /* CACHE TUNING REGISTER */ +__sfr __at (0xA3) CCH0LC ; /* CACHE LOCK */ +__sfr __at (0xA4) P0MDOUT ; /* PORT 0 OUTPUT MODE */ +__sfr __at (0xA5) P1MDOUT ; /* PORT 1 OUTPUT MODE */ +__sfr __at (0xA6) P2MDOUT ; /* PORT 2 OUTPUT MODE CONFIGURATION */ +__sfr __at (0xA7) P3MDOUT ; /* PORT 3 OUTPUT MODE CONFIGURATION */ +__sfr __at (0xAD) P1MDIN ; /* PORT 1 INPUT MODE */ +__sfr __at (0xB7) FLACL ; /* FLASH ACCESS LIMIT */ +__sfr __at (0xC8) P4 ; /* PORT 4 */ +__sfr __at (0xD8) P5 ; /* PORT 5 */ +__sfr __at (0xE1) XBR0 ; /* CROSSBAR CONFIGURATION REGISTER 0 */ +__sfr __at (0xE2) XBR1 ; /* CROSSBAR CONFIGURATION REGISTER 1 */ +__sfr __at (0xE3) XBR2 ; /* CROSSBAR CONFIGURATION REGISTER 2 */ +__sfr __at (0xE8) P6 ; /* PORT 6 */ +__sfr __at (0xF8) P7 ; /* PORT 7 */ /* WORD/DWORD Registers */ /* Page 0x00 */ -__sfr16 __at 0x8C8A TMR0 ; /* TIMER 0 COUNTER */ -__sfr16 __at 0x8D8B TMR1 ; /* TIMER 1 COUNTER */ -__sfr16 __at 0xCDCC TMR2 ; /* TIMER 2 COUNTER */ -__sfr16 __at 0xCBCA RCAP2 ; /* TIMER 2 CAPTURE REGISTER WORD */ -__sfr16 __at 0xBFBE ADC0 ; /* ADC 0 DATA WORD */ -__sfr16 __at 0xC5C4 ADC0GT ; /* ADC 0 GREATER-THAN REGISTER WORD */ -__sfr16 __at 0xC7C6 ADC0LT ; /* ADC 0 LESS-THAN REGISTER WORD */ -__sfr16 __at 0xD3D2 DAC0 ; /* DAC 0 REGISTER WORD */ -__sfr16 __at 0xFAF9 PCA0 ; /* PCA 0 TIMER COUNTER */ -__sfr16 __at 0xFCFB PCA0CP0 ; /* PCA 0 MODULE 0 CAPTURE/COMPARE WORD */ -__sfr16 __at 0xFEFD PCA0CP1 ; /* PCA 0 MODULE 1 CAPTURE/COMPARE WORD */ -__sfr16 __at 0xEAE9 PCA0CP2 ; /* PCA 0 MODULE 2 CAPTURE/COMPARE WORD */ -__sfr16 __at 0xECEB PCA0CP3 ; /* PCA 0 MODULE 3 CAPTURE/COMPARE WORD */ -__sfr16 __at 0xEEED PCA0CP4 ; /* PCA 0 MODULE 4 CAPTURE/COMPARE WORD */ -__sfr16 __at 0xE2E1 PCA0CP5 ; /* PCA 0 MODULE 5 CAPTURE/COMPARE WORD */ +__sfr16 __at (0x8C8A) TMR0 ; /* TIMER 0 COUNTER */ +__sfr16 __at (0x8D8B) TMR1 ; /* TIMER 1 COUNTER */ +__sfr16 __at (0xCDCC) TMR2 ; /* TIMER 2 COUNTER */ +__sfr16 __at (0xCBCA) RCAP2 ; /* TIMER 2 CAPTURE REGISTER WORD */ +__sfr16 __at (0xBFBE) ADC0 ; /* ADC 0 DATA WORD */ +__sfr16 __at (0xC5C4) ADC0GT ; /* ADC 0 GREATER-THAN REGISTER WORD */ +__sfr16 __at (0xC7C6) ADC0LT ; /* ADC 0 LESS-THAN REGISTER WORD */ +__sfr16 __at (0xD3D2) DAC0 ; /* DAC 0 REGISTER WORD */ +__sfr16 __at (0xFAF9) PCA0 ; /* PCA 0 TIMER COUNTER */ +__sfr16 __at (0xFCFB) PCA0CP0 ; /* PCA 0 MODULE 0 CAPTURE/COMPARE WORD */ +__sfr16 __at (0xFEFD) PCA0CP1 ; /* PCA 0 MODULE 1 CAPTURE/COMPARE WORD */ +__sfr16 __at (0xEAE9) PCA0CP2 ; /* PCA 0 MODULE 2 CAPTURE/COMPARE WORD */ +__sfr16 __at (0xECEB) PCA0CP3 ; /* PCA 0 MODULE 3 CAPTURE/COMPARE WORD */ +__sfr16 __at (0xEEED) PCA0CP4 ; /* PCA 0 MODULE 4 CAPTURE/COMPARE WORD */ +__sfr16 __at (0xE2E1) PCA0CP5 ; /* PCA 0 MODULE 5 CAPTURE/COMPARE WORD */ /* Page 0x01 */ -__sfr16 __at 0xCDCC TMR3 ; /* TIMER 3 COUNTER */ -__sfr16 __at 0xCBCA RCAP3 ; /* TIMER 3 CAPTURE REGISTER WORD */ -__sfr16 __at 0xD3D2 DAC1 ; /* DAC 1 REGISTER WORD */ +__sfr16 __at (0xCDCC) TMR3 ; /* TIMER 3 COUNTER */ +__sfr16 __at (0xCBCA) RCAP3 ; /* TIMER 3 CAPTURE REGISTER WORD */ +__sfr16 __at (0xD3D2) DAC1 ; /* DAC 1 REGISTER WORD */ /* Page 0x02 */ -__sfr16 __at 0xCDCC TMR4 ; /* TIMER 4 COUNTER */ -__sfr16 __at 0xCBCA RCAP4 ; /* TIMER 4 CAPTURE REGISTER WORD */ +__sfr16 __at (0xCDCC) TMR4 ; /* TIMER 4 COUNTER */ +__sfr16 __at (0xCBCA) RCAP4 ; /* TIMER 4 CAPTURE REGISTER WORD */ /* Page 0x03 */ -__sfr16 __at 0xC2C1 MAC0A ; /* MAC0 A Register */ +__sfr16 __at (0xC2C1) MAC0A ; /* MAC0 A Register */ /* No sfr16 definition for MAC0B because MAC0BL must be written last */ -__sfr32 __at 0x96959493 MAC0ACC ; /* MAC0 Accumulator */ -__sfr16 __at 0xCFCE MAC0RND ; /* MAC0 Rounding Register */ +__sfr32 __at (0x96959493) MAC0ACC ; /* MAC0 Accumulator */ +__sfr16 __at (0xCFCE) MAC0RND ; /* MAC0 Rounding Register */ /* BIT Registers */ /* P0 0x80 */ -__sbit __at 0x80 P0_0 ; -__sbit __at 0x81 P0_1 ; -__sbit __at 0x82 P0_2 ; -__sbit __at 0x83 P0_3 ; -__sbit __at 0x84 P0_4 ; -__sbit __at 0x85 P0_5 ; -__sbit __at 0x86 P0_6 ; -__sbit __at 0x87 P0_7 ; +__sbit __at (0x80) P0_0 ; +__sbit __at (0x81) P0_1 ; +__sbit __at (0x82) P0_2 ; +__sbit __at (0x83) P0_3 ; +__sbit __at (0x84) P0_4 ; +__sbit __at (0x85) P0_5 ; +__sbit __at (0x86) P0_6 ; +__sbit __at (0x87) P0_7 ; /* TCON 0x88 */ -__sbit __at 0x88 IT0 ; /* EXT. INTERRUPT 0 TYPE */ -__sbit __at 0x89 IE0 ; /* EXT. INTERRUPT 0 EDGE FLAG */ -__sbit __at 0x8A IT1 ; /* EXT. INTERRUPT 1 TYPE */ -__sbit __at 0x8B IE1 ; /* EXT. INTERRUPT 1 EDGE FLAG */ -__sbit __at 0x8C TR0 ; /* TIMER 0 ON/OFF CONTROL */ -__sbit __at 0x8D TF0 ; /* TIMER 0 OVERFLOW FLAG */ -__sbit __at 0x8E TR1 ; /* TIMER 1 ON/OFF CONTROL */ -__sbit __at 0x8F TF1 ; /* TIMER 1 OVERFLOW FLAG */ +__sbit __at (0x88) IT0 ; /* EXT. INTERRUPT 0 TYPE */ +__sbit __at (0x89) IE0 ; /* EXT. INTERRUPT 0 EDGE FLAG */ +__sbit __at (0x8A) IT1 ; /* EXT. INTERRUPT 1 TYPE */ +__sbit __at (0x8B) IE1 ; /* EXT. INTERRUPT 1 EDGE FLAG */ +__sbit __at (0x8C) TR0 ; /* TIMER 0 ON/OFF CONTROL */ +__sbit __at (0x8D) TF0 ; /* TIMER 0 OVERFLOW FLAG */ +__sbit __at (0x8E) TR1 ; /* TIMER 1 ON/OFF CONTROL */ +__sbit __at (0x8F) TF1 ; /* TIMER 1 OVERFLOW FLAG */ /* CPT0CN 0x88 */ -__sbit __at 0x88 CP0HYN0 ; /* COMPARATOR 0 NEGATIVE HYSTERESIS 0 */ -__sbit __at 0x89 CP0HYN1 ; /* COMPARATOR 0 NEGATIVE HYSTERESIS 1 */ -__sbit __at 0x8A CP0HYP0 ; /* COMPARATOR 0 POSITIVE HYSTERESIS 0 */ -__sbit __at 0x8B CP0HYP1 ; /* COMPARATOR 0 POSITIVE HYSTERESIS 1 */ -__sbit __at 0x8C CP0FIF ; /* COMPARATOR 0 FALLING EDGE INTERRUPT */ -__sbit __at 0x8D CP0RIF ; /* COMPARATOR 0 RISING EDGE INTERRUPT */ -__sbit __at 0x8E CP0OUT ; /* COMPARATOR 0 OUTPUT */ -__sbit __at 0x8F CP0EN ; /* COMPARATOR 0 ENABLE */ +__sbit __at (0x88) CP0HYN0 ; /* COMPARATOR 0 NEGATIVE HYSTERESIS 0 */ +__sbit __at (0x89) CP0HYN1 ; /* COMPARATOR 0 NEGATIVE HYSTERESIS 1 */ +__sbit __at (0x8A) CP0HYP0 ; /* COMPARATOR 0 POSITIVE HYSTERESIS 0 */ +__sbit __at (0x8B) CP0HYP1 ; /* COMPARATOR 0 POSITIVE HYSTERESIS 1 */ +__sbit __at (0x8C) CP0FIF ; /* COMPARATOR 0 FALLING EDGE INTERRUPT */ +__sbit __at (0x8D) CP0RIF ; /* COMPARATOR 0 RISING EDGE INTERRUPT */ +__sbit __at (0x8E) CP0OUT ; /* COMPARATOR 0 OUTPUT */ +__sbit __at (0x8F) CP0EN ; /* COMPARATOR 0 ENABLE */ /* CPT1CN 0x88 */ -__sbit __at 0x88 CP1HYN0 ; /* COMPARATOR 1 NEGATIVE HYSTERESIS 0 */ -__sbit __at 0x89 CP1HYN1 ; /* COMPARATOR 1 NEGATIVE HYSTERESIS 1 */ -__sbit __at 0x8A CP1HYP0 ; /* COMPARATOR 1 POSITIVE HYSTERESIS 0 */ -__sbit __at 0x8B CP1HYP1 ; /* COMPARATOR 1 POSITIVE HYSTERESIS 1 */ -__sbit __at 0x8C CP1FIF ; /* COMPARATOR 1 FALLING EDGE INTERRUPT */ -__sbit __at 0x8D CP1RIF ; /* COMPARATOR 1 RISING EDGE INTERRUPT */ -__sbit __at 0x8E CP1OUT ; /* COMPARATOR 1 OUTPUT */ -__sbit __at 0x8F CP1EN ; /* COMPARATOR 1 ENABLE */ +__sbit __at (0x88) CP1HYN0 ; /* COMPARATOR 1 NEGATIVE HYSTERESIS 0 */ +__sbit __at (0x89) CP1HYN1 ; /* COMPARATOR 1 NEGATIVE HYSTERESIS 1 */ +__sbit __at (0x8A) CP1HYP0 ; /* COMPARATOR 1 POSITIVE HYSTERESIS 0 */ +__sbit __at (0x8B) CP1HYP1 ; /* COMPARATOR 1 POSITIVE HYSTERESIS 1 */ +__sbit __at (0x8C) CP1FIF ; /* COMPARATOR 1 FALLING EDGE INTERRUPT */ +__sbit __at (0x8D) CP1RIF ; /* COMPARATOR 1 RISING EDGE INTERRUPT */ +__sbit __at (0x8E) CP1OUT ; /* COMPARATOR 1 OUTPUT */ +__sbit __at (0x8F) CP1EN ; /* COMPARATOR 1 ENABLE */ /* FLSTAT 0x88 */ -__sbit __at 0x88 FLHBUSY ; /* FLASH BUSY */ +__sbit __at (0x88) FLHBUSY ; /* FLASH BUSY */ /* P1 0x90 */ -__sbit __at 0x90 P1_0 ; -__sbit __at 0x91 P1_1 ; -__sbit __at 0x92 P1_2 ; -__sbit __at 0x93 P1_3 ; -__sbit __at 0x94 P1_4 ; -__sbit __at 0x95 P1_5 ; -__sbit __at 0x96 P1_6 ; -__sbit __at 0x97 P1_7 ; +__sbit __at (0x90) P1_0 ; +__sbit __at (0x91) P1_1 ; +__sbit __at (0x92) P1_2 ; +__sbit __at (0x93) P1_3 ; +__sbit __at (0x94) P1_4 ; +__sbit __at (0x95) P1_5 ; +__sbit __at (0x96) P1_6 ; +__sbit __at (0x97) P1_7 ; /* SCON0 0x98 */ -__sbit __at 0x98 RI0 ; /* UART 0 RX INTERRUPT FLAG */ -__sbit __at 0x98 RI ; /* UART 0 RX INTERRUPT FLAG */ -__sbit __at 0x99 TI0 ; /* UART 0 TX INTERRUPT FLAG */ -__sbit __at 0x99 TI ; /* UART 0 TX INTERRUPT FLAG */ -__sbit __at 0x9A RB80 ; /* UART 0 RX BIT 8 */ -__sbit __at 0x9B TB80 ; /* UART 0 TX BIT 8 */ -__sbit __at 0x9C REN0 ; /* UART 0 RX ENABLE */ -__sbit __at 0x9C REN ; /* UART 0 RX ENABLE */ -__sbit __at 0x9D SM20 ; /* UART 0 MULTIPROCESSOR EN */ -__sbit __at 0x9E SM10 ; /* UART 0 MODE 1 */ -__sbit __at 0x9F SM00 ; /* UART 0 MODE 0 */ +__sbit __at (0x98) RI0 ; /* UART 0 RX INTERRUPT FLAG */ +__sbit __at (0x98) RI ; /* UART 0 RX INTERRUPT FLAG */ +__sbit __at (0x99) TI0 ; /* UART 0 TX INTERRUPT FLAG */ +__sbit __at (0x99) TI ; /* UART 0 TX INTERRUPT FLAG */ +__sbit __at (0x9A) RB80 ; /* UART 0 RX BIT 8 */ +__sbit __at (0x9B) TB80 ; /* UART 0 TX BIT 8 */ +__sbit __at (0x9C) REN0 ; /* UART 0 RX ENABLE */ +__sbit __at (0x9C) REN ; /* UART 0 RX ENABLE */ +__sbit __at (0x9D) SM20 ; /* UART 0 MULTIPROCESSOR EN */ +__sbit __at (0x9E) SM10 ; /* UART 0 MODE 1 */ +__sbit __at (0x9F) SM00 ; /* UART 0 MODE 0 */ /* SCON1 0x98 */ -__sbit __at 0x98 RI1 ; /* UART 1 RX INTERRUPT FLAG */ -__sbit __at 0x99 TI1 ; /* UART 1 TX INTERRUPT FLAG */ -__sbit __at 0x9A RB81 ; /* UART 1 RX BIT 8 */ -__sbit __at 0x9B TB81 ; /* UART 1 TX BIT 8 */ -__sbit __at 0x9C REN1 ; /* UART 1 RX ENABLE */ -__sbit __at 0x9D MCE1 ; /* UART 1 MCE */ -__sbit __at 0x9F S1MODE ; /* UART 1 MODE */ +__sbit __at (0x98) RI1 ; /* UART 1 RX INTERRUPT FLAG */ +__sbit __at (0x99) TI1 ; /* UART 1 TX INTERRUPT FLAG */ +__sbit __at (0x9A) RB81 ; /* UART 1 RX BIT 8 */ +__sbit __at (0x9B) TB81 ; /* UART 1 TX BIT 8 */ +__sbit __at (0x9C) REN1 ; /* UART 1 RX ENABLE */ +__sbit __at (0x9D) MCE1 ; /* UART 1 MCE */ +__sbit __at (0x9F) S1MODE ; /* UART 1 MODE */ /* P2 0xA0 */ -__sbit __at 0xA0 P2_0 ; -__sbit __at 0xA1 P2_1 ; -__sbit __at 0xA2 P2_2 ; -__sbit __at 0xA3 P2_3 ; -__sbit __at 0xA4 P2_4 ; -__sbit __at 0xA5 P2_5 ; -__sbit __at 0xA6 P2_6 ; -__sbit __at 0xA7 P2_7 ; +__sbit __at (0xA0) P2_0 ; +__sbit __at (0xA1) P2_1 ; +__sbit __at (0xA2) P2_2 ; +__sbit __at (0xA3) P2_3 ; +__sbit __at (0xA4) P2_4 ; +__sbit __at (0xA5) P2_5 ; +__sbit __at (0xA6) P2_6 ; +__sbit __at (0xA7) P2_7 ; /* IE 0xA8 */ -__sbit __at 0xA8 EX0 ; /* EXTERNAL INTERRUPT 0 ENABLE */ -__sbit __at 0xA9 ET0 ; /* TIMER 0 INTERRUPT ENABLE */ -__sbit __at 0xAA EX1 ; /* EXTERNAL INTERRUPT 1 ENABLE */ -__sbit __at 0xAB ET1 ; /* TIMER 1 INTERRUPT ENABLE */ -__sbit __at 0xAC ES0 ; /* UART0 INTERRUPT ENABLE */ -__sbit __at 0xAC ES ; /* UART0 INTERRUPT ENABLE */ -__sbit __at 0xAD ET2 ; /* TIMER 2 INTERRUPT ENABLE */ -__sbit __at 0xAF EA ; /* GLOBAL INTERRUPT ENABLE */ +__sbit __at (0xA8) EX0 ; /* EXTERNAL INTERRUPT 0 ENABLE */ +__sbit __at (0xA9) ET0 ; /* TIMER 0 INTERRUPT ENABLE */ +__sbit __at (0xAA) EX1 ; /* EXTERNAL INTERRUPT 1 ENABLE */ +__sbit __at (0xAB) ET1 ; /* TIMER 1 INTERRUPT ENABLE */ +__sbit __at (0xAC) ES0 ; /* UART0 INTERRUPT ENABLE */ +__sbit __at (0xAC) ES ; /* UART0 INTERRUPT ENABLE */ +__sbit __at (0xAD) ET2 ; /* TIMER 2 INTERRUPT ENABLE */ +__sbit __at (0xAF) EA ; /* GLOBAL INTERRUPT ENABLE */ /* P3 0xB0 */ -__sbit __at 0xB0 P3_0 ; -__sbit __at 0xB1 P3_1 ; -__sbit __at 0xB2 P3_2 ; -__sbit __at 0xB3 P3_3 ; -__sbit __at 0xB4 P3_4 ; -__sbit __at 0xB5 P3_5 ; -__sbit __at 0xB6 P3_6 ; -__sbit __at 0xB7 P3_7 ; +__sbit __at (0xB0) P3_0 ; +__sbit __at (0xB1) P3_1 ; +__sbit __at (0xB2) P3_2 ; +__sbit __at (0xB3) P3_3 ; +__sbit __at (0xB4) P3_4 ; +__sbit __at (0xB5) P3_5 ; +__sbit __at (0xB6) P3_6 ; +__sbit __at (0xB7) P3_7 ; /* IP 0xB8 */ -__sbit __at 0xB8 PX0 ; /* EXTERNAL INTERRUPT 0 PRIORITY */ -__sbit __at 0xB9 PT0 ; /* TIMER 0 PRIORITY */ -__sbit __at 0xBA PX1 ; /* EXTERNAL INTERRUPT 1 PRIORITY */ -__sbit __at 0xBB PT1 ; /* TIMER 1 PRIORITY */ -__sbit __at 0xBC PS ; /* SERIAL PORT PRIORITY */ -__sbit __at 0xBD PT2 ; /* TIMER 2 PRIORITY */ +__sbit __at (0xB8) PX0 ; /* EXTERNAL INTERRUPT 0 PRIORITY */ +__sbit __at (0xB9) PT0 ; /* TIMER 0 PRIORITY */ +__sbit __at (0xBA) PX1 ; /* EXTERNAL INTERRUPT 1 PRIORITY */ +__sbit __at (0xBB) PT1 ; /* TIMER 1 PRIORITY */ +__sbit __at (0xBC) PS ; /* SERIAL PORT PRIORITY */ +__sbit __at (0xBD) PT2 ; /* TIMER 2 PRIORITY */ /* SMB0CN 0xC0 */ -__sbit __at 0xC0 SMBTOE ; /* SMBUS 0 TIMEOUT ENABLE */ -__sbit __at 0xC1 SMBFTE ; /* SMBUS 0 FREE TIMER ENABLE */ -__sbit __at 0xC2 AA ; /* SMBUS 0 ASSERT/ACKNOWLEDGE FLAG */ -__sbit __at 0xC3 SI ; /* SMBUS 0 INTERRUPT PENDING FLAG */ -__sbit __at 0xC4 STO ; /* SMBUS 0 STOP FLAG */ -__sbit __at 0xC5 STA ; /* SMBUS 0 START FLAG */ -__sbit __at 0xC6 ENSMB ; /* SMBUS 0 ENABLE */ -__sbit __at 0xC7 BUSY ; /* SMBUS 0 BUSY */ +__sbit __at (0xC0) SMBTOE ; /* SMBUS 0 TIMEOUT ENABLE */ +__sbit __at (0xC1) SMBFTE ; /* SMBUS 0 FREE TIMER ENABLE */ +__sbit __at (0xC2) AA ; /* SMBUS 0 ASSERT/ACKNOWLEDGE FLAG */ +__sbit __at (0xC3) SI ; /* SMBUS 0 INTERRUPT PENDING FLAG */ +__sbit __at (0xC4) STO ; /* SMBUS 0 STOP FLAG */ +__sbit __at (0xC5) STA ; /* SMBUS 0 START FLAG */ +__sbit __at (0xC6) ENSMB ; /* SMBUS 0 ENABLE */ +__sbit __at (0xC7) BUSY ; /* SMBUS 0 BUSY */ /* MAC0STA 0xC0 */ -__sbit __at 0xC0 MAC0N ; /* MAC 0 NEGATIVE FLAG */ -__sbit __at 0xC1 MAC0SO ; /* MAC 0 SOFT OVERFLOW FLAG */ -__sbit __at 0xC2 MAC0Z ; /* MAC 0 ZERO FLAG */ -__sbit __at 0xC3 MAC0HO ; /* MAC 0 HARD OVERFLOW FLAG */ +__sbit __at (0xC0) MAC0N ; /* MAC 0 NEGATIVE FLAG */ +__sbit __at (0xC1) MAC0SO ; /* MAC 0 SOFT OVERFLOW FLAG */ +__sbit __at (0xC2) MAC0Z ; /* MAC 0 ZERO FLAG */ +__sbit __at (0xC3) MAC0HO ; /* MAC 0 HARD OVERFLOW FLAG */ /* TMR2CN 0xC8 */ -__sbit __at 0xC8 CPRL2 ; /* TIMER 2 CAPTURE SELECT */ -__sbit __at 0xC9 CT2 ; /* TIMER 2 COUNTER SELECT */ -__sbit __at 0xCA TR2 ; /* TIMER 2 ON/OFF CONTROL */ -__sbit __at 0xCB EXEN2 ; /* TIMER 2 EXTERNAL ENABLE FLAG */ -__sbit __at 0xCE EXF2 ; /* TIMER 2 EXTERNAL FLAG */ -__sbit __at 0xCF TF2 ; /* TIMER 2 OVERFLOW FLAG */ +__sbit __at (0xC8) CPRL2 ; /* TIMER 2 CAPTURE SELECT */ +__sbit __at (0xC9) CT2 ; /* TIMER 2 COUNTER SELECT */ +__sbit __at (0xCA) TR2 ; /* TIMER 2 ON/OFF CONTROL */ +__sbit __at (0xCB) EXEN2 ; /* TIMER 2 EXTERNAL ENABLE FLAG */ +__sbit __at (0xCE) EXF2 ; /* TIMER 2 EXTERNAL FLAG */ +__sbit __at (0xCF) TF2 ; /* TIMER 2 OVERFLOW FLAG */ /* TMR3CN 0xC8 */ -__sbit __at 0xC8 CPRL3 ; /* TIMER 3 CAPTURE SELECT */ -__sbit __at 0xC9 CT3 ; /* TIMER 3 COUNTER SELECT */ -__sbit __at 0xCA TR3 ; /* TIMER 3 ON/OFF CONTROL */ -__sbit __at 0xCB EXEN3 ; /* TIMER 3 EXTERNAL ENABLE FLAG */ -__sbit __at 0xCE EXF3 ; /* TIMER 3 EXTERNAL FLAG */ -__sbit __at 0xCF TF3 ; /* TIMER 3 OVERFLOW FLAG */ +__sbit __at (0xC8) CPRL3 ; /* TIMER 3 CAPTURE SELECT */ +__sbit __at (0xC9) CT3 ; /* TIMER 3 COUNTER SELECT */ +__sbit __at (0xCA) TR3 ; /* TIMER 3 ON/OFF CONTROL */ +__sbit __at (0xCB) EXEN3 ; /* TIMER 3 EXTERNAL ENABLE FLAG */ +__sbit __at (0xCE) EXF3 ; /* TIMER 3 EXTERNAL FLAG */ +__sbit __at (0xCF) TF3 ; /* TIMER 3 OVERFLOW FLAG */ /* TMR4CN 0xC8 */ -__sbit __at 0xC8 CPRL4 ; /* TIMER 4 CAPTURE SELECT */ -__sbit __at 0xC9 CT4 ; /* TIMER 4 COUNTER SELECT */ -__sbit __at 0xCA TR4 ; /* TIMER 4 ON/OFF CONTROL */ -__sbit __at 0xCB EXEN4 ; /* TIMER 4 EXTERNAL ENABLE FLAG */ -__sbit __at 0xCE EXF4 ; /* TIMER 4 EXTERNAL FLAG */ -__sbit __at 0xCF TF4 ; /* TIMER 4 OVERFLOW FLAG */ +__sbit __at (0xC8) CPRL4 ; /* TIMER 4 CAPTURE SELECT */ +__sbit __at (0xC9) CT4 ; /* TIMER 4 COUNTER SELECT */ +__sbit __at (0xCA) TR4 ; /* TIMER 4 ON/OFF CONTROL */ +__sbit __at (0xCB) EXEN4 ; /* TIMER 4 EXTERNAL ENABLE FLAG */ +__sbit __at (0xCE) EXF4 ; /* TIMER 4 EXTERNAL FLAG */ +__sbit __at (0xCF) TF4 ; /* TIMER 4 OVERFLOW FLAG */ /* P4 0xC8 */ -__sbit __at 0xC8 P4_0 ; -__sbit __at 0xC9 P4_1 ; -__sbit __at 0xCA P4_2 ; -__sbit __at 0xCB P4_3 ; -__sbit __at 0xCC P4_4 ; -__sbit __at 0xCD P4_5 ; -__sbit __at 0xCE P4_6 ; -__sbit __at 0xCF P4_7 ; +__sbit __at (0xC8) P4_0 ; +__sbit __at (0xC9) P4_1 ; +__sbit __at (0xCA) P4_2 ; +__sbit __at (0xCB) P4_3 ; +__sbit __at (0xCC) P4_4 ; +__sbit __at (0xCD) P4_5 ; +__sbit __at (0xCE) P4_6 ; +__sbit __at (0xCF) P4_7 ; /* PSW 0xD0 */ -__sbit __at 0xD0 P ; /* ACCUMULATOR PARITY FLAG */ -__sbit __at 0xD1 F1 ; /* USER FLAG 1 */ -__sbit __at 0xD2 OV ; /* OVERFLOW FLAG */ -__sbit __at 0xD3 RS0 ; /* REGISTER BANK SELECT 0 */ -__sbit __at 0xD4 RS1 ; /* REGISTER BANK SELECT 1 */ -__sbit __at 0xD5 F0 ; /* USER FLAG 0 */ -__sbit __at 0xD6 AC ; /* AUXILIARY CARRY FLAG */ -__sbit __at 0xD7 CY ; /* CARRY FLAG */ +__sbit __at (0xD0) P ; /* ACCUMULATOR PARITY FLAG */ +__sbit __at (0xD1) F1 ; /* USER FLAG 1 */ +__sbit __at (0xD2) OV ; /* OVERFLOW FLAG */ +__sbit __at (0xD3) RS0 ; /* REGISTER BANK SELECT 0 */ +__sbit __at (0xD4) RS1 ; /* REGISTER BANK SELECT 1 */ +__sbit __at (0xD5) F0 ; /* USER FLAG 0 */ +__sbit __at (0xD6) AC ; /* AUXILIARY CARRY FLAG */ +__sbit __at (0xD7) CY ; /* CARRY FLAG */ /* PCA0CN D8H */ -__sbit __at 0xD8 CCF0 ; /* PCA 0 MODULE 0 INTERRUPT FLAG */ -__sbit __at 0xD9 CCF1 ; /* PCA 0 MODULE 1 INTERRUPT FLAG */ -__sbit __at 0xDA CCF2 ; /* PCA 0 MODULE 2 INTERRUPT FLAG */ -__sbit __at 0xDB CCF3 ; /* PCA 0 MODULE 3 INTERRUPT FLAG */ -__sbit __at 0xDC CCF4 ; /* PCA 0 MODULE 4 INTERRUPT FLAG */ -__sbit __at 0xDD CCF5 ; /* PCA 0 MODULE 5 INTERRUPT FLAG */ -__sbit __at 0xDE CR ; /* PCA 0 COUNTER RUN CONTROL BIT */ -__sbit __at 0xDF CF ; /* PCA 0 COUNTER OVERFLOW FLAG */ +__sbit __at (0xD8) CCF0 ; /* PCA 0 MODULE 0 INTERRUPT FLAG */ +__sbit __at (0xD9) CCF1 ; /* PCA 0 MODULE 1 INTERRUPT FLAG */ +__sbit __at (0xDA) CCF2 ; /* PCA 0 MODULE 2 INTERRUPT FLAG */ +__sbit __at (0xDB) CCF3 ; /* PCA 0 MODULE 3 INTERRUPT FLAG */ +__sbit __at (0xDC) CCF4 ; /* PCA 0 MODULE 4 INTERRUPT FLAG */ +__sbit __at (0xDD) CCF5 ; /* PCA 0 MODULE 5 INTERRUPT FLAG */ +__sbit __at (0xDE) CR ; /* PCA 0 COUNTER RUN CONTROL BIT */ +__sbit __at (0xDF) CF ; /* PCA 0 COUNTER OVERFLOW FLAG */ /* P5 0xD8 */ -__sbit __at 0xD8 P5_0 ; -__sbit __at 0xD9 P5_1 ; -__sbit __at 0xDA P5_2 ; -__sbit __at 0xDB P5_3 ; -__sbit __at 0xDC P5_4 ; -__sbit __at 0xDD P5_5 ; -__sbit __at 0xDE P5_6 ; -__sbit __at 0xDF P5_7 ; +__sbit __at (0xD8) P5_0 ; +__sbit __at (0xD9) P5_1 ; +__sbit __at (0xDA) P5_2 ; +__sbit __at (0xDB) P5_3 ; +__sbit __at (0xDC) P5_4 ; +__sbit __at (0xDD) P5_5 ; +__sbit __at (0xDE) P5_6 ; +__sbit __at (0xDF) P5_7 ; /* ADC0CN E8H */ -__sbit __at 0xE8 AD0LJST ; /* ADC 0 RIGHT JUSTIFY DATA BIT */ -__sbit __at 0xE9 AD0WINT ; /* ADC 0 WINDOW INTERRUPT FLAG */ -__sbit __at 0xEA AD0CM0 ; /* ADC 0 CONVERT START MODE BIT 0 */ -__sbit __at 0xEB AD0CM1 ; /* ADC 0 CONVERT START MODE BIT 1 */ -__sbit __at 0xEC AD0BUSY ; /* ADC 0 BUSY FLAG */ -__sbit __at 0xED AD0INT ; /* ADC 0 EOC INTERRUPT FLAG */ -__sbit __at 0xEE AD0TM ; /* ADC 0 TRACK MODE */ -__sbit __at 0xEF AD0EN ; /* ADC 0 ENABLE */ +__sbit __at (0xE8) AD0LJST ; /* ADC 0 RIGHT JUSTIFY DATA BIT */ +__sbit __at (0xE9) AD0WINT ; /* ADC 0 WINDOW INTERRUPT FLAG */ +__sbit __at (0xEA) AD0CM0 ; /* ADC 0 CONVERT START MODE BIT 0 */ +__sbit __at (0xEB) AD0CM1 ; /* ADC 0 CONVERT START MODE BIT 1 */ +__sbit __at (0xEC) AD0BUSY ; /* ADC 0 BUSY FLAG */ +__sbit __at (0xED) AD0INT ; /* ADC 0 EOC INTERRUPT FLAG */ +__sbit __at (0xEE) AD0TM ; /* ADC 0 TRACK MODE */ +__sbit __at (0xEF) AD0EN ; /* ADC 0 ENABLE */ /* ADC2CN E8H */ -__sbit __at 0xE8 AD2WINT ; /* ADC 2 WINDOW INTERRUPT FLAG */ -__sbit __at 0xE9 AD2CM0 ; /* ADC 2 CONVERT START MODE BIT 0 */ -__sbit __at 0xEA AD2CM1 ; /* ADC 2 CONVERT START MODE BIT 1 */ -__sbit __at 0xEB AD2CM2 ; /* ADC 2 CONVERT START MODE BIT 2 */ -__sbit __at 0xEC AD2BUSY ; /* ADC 2 BUSY FLAG */ -__sbit __at 0xED AD2INT ; /* ADC 2 EOC INTERRUPT FLAG */ -__sbit __at 0xEE AD2TM ; /* ADC 2 TRACK MODE */ -__sbit __at 0xEF AD2EN ; /* ADC 2 ENABLE */ +__sbit __at (0xE8) AD2WINT ; /* ADC 2 WINDOW INTERRUPT FLAG */ +__sbit __at (0xE9) AD2CM0 ; /* ADC 2 CONVERT START MODE BIT 0 */ +__sbit __at (0xEA) AD2CM1 ; /* ADC 2 CONVERT START MODE BIT 1 */ +__sbit __at (0xEB) AD2CM2 ; /* ADC 2 CONVERT START MODE BIT 2 */ +__sbit __at (0xEC) AD2BUSY ; /* ADC 2 BUSY FLAG */ +__sbit __at (0xED) AD2INT ; /* ADC 2 EOC INTERRUPT FLAG */ +__sbit __at (0xEE) AD2TM ; /* ADC 2 TRACK MODE */ +__sbit __at (0xEF) AD2EN ; /* ADC 2 ENABLE */ /* P6 0xE8 */ -__sbit __at 0xE8 P6_0 ; -__sbit __at 0xE9 P6_1 ; -__sbit __at 0xEA P6_2 ; -__sbit __at 0xEB P6_3 ; -__sbit __at 0xEC P6_4 ; -__sbit __at 0xED P6_5 ; -__sbit __at 0xEE P6_6 ; -__sbit __at 0xEF P6_7 ; +__sbit __at (0xE8) P6_0 ; +__sbit __at (0xE9) P6_1 ; +__sbit __at (0xEA) P6_2 ; +__sbit __at (0xEB) P6_3 ; +__sbit __at (0xEC) P6_4 ; +__sbit __at (0xED) P6_5 ; +__sbit __at (0xEE) P6_6 ; +__sbit __at (0xEF) P6_7 ; /* SPI0CN F8H */ -__sbit __at 0xF8 SPIEN ; /* SPI 0 SPI ENABLE */ -__sbit __at 0xF9 TXBMT ; /* SPI 0 TX BUFFER EMPTY FLAG */ -__sbit __at 0xFA NSSMD0 ; /* SPI 0 SLAVE SELECT MODE 0 */ -__sbit __at 0xFB NSSMD1 ; /* SPI 0 SLAVE SELECT MODE 1 */ -__sbit __at 0xFC RXOVRN ; /* SPI 0 RX OVERRUN FLAG */ -__sbit __at 0xFD MODF ; /* SPI 0 MODE FAULT FLAG */ -__sbit __at 0xFE WCOL ; /* SPI 0 WRITE COLLISION FLAG */ -__sbit __at 0xFF SPIF ; /* SPI 0 INTERRUPT FLAG */ +__sbit __at (0xF8) SPIEN ; /* SPI 0 SPI ENABLE */ +__sbit __at (0xF9) TXBMT ; /* SPI 0 TX BUFFER EMPTY FLAG */ +__sbit __at (0xFA) NSSMD0 ; /* SPI 0 SLAVE SELECT MODE 0 */ +__sbit __at (0xFB) NSSMD1 ; /* SPI 0 SLAVE SELECT MODE 1 */ +__sbit __at (0xFC) RXOVRN ; /* SPI 0 RX OVERRUN FLAG */ +__sbit __at (0xFD) MODF ; /* SPI 0 MODE FAULT FLAG */ +__sbit __at (0xFE) WCOL ; /* SPI 0 WRITE COLLISION FLAG */ +__sbit __at (0xFF) SPIF ; /* SPI 0 INTERRUPT FLAG */ /* P7 0xF8 */ -__sbit __at 0xF8 P7_0 ; -__sbit __at 0xF9 P7_1 ; -__sbit __at 0xFA P7_2 ; -__sbit __at 0xFB P7_3 ; -__sbit __at 0xFC P7_4 ; -__sbit __at 0xFD P7_5 ; -__sbit __at 0xFE P7_6 ; -__sbit __at 0xFF P7_7 ; +__sbit __at (0xF8) P7_0 ; +__sbit __at (0xF9) P7_1 ; +__sbit __at (0xFA) P7_2 ; +__sbit __at (0xFB) P7_3 ; +__sbit __at (0xFC) P7_4 ; +__sbit __at (0xFD) P7_5 ; +__sbit __at (0xFE) P7_6 ; +__sbit __at (0xFF) P7_7 ; /* Predefined SFR Bit Masks */ -#define IDLE 0x01 /* PCON */ -#define STOP 0x02 /* PCON */ +#define PCON_IDLE 0x01 /* PCON */ +#define PCON_STOP 0x02 /* PCON */ #define ECCF 0x01 /* PCA0CPMn */ #define PWM 0x02 /* PCA0CPMn */ #define TOG 0x04 /* PCA0CPMn */ diff --git a/device/include/mcs51/c8051f300.h b/device/include/mcs51/c8051f300.h index 2ddb9fe4..ebeb8368 100644 --- a/device/include/mcs51/c8051f300.h +++ b/device/include/mcs51/c8051f300.h @@ -24,217 +24,217 @@ /* BYTE Registers */ -__sfr __at 0x80 P0 ; /* PORT 0 */ -__sfr __at 0x81 SP ; /* STACK POINTER */ -__sfr __at 0x82 DPL ; /* DATA POINTER - LOW BYTE */ -__sfr __at 0x83 DPH ; /* DATA POINTER - HIGH BYTE */ -__sfr __at 0x87 PCON ; /* POWER CONTROL */ -__sfr __at 0x88 TCON ; /* TIMER CONTROL */ -__sfr __at 0x89 TMOD ; /* TIMER MODE */ -__sfr __at 0x8A TL0 ; /* TIMER 0 - LOW BYTE */ -__sfr __at 0x8B TL1 ; /* TIMER 1 - LOW BYTE */ -__sfr __at 0x8C TH0 ; /* TIMER 0 - HIGH BYTE */ -__sfr __at 0x8D TH1 ; /* TIMER 1 - HIGH BYTE */ -__sfr __at 0x8E CKCON ; /* CLOCK CONTROL */ -__sfr __at 0x8F PSCTL ; /* PROGRAM STORE R/W CONTROL */ -__sfr __at 0x98 SCON ; /* SERIAL PORT CONTROL */ -__sfr __at 0x98 SCON0 ; /* SERIAL PORT CONTROL */ -__sfr __at 0x99 SBUF ; /* SERIAL PORT BUFFER */ -__sfr __at 0x99 SBUF0 ; /* SERIAL PORT BUFFER */ -__sfr __at 0x9D CPT0MD ; /* COMPARATOR 0 MODE SELECTION */ -__sfr __at 0x9F CPT0MX ; /* COMPARATOR 0 MUX SELECTION */ -__sfr __at 0xA4 P0MDOUT ; /* PORT 0 OUTPUT MODE CONFIGURATION */ -__sfr __at 0xA8 IE ; /* INTERRUPT ENABLE */ -__sfr __at 0xB1 OSCXCN ; /* EXTERNAL OSCILLATOR CONTROL */ -__sfr __at 0xB2 OSCICN ; /* INTERNAL OSCILLATOR CONTROL */ -__sfr __at 0xB3 OSCICL ; /* INTERNAL OSCILLATOR CALIBRATION */ -__sfr __at 0xB6 FLSCL ; /* FLASH MEMORY TIMING PRESCALER */ -__sfr __at 0xB7 FLKEY ; /* FLASH ACESS LIMIT */ -__sfr __at 0xB8 IP ; /* INTERRUPT PRIORITY */ -__sfr __at 0xBB AMX0SL ; /* ADC 0 MUX CHANNEL SELECTION */ -__sfr __at 0xBC ADC0CF ; /* ADC 0 CONFIGURATION */ -__sfr __at 0xBE ADC0 ; /* ADC 0 DATA */ -__sfr __at 0xC0 SMB0CN ; /* SMBUS CONTROL */ -__sfr __at 0xC1 SMB0CF ; /* SMBUS CONFIGURATION */ -__sfr __at 0xC2 SMB0DAT ; /* SMBUS DATA */ -__sfr __at 0xC4 ADC0GT ; /* ADC 0 GREATER-THAN REGISTER */ -__sfr __at 0xC6 ADC0LT ; /* ADC 0 LESS-THAN REGISTER */ -__sfr __at 0xC8 T2CON ; /* TIMER 2 CONTROL */ -__sfr __at 0xC8 TMR2CN ; /* TIMER 2 CONTROL */ -__sfr __at 0xCA RCAP2L ; /* TIMER 2 CAPTURE REGISTER - LOW BYTE */ -__sfr __at 0xCA TMR2RLL ; /* TIMER 2 CAPTURE REGISTER - LOW BYTE */ -__sfr __at 0xCB RCAP2H ; /* TIMER 2 CAPTURE REGISTER - HIGH BYTE */ -__sfr __at 0xCB TMR2RLH ; /* TIMER 2 CAPTURE REGISTER - HIGH BYTE */ -__sfr __at 0xCC TL2 ; /* TIMER 2 - LOW BYTE */ -__sfr __at 0xCC TMR2L ; /* TIMER 2 - LOW BYTE */ -__sfr __at 0xCD TH2 ; /* TIMER 2 - HIGH BYTE */ -__sfr __at 0xCD TMR2H ; /* TIMER 2 - HIGH BYTE */ -__sfr __at 0xD0 PSW ; /* PROGRAM STATUS WORD */ -__sfr __at 0xD1 REF0CN ; /* VOLTAGE REFERENCE 0 CONTROL */ -__sfr __at 0xD8 PCA0CN ; /* PCA CONTROL */ -__sfr __at 0xD9 PCA0MD ; /* PCA MODE */ -__sfr __at 0xDA PCA0CPM0 ; /* PCA MODULE 0 MODE REGISTER */ -__sfr __at 0xDB PCA0CPM1 ; /* PCA MODULE 1 MODE REGISTER */ -__sfr __at 0xDC PCA0CPM2 ; /* PCA MODULE 2 MODE REGISTER */ -__sfr __at 0xE0 ACC ; /* ACCUMULATOR */ -__sfr __at 0xE1 PRT0MX ; /* PORT MUX CONFIGURATION REGISTER 0 */ -__sfr __at 0xE1 XBR0 ; /* PORT MUX CONFIGURATION REGISTER 0 */ -__sfr __at 0xE2 PRT1MX ; /* PORT MUX CONFIGURATION REGISTER 1 */ -__sfr __at 0xE2 XBR1 ; /* PORT MUX CONFIGURATION REGISTER 1 */ -__sfr __at 0xE3 PRT2MX ; /* PORT MUX CONFIGURATION REGISTER 2 */ -__sfr __at 0xE3 XBR2 ; /* PORT MUX CONFIGURATION REGISTER 2 */ -__sfr __at 0xE4 IT01CF ; /* INT0/INT1 CONFIGURATION REGISTER */ -__sfr __at 0xE4 INT01CF ; /* INT0/INT1 CONFIGURATION REGISTER */ -__sfr __at 0xE6 EIE1 ; /* EXTERNAL INTERRUPT ENABLE 1 */ -__sfr __at 0xE8 ADC0CN ; /* ADC 0 CONTROL */ -__sfr __at 0xE9 PCA0CPL1 ; /* PCA CAPTURE 1 LOW */ -__sfr __at 0xEA PCA0CPH1 ; /* PCA CAPTURE 1 HIGH */ -__sfr __at 0xEB PCA0CPL2 ; /* PCA CAPTURE 2 LOW */ -__sfr __at 0xEC PCA0CPH2 ; /* PCA CAPTURE 2 HIGH */ -__sfr __at 0xEF RSTSRC ; /* RESET SOURCE */ -__sfr __at 0xF0 B ; /* B REGISTER */ -__sfr __at 0xF1 P0MODE ; /* PORT 0 INPUT MODE CONFIGURATION */ -__sfr __at 0xF1 P0MDIN ; /* PORT 0 INPUT MODE CONFIGURATION */ -__sfr __at 0xF6 EIP1 ; /* EXTERNAL INTERRUPT PRIORITY REGISTER 1 */ -__sfr __at 0xF8 CPT0CN ; /* COMPARATOR 0 CONTROL */ -__sfr __at 0xF9 PCA0L ; /* PCA COUNTER LOW */ -__sfr __at 0xFA PCA0H ; /* PCA COUNTER HIGH */ -__sfr __at 0xFB PCA0CPL0 ; /* PCA CAPTURE 0 LOW */ -__sfr __at 0xFC PCA0CPH0 ; /* PCA CAPTURE 0 HIGH */ +__sfr __at (0x80) P0 ; /* PORT 0 */ +__sfr __at (0x81) SP ; /* STACK POINTER */ +__sfr __at (0x82) DPL ; /* DATA POINTER - LOW BYTE */ +__sfr __at (0x83) DPH ; /* DATA POINTER - HIGH BYTE */ +__sfr __at (0x87) PCON ; /* POWER CONTROL */ +__sfr __at (0x88) TCON ; /* TIMER CONTROL */ +__sfr __at (0x89) TMOD ; /* TIMER MODE */ +__sfr __at (0x8A) TL0 ; /* TIMER 0 - LOW BYTE */ +__sfr __at (0x8B) TL1 ; /* TIMER 1 - LOW BYTE */ +__sfr __at (0x8C) TH0 ; /* TIMER 0 - HIGH BYTE */ +__sfr __at (0x8D) TH1 ; /* TIMER 1 - HIGH BYTE */ +__sfr __at (0x8E) CKCON ; /* CLOCK CONTROL */ +__sfr __at (0x8F) PSCTL ; /* PROGRAM STORE R/W CONTROL */ +__sfr __at (0x98) SCON ; /* SERIAL PORT CONTROL */ +__sfr __at (0x98) SCON0 ; /* SERIAL PORT CONTROL */ +__sfr __at (0x99) SBUF ; /* SERIAL PORT BUFFER */ +__sfr __at (0x99) SBUF0 ; /* SERIAL PORT BUFFER */ +__sfr __at (0x9D) CPT0MD ; /* COMPARATOR 0 MODE SELECTION */ +__sfr __at (0x9F) CPT0MX ; /* COMPARATOR 0 MUX SELECTION */ +__sfr __at (0xA4) P0MDOUT ; /* PORT 0 OUTPUT MODE CONFIGURATION */ +__sfr __at (0xA8) IE ; /* INTERRUPT ENABLE */ +__sfr __at (0xB1) OSCXCN ; /* EXTERNAL OSCILLATOR CONTROL */ +__sfr __at (0xB2) OSCICN ; /* INTERNAL OSCILLATOR CONTROL */ +__sfr __at (0xB3) OSCICL ; /* INTERNAL OSCILLATOR CALIBRATION */ +__sfr __at (0xB6) FLSCL ; /* FLASH MEMORY TIMING PRESCALER */ +__sfr __at (0xB7) FLKEY ; /* FLASH ACESS LIMIT */ +__sfr __at (0xB8) IP ; /* INTERRUPT PRIORITY */ +__sfr __at (0xBB) AMX0SL ; /* ADC 0 MUX CHANNEL SELECTION */ +__sfr __at (0xBC) ADC0CF ; /* ADC 0 CONFIGURATION */ +__sfr __at (0xBE) ADC0 ; /* ADC 0 DATA */ +__sfr __at (0xC0) SMB0CN ; /* SMBUS CONTROL */ +__sfr __at (0xC1) SMB0CF ; /* SMBUS CONFIGURATION */ +__sfr __at (0xC2) SMB0DAT ; /* SMBUS DATA */ +__sfr __at (0xC4) ADC0GT ; /* ADC 0 GREATER-THAN REGISTER */ +__sfr __at (0xC6) ADC0LT ; /* ADC 0 LESS-THAN REGISTER */ +__sfr __at (0xC8) T2CON ; /* TIMER 2 CONTROL */ +__sfr __at (0xC8) TMR2CN ; /* TIMER 2 CONTROL */ +__sfr __at (0xCA) RCAP2L ; /* TIMER 2 CAPTURE REGISTER - LOW BYTE */ +__sfr __at (0xCA) TMR2RLL ; /* TIMER 2 CAPTURE REGISTER - LOW BYTE */ +__sfr __at (0xCB) RCAP2H ; /* TIMER 2 CAPTURE REGISTER - HIGH BYTE */ +__sfr __at (0xCB) TMR2RLH ; /* TIMER 2 CAPTURE REGISTER - HIGH BYTE */ +__sfr __at (0xCC) TL2 ; /* TIMER 2 - LOW BYTE */ +__sfr __at (0xCC) TMR2L ; /* TIMER 2 - LOW BYTE */ +__sfr __at (0xCD) TH2 ; /* TIMER 2 - HIGH BYTE */ +__sfr __at (0xCD) TMR2H ; /* TIMER 2 - HIGH BYTE */ +__sfr __at (0xD0) PSW ; /* PROGRAM STATUS WORD */ +__sfr __at (0xD1) REF0CN ; /* VOLTAGE REFERENCE 0 CONTROL */ +__sfr __at (0xD8) PCA0CN ; /* PCA CONTROL */ +__sfr __at (0xD9) PCA0MD ; /* PCA MODE */ +__sfr __at (0xDA) PCA0CPM0 ; /* PCA MODULE 0 MODE REGISTER */ +__sfr __at (0xDB) PCA0CPM1 ; /* PCA MODULE 1 MODE REGISTER */ +__sfr __at (0xDC) PCA0CPM2 ; /* PCA MODULE 2 MODE REGISTER */ +__sfr __at (0xE0) ACC ; /* ACCUMULATOR */ +__sfr __at (0xE1) PRT0MX ; /* PORT MUX CONFIGURATION REGISTER 0 */ +__sfr __at (0xE1) XBR0 ; /* PORT MUX CONFIGURATION REGISTER 0 */ +__sfr __at (0xE2) PRT1MX ; /* PORT MUX CONFIGURATION REGISTER 1 */ +__sfr __at (0xE2) XBR1 ; /* PORT MUX CONFIGURATION REGISTER 1 */ +__sfr __at (0xE3) PRT2MX ; /* PORT MUX CONFIGURATION REGISTER 2 */ +__sfr __at (0xE3) XBR2 ; /* PORT MUX CONFIGURATION REGISTER 2 */ +__sfr __at (0xE4) IT01CF ; /* INT0/INT1 CONFIGURATION REGISTER */ +__sfr __at (0xE4) INT01CF ; /* INT0/INT1 CONFIGURATION REGISTER */ +__sfr __at (0xE6) EIE1 ; /* EXTERNAL INTERRUPT ENABLE 1 */ +__sfr __at (0xE8) ADC0CN ; /* ADC 0 CONTROL */ +__sfr __at (0xE9) PCA0CPL1 ; /* PCA CAPTURE 1 LOW */ +__sfr __at (0xEA) PCA0CPH1 ; /* PCA CAPTURE 1 HIGH */ +__sfr __at (0xEB) PCA0CPL2 ; /* PCA CAPTURE 2 LOW */ +__sfr __at (0xEC) PCA0CPH2 ; /* PCA CAPTURE 2 HIGH */ +__sfr __at (0xEF) RSTSRC ; /* RESET SOURCE */ +__sfr __at (0xF0) B ; /* B REGISTER */ +__sfr __at (0xF1) P0MODE ; /* PORT 0 INPUT MODE CONFIGURATION */ +__sfr __at (0xF1) P0MDIN ; /* PORT 0 INPUT MODE CONFIGURATION */ +__sfr __at (0xF6) EIP1 ; /* EXTERNAL INTERRUPT PRIORITY REGISTER 1 */ +__sfr __at (0xF8) CPT0CN ; /* COMPARATOR 0 CONTROL */ +__sfr __at (0xF9) PCA0L ; /* PCA COUNTER LOW */ +__sfr __at (0xFA) PCA0H ; /* PCA COUNTER HIGH */ +__sfr __at (0xFB) PCA0CPL0 ; /* PCA CAPTURE 0 LOW */ +__sfr __at (0xFC) PCA0CPH0 ; /* PCA CAPTURE 0 HIGH */ /* WORD/DWORD Registers */ -__sfr16 __at 0x8C8A TMR0 ; /* TIMER 0 COUNTER */ -__sfr16 __at 0x8D8B TMR1 ; /* TIMER 1 COUNTER */ -__sfr16 __at 0xCDCC TMR2 ; /* TIMER 2 COUNTER */ -__sfr16 __at 0xCBCA RCAP2 ; /* TIMER 2 CAPTURE REGISTER WORD */ -__sfr16 __at 0xCBCA TMR2RL ; /* TIMER 2 CAPTURE REGISTER WORD */ -__sfr16 __at 0xFAF9 PCA0 ; /* PCA COUNTER */ -__sfr16 __at 0xFCFB PCA0CP0 ; /* PCA CAPTURE 0 WORD */ -__sfr16 __at 0xEAE9 PCA0CP1 ; /* PCA CAPTURE 1 WORD */ -__sfr16 __at 0xECEB PCA0CP2 ; /* PCA CAPTURE 2 WORD */ +__sfr16 __at (0x8C8A) TMR0 ; /* TIMER 0 COUNTER */ +__sfr16 __at (0x8D8B) TMR1 ; /* TIMER 1 COUNTER */ +__sfr16 __at (0xCDCC) TMR2 ; /* TIMER 2 COUNTER */ +__sfr16 __at (0xCBCA) RCAP2 ; /* TIMER 2 CAPTURE REGISTER WORD */ +__sfr16 __at (0xCBCA) TMR2RL ; /* TIMER 2 CAPTURE REGISTER WORD */ +__sfr16 __at (0xFAF9) PCA0 ; /* PCA COUNTER */ +__sfr16 __at (0xFCFB) PCA0CP0 ; /* PCA CAPTURE 0 WORD */ +__sfr16 __at (0xEAE9) PCA0CP1 ; /* PCA CAPTURE 1 WORD */ +__sfr16 __at (0xECEB) PCA0CP2 ; /* PCA CAPTURE 2 WORD */ /* BIT Registers */ /* P0 0x80 */ -__sbit __at 0x80 P0_0 ; -__sbit __at 0x81 P0_1 ; -__sbit __at 0x82 P0_2 ; -__sbit __at 0x83 P0_3 ; -__sbit __at 0x84 P0_4 ; -__sbit __at 0x85 P0_5 ; -__sbit __at 0x86 P0_6 ; -__sbit __at 0x87 P0_7 ; +__sbit __at (0x80) P0_0 ; +__sbit __at (0x81) P0_1 ; +__sbit __at (0x82) P0_2 ; +__sbit __at (0x83) P0_3 ; +__sbit __at (0x84) P0_4 ; +__sbit __at (0x85) P0_5 ; +__sbit __at (0x86) P0_6 ; +__sbit __at (0x87) P0_7 ; /* TCON 0x88 */ -__sbit __at 0x88 IT0 ; /* TCON.0 - EXT. INTERRUPT 0 TYPE */ -__sbit __at 0x89 IE0 ; /* TCON.1 - EXT. INTERRUPT 0 EDGE FLAG */ -__sbit __at 0x8A IT1 ; /* TCON.2 - EXT. INTERRUPT 1 TYPE */ -__sbit __at 0x8B IE1 ; /* TCON.3 - EXT. INTERRUPT 1 EDGE FLAG */ -__sbit __at 0x8C TR0 ; /* TCON.4 - TIMER 0 ON/OFF CONTROL */ -__sbit __at 0x8D TF0 ; /* TCON.5 - TIMER 0 OVERFLOW FLAG */ -__sbit __at 0x8E TR1 ; /* TCON.6 - TIMER 1 ON/OFF CONTROL */ -__sbit __at 0x8F TF1 ; /* TCON.7 - TIMER 1 OVERFLOW FLAG */ +__sbit __at (0x88) IT0 ; /* TCON.0 - EXT. INTERRUPT 0 TYPE */ +__sbit __at (0x89) IE0 ; /* TCON.1 - EXT. INTERRUPT 0 EDGE FLAG */ +__sbit __at (0x8A) IT1 ; /* TCON.2 - EXT. INTERRUPT 1 TYPE */ +__sbit __at (0x8B) IE1 ; /* TCON.3 - EXT. INTERRUPT 1 EDGE FLAG */ +__sbit __at (0x8C) TR0 ; /* TCON.4 - TIMER 0 ON/OFF CONTROL */ +__sbit __at (0x8D) TF0 ; /* TCON.5 - TIMER 0 OVERFLOW FLAG */ +__sbit __at (0x8E) TR1 ; /* TCON.6 - TIMER 1 ON/OFF CONTROL */ +__sbit __at (0x8F) TF1 ; /* TCON.7 - TIMER 1 OVERFLOW FLAG */ /* SCON 0x98 */ -__sbit __at 0x98 RI ; /* SCON.0 - RECEIVE INTERRUPT FLAG */ -__sbit __at 0x98 RI0 ; /* SCON.0 - RECEIVE INTERRUPT FLAG */ -__sbit __at 0x99 TI ; /* SCON.1 - TRANSMIT INTERRUPT FLAG */ -__sbit __at 0x99 TI0 ; /* SCON.1 - TRANSMIT INTERRUPT FLAG */ -__sbit __at 0x9A RB8 ; /* SCON.2 - RECEIVE BIT 8 */ -__sbit __at 0x9A RB80 ; /* SCON.2 - RECEIVE BIT 8 */ -__sbit __at 0x9B TB8 ; /* SCON.3 - TRANSMIT BIT 8 */ -__sbit __at 0x9B TB80 ; /* SCON.3 - TRANSMIT BIT 8 */ -__sbit __at 0x9C REN ; /* SCON.4 - RECEIVE ENABLE */ -__sbit __at 0x9C REN0 ; /* SCON.4 - RECEIVE ENABLE */ -__sbit __at 0x9D SM2 ; /* SCON.5 - MULTIPROCESSOR COMMUNICATION ENABLE */ -__sbit __at 0x9D MCE0 ; /* SCON.5 - MULTIPROCESSOR COMMUNICATION ENABLE */ -__sbit __at 0x9F SM0 ; /* SCON.7 - SERIAL MODE CONTROL BIT 0 */ -__sbit __at 0x9F S0MODE ; /* SCON.7 - SERIAL MODE CONTROL BIT 0 */ +__sbit __at (0x98) RI ; /* SCON.0 - RECEIVE INTERRUPT FLAG */ +__sbit __at (0x98) RI0 ; /* SCON.0 - RECEIVE INTERRUPT FLAG */ +__sbit __at (0x99) TI ; /* SCON.1 - TRANSMIT INTERRUPT FLAG */ +__sbit __at (0x99) TI0 ; /* SCON.1 - TRANSMIT INTERRUPT FLAG */ +__sbit __at (0x9A) RB8 ; /* SCON.2 - RECEIVE BIT 8 */ +__sbit __at (0x9A) RB80 ; /* SCON.2 - RECEIVE BIT 8 */ +__sbit __at (0x9B) TB8 ; /* SCON.3 - TRANSMIT BIT 8 */ +__sbit __at (0x9B) TB80 ; /* SCON.3 - TRANSMIT BIT 8 */ +__sbit __at (0x9C) REN ; /* SCON.4 - RECEIVE ENABLE */ +__sbit __at (0x9C) REN0 ; /* SCON.4 - RECEIVE ENABLE */ +__sbit __at (0x9D) SM2 ; /* SCON.5 - MULTIPROCESSOR COMMUNICATION ENABLE */ +__sbit __at (0x9D) MCE0 ; /* SCON.5 - MULTIPROCESSOR COMMUNICATION ENABLE */ +__sbit __at (0x9F) SM0 ; /* SCON.7 - SERIAL MODE CONTROL BIT 0 */ +__sbit __at (0x9F) S0MODE ; /* SCON.7 - SERIAL MODE CONTROL BIT 0 */ /* IE 0xA8 */ -__sbit __at 0xA8 EX0 ; /* IE.0 - EXTERNAL INTERRUPT 0 ENABLE */ -__sbit __at 0xA9 ET0 ; /* IE.1 - TIMER 0 INTERRUPT ENABLE */ -__sbit __at 0xAA EX1 ; /* IE.2 - EXTERNAL INTERRUPT 1 ENABLE */ -__sbit __at 0xAB ET1 ; /* IE.3 - TIMER 1 INTERRUPT ENABLE */ -__sbit __at 0xAC ES ; /* IE.4 - SERIAL PORT INTERRUPT ENABLE */ -__sbit __at 0xAC ES0 ; /* IE.4 - SERIAL PORT INTERRUPT ENABLE */ -__sbit __at 0xAD ET2 ; /* IE.5 - TIMER 2 INTERRUPT ENABLE */ -__sbit __at 0xAE IEGF0 ; /* IE.6 - GENERAL PURPOSE FLAG 0 */ -__sbit __at 0xAF EA ; /* IE.7 - GLOBAL INTERRUPT ENABLE */ +__sbit __at (0xA8) EX0 ; /* IE.0 - EXTERNAL INTERRUPT 0 ENABLE */ +__sbit __at (0xA9) ET0 ; /* IE.1 - TIMER 0 INTERRUPT ENABLE */ +__sbit __at (0xAA) EX1 ; /* IE.2 - EXTERNAL INTERRUPT 1 ENABLE */ +__sbit __at (0xAB) ET1 ; /* IE.3 - TIMER 1 INTERRUPT ENABLE */ +__sbit __at (0xAC) ES ; /* IE.4 - SERIAL PORT INTERRUPT ENABLE */ +__sbit __at (0xAC) ES0 ; /* IE.4 - SERIAL PORT INTERRUPT ENABLE */ +__sbit __at (0xAD) ET2 ; /* IE.5 - TIMER 2 INTERRUPT ENABLE */ +__sbit __at (0xAE) IEGF0 ; /* IE.6 - GENERAL PURPOSE FLAG 0 */ +__sbit __at (0xAF) EA ; /* IE.7 - GLOBAL INTERRUPT ENABLE */ /* IP 0xB8 */ -__sbit __at 0xB8 PX0 ; /* IP.0 - EXTERNAL INTERRUPT 0 PRIORITY */ -__sbit __at 0xB9 PT0 ; /* IP.1 - TIMER 0 PRIORITY */ -__sbit __at 0xBA PX1 ; /* IP.2 - EXTERNAL INTERRUPT 1 PRIORITY */ -__sbit __at 0xBB PT1 ; /* IP.3 - TIMER 1 PRIORITY */ -__sbit __at 0xBC PS ; /* IP.4 - SERIAL PORT PRIORITY */ -__sbit __at 0xBC PS0 ; /* IP.4 - SERIAL PORT PRIORITY */ -__sbit __at 0xBD PT2 ; /* IP.5 - TIMER 2 PRIORITY */ +__sbit __at (0xB8) PX0 ; /* IP.0 - EXTERNAL INTERRUPT 0 PRIORITY */ +__sbit __at (0xB9) PT0 ; /* IP.1 - TIMER 0 PRIORITY */ +__sbit __at (0xBA) PX1 ; /* IP.2 - EXTERNAL INTERRUPT 1 PRIORITY */ +__sbit __at (0xBB) PT1 ; /* IP.3 - TIMER 1 PRIORITY */ +__sbit __at (0xBC) PS ; /* IP.4 - SERIAL PORT PRIORITY */ +__sbit __at (0xBC) PS0 ; /* IP.4 - SERIAL PORT PRIORITY */ +__sbit __at (0xBD) PT2 ; /* IP.5 - TIMER 2 PRIORITY */ /* SMB0CN 0xC0 */ -__sbit __at 0xC0 SI ; /* SMB0CN.0 - SMBUS 0 INTERRUPT PENDING FLAG */ -__sbit __at 0xC1 ACK ; /* SMB0CN.1 - SMBUS 0 ACKNOWLEDGE FLAG */ -__sbit __at 0xC2 ARBLOST ; /* SMB0CN.2 - SMBUS 0 ARBITRATION LOST INDICATOR */ -__sbit __at 0xC3 ACKRQ ; /* SMB0CN.3 - SMBUS 0 ACKNOWLEDGE REQUEST */ -__sbit __at 0xC4 STO ; /* SMB0CN.4 - SMBUS 0 STOP FLAG */ -__sbit __at 0xC5 STA ; /* SMB0CN.5 - SMBUS 0 START FLAG */ -__sbit __at 0xC6 TXMODE ; /* SMB0CN.6 - SMBUS 0 TRANSMIT MODE INDICATOR */ -__sbit __at 0xC7 MASTER ; /* SMB0CN.7 - SMBUS 0 MASTER/SLAVE INDICATOR */ +__sbit __at (0xC0) SI ; /* SMB0CN.0 - SMBUS 0 INTERRUPT PENDING FLAG */ +__sbit __at (0xC1) ACK ; /* SMB0CN.1 - SMBUS 0 ACKNOWLEDGE FLAG */ +__sbit __at (0xC2) ARBLOST ; /* SMB0CN.2 - SMBUS 0 ARBITRATION LOST INDICATOR */ +__sbit __at (0xC3) ACKRQ ; /* SMB0CN.3 - SMBUS 0 ACKNOWLEDGE REQUEST */ +__sbit __at (0xC4) STO ; /* SMB0CN.4 - SMBUS 0 STOP FLAG */ +__sbit __at (0xC5) STA ; /* SMB0CN.5 - SMBUS 0 START FLAG */ +__sbit __at (0xC6) TXMODE ; /* SMB0CN.6 - SMBUS 0 TRANSMIT MODE INDICATOR */ +__sbit __at (0xC7) MASTER ; /* SMB0CN.7 - SMBUS 0 MASTER/SLAVE INDICATOR */ /* TMR2CN 0xC8 */ -__sbit __at 0xC8 T2XCLK ; /* TMR2CN.0 - TIMER 2 EXTERNAL CLOCK SELECT */ -__sbit __at 0xCA TR2 ; /* TMR2CN.2 - TIMER 2 ON/OFF CONTROL */ -__sbit __at 0xCB T2SPLIT ; /* TMR2CN.3 - TIMER 2 SPLIT MODE ENABLE */ -__sbit __at 0xCD TF2LEN ; /* TMR2CN.5 - TIMER 2 LOW BYTE INTERRUPT ENABLE */ -__sbit __at 0xCE TF2L ; /* TMR2CN.6 - TIMER 2 LOW BYTE OVERFLOW FLAG */ -__sbit __at 0xCF TF2 ; /* TMR2CN.7 - TIMER 2 OVERFLOW FLAG */ -__sbit __at 0xCF TF2H ; /* TMR2CN.7 - TIMER 2 HIGH BYTE OVERFLOW FLAG */ +__sbit __at (0xC8) T2XCLK ; /* TMR2CN.0 - TIMER 2 EXTERNAL CLOCK SELECT */ +__sbit __at (0xCA) TR2 ; /* TMR2CN.2 - TIMER 2 ON/OFF CONTROL */ +__sbit __at (0xCB) T2SPLIT ; /* TMR2CN.3 - TIMER 2 SPLIT MODE ENABLE */ +__sbit __at (0xCD) TF2LEN ; /* TMR2CN.5 - TIMER 2 LOW BYTE INTERRUPT ENABLE */ +__sbit __at (0xCE) TF2L ; /* TMR2CN.6 - TIMER 2 LOW BYTE OVERFLOW FLAG */ +__sbit __at (0xCF) TF2 ; /* TMR2CN.7 - TIMER 2 OVERFLOW FLAG */ +__sbit __at (0xCF) TF2H ; /* TMR2CN.7 - TIMER 2 HIGH BYTE OVERFLOW FLAG */ /* PSW 0xD0 */ -__sbit __at 0xD0 PARITY ; /* PSW.0 - ACCUMULATOR PARITY FLAG */ -__sbit __at 0xD1 F1 ; /* PSW.1 - FLAG 1 */ -__sbit __at 0xD2 OV ; /* PSW.2 - OVERFLOW FLAG */ -__sbit __at 0xD3 RS0 ; /* PSW.3 - REGISTER BANK SELECT 0 */ -__sbit __at 0xD4 RS1 ; /* PSW.4 - REGISTER BANK SELECT 1 */ -__sbit __at 0xD5 F0 ; /* PSW.5 - FLAG 0 */ -__sbit __at 0xD6 AC ; /* PSW.6 - AUXILIARY CARRY FLAG */ -__sbit __at 0xD7 CY ; /* PSW.7 - CARRY FLAG */ +__sbit __at (0xD0) PARITY ; /* PSW.0 - ACCUMULATOR PARITY FLAG */ +__sbit __at (0xD1) F1 ; /* PSW.1 - FLAG 1 */ +__sbit __at (0xD2) OV ; /* PSW.2 - OVERFLOW FLAG */ +__sbit __at (0xD3) RS0 ; /* PSW.3 - REGISTER BANK SELECT 0 */ +__sbit __at (0xD4) RS1 ; /* PSW.4 - REGISTER BANK SELECT 1 */ +__sbit __at (0xD5) F0 ; /* PSW.5 - FLAG 0 */ +__sbit __at (0xD6) AC ; /* PSW.6 - AUXILIARY CARRY FLAG */ +__sbit __at (0xD7) CY ; /* PSW.7 - CARRY FLAG */ /* PCA0CN 0xD8 */ -__sbit __at 0xD8 CCF0 ; /* PCA0CN.0 - PCA MODULE 0 CAPTURE/COMPARE FLAG */ -__sbit __at 0xD9 CCF1 ; /* PCA0CN.1 - PCA MODULE 1 CAPTURE/COMPARE FLAG */ -__sbit __at 0xDA CCF2 ; /* PCA0CN.2 - PCA MODULE 2 CAPTURE/COMPARE FLAG */ -__sbit __at 0xDE CR ; /* PCA0CN.6 - PCA COUNTER/TIMER RUN CONTROL */ -__sbit __at 0xDF CF ; /* PCA0CN.7 - PCA COUNTER/TIMER OVERFLOW FLAG */ +__sbit __at (0xD8) CCF0 ; /* PCA0CN.0 - PCA MODULE 0 CAPTURE/COMPARE FLAG */ +__sbit __at (0xD9) CCF1 ; /* PCA0CN.1 - PCA MODULE 1 CAPTURE/COMPARE FLAG */ +__sbit __at (0xDA) CCF2 ; /* PCA0CN.2 - PCA MODULE 2 CAPTURE/COMPARE FLAG */ +__sbit __at (0xDE) CR ; /* PCA0CN.6 - PCA COUNTER/TIMER RUN CONTROL */ +__sbit __at (0xDF) CF ; /* PCA0CN.7 - PCA COUNTER/TIMER OVERFLOW FLAG */ /* ADC0CN 0xE8 */ -__sbit __at 0xE8 AD0CM0 ; /* ADC0CN.0 - ADC 0 START OF CONV. MODE BIT 0 */ -__sbit __at 0xE9 AD0CM1 ; /* ADC0CN.1 - ADC 0 START OF CONV. MODE BIT 1 */ -__sbit __at 0xEA AD0CM2 ; /* ADC0CN.2 - ADC 0 START OF CONV. MODE BIT 2 */ -__sbit __at 0xEB AD0WINT ; /* ADC0CN.3 - ADC 0 WINDOW COMPARE INT. FLAG */ -__sbit __at 0xEC AD0BUSY ; /* ADC0CN.4 - ADC 0 BUSY FLAG */ -__sbit __at 0xED AD0INT ; /* ADC0CN.5 - ADC 0 CONV. COMPLETE INT. FLAG */ -__sbit __at 0xEE AD0TM ; /* ADC0CN.6 - ADC 0 TRACK MODE */ -__sbit __at 0xEF AD0EN ; /* ADC0CN.7 - ADC 0 ENABLE */ +__sbit __at (0xE8) AD0CM0 ; /* ADC0CN.0 - ADC 0 START OF CONV. MODE BIT 0 */ +__sbit __at (0xE9) AD0CM1 ; /* ADC0CN.1 - ADC 0 START OF CONV. MODE BIT 1 */ +__sbit __at (0xEA) AD0CM2 ; /* ADC0CN.2 - ADC 0 START OF CONV. MODE BIT 2 */ +__sbit __at (0xEB) AD0WINT ; /* ADC0CN.3 - ADC 0 WINDOW COMPARE INT. FLAG */ +__sbit __at (0xEC) AD0BUSY ; /* ADC0CN.4 - ADC 0 BUSY FLAG */ +__sbit __at (0xED) AD0INT ; /* ADC0CN.5 - ADC 0 CONV. COMPLETE INT. FLAG */ +__sbit __at (0xEE) AD0TM ; /* ADC0CN.6 - ADC 0 TRACK MODE */ +__sbit __at (0xEF) AD0EN ; /* ADC0CN.7 - ADC 0 ENABLE */ /* CPT0CN 0xF8 */ -__sbit __at 0xF8 CP0HYN0 ; /* CPT0CN.0 - Comp.0 Neg. Hysteresis Control Bit0*/ -__sbit __at 0xF9 CP0HYN1 ; /* CPT0CN.1 - Comp.0 Neg. Hysteresis Control Bit1*/ -__sbit __at 0xFA CP0HYP0 ; /* CPT0CN.2 - Comp.0 Pos. Hysteresis Control Bit0*/ -__sbit __at 0xFB CP0HYP1 ; /* CPT0CN.3 - Comp.0 Pos. Hysteresis Control Bit1*/ -__sbit __at 0xFC CP0FIF ; /* CPT0CN.4 - Comparator0 Falling-Edge Int. Flag */ -__sbit __at 0xFD CP0RIF ; /* CPT0CN.5 - Comparator0 Rising-Edge Int. Flag */ -__sbit __at 0xFE CP0OUT ; /* CPT0CN.6 - Comparator0 Output State Flag */ -__sbit __at 0xFF CP0EN ; /* CPT0CN.7 - Comparator0 Enable Bit */ +__sbit __at (0xF8) CP0HYN0 ; /* CPT0CN.0 - Comp.0 Neg. Hysteresis Control Bit0*/ +__sbit __at (0xF9) CP0HYN1 ; /* CPT0CN.1 - Comp.0 Neg. Hysteresis Control Bit1*/ +__sbit __at (0xFA) CP0HYP0 ; /* CPT0CN.2 - Comp.0 Pos. Hysteresis Control Bit0*/ +__sbit __at (0xFB) CP0HYP1 ; /* CPT0CN.3 - Comp.0 Pos. Hysteresis Control Bit1*/ +__sbit __at (0xFC) CP0FIF ; /* CPT0CN.4 - Comparator0 Falling-Edge Int. Flag */ +__sbit __at (0xFD) CP0RIF ; /* CPT0CN.5 - Comparator0 Rising-Edge Int. Flag */ +__sbit __at (0xFE) CP0OUT ; /* CPT0CN.6 - Comparator0 Output State Flag */ +__sbit __at (0xFF) CP0EN ; /* CPT0CN.7 - Comparator0 Enable Bit */ /* Predefined SFR Bit Masks */ -#define IDLE 0x01 /* PCON */ -#define STOP 0x02 /* PCON */ +#define PCON_IDLE 0x01 /* PCON */ +#define PCON_STOP 0x02 /* PCON */ #define T1M 0x10 /* CKCON */ #define PSWE 0x01 /* PSCTL */ #define PSEE 0x02 /* PSCTL */ diff --git a/device/include/mcs51/c8051f310.h b/device/include/mcs51/c8051f310.h index 67f334f2..b520aa73 100644 --- a/device/include/mcs51/c8051f310.h +++ b/device/include/mcs51/c8051f310.h @@ -24,294 +24,294 @@ /* BYTE Registers */ -__sfr __at 0x80 P0 ; /* PORT 0 */ -__sfr __at 0x81 SP ; /* STACK POINTER */ -__sfr __at 0x82 DPL ; /* DATA POINTER - LOW BYTE */ -__sfr __at 0x83 DPH ; /* DATA POINTER - HIGH BYTE */ -__sfr __at 0x87 PCON ; /* POWER CONTROL */ -__sfr __at 0x88 TCON ; /* TIMER CONTROL */ -__sfr __at 0x89 TMOD ; /* TIMER MODE */ -__sfr __at 0x8A TL0 ; /* TIMER 0 - LOW BYTE */ -__sfr __at 0x8B TL1 ; /* TIMER 1 - LOW BYTE */ -__sfr __at 0x8C TH0 ; /* TIMER 0 - HIGH BYTE */ -__sfr __at 0x8D TH1 ; /* TIMER 1 - HIGH BYTE */ -__sfr __at 0x8E CKCON ; /* CLOCK CONTROL */ -__sfr __at 0x8F PSCTL ; /* PROGRAM STORE R/W CONTROL */ -__sfr __at 0x90 P1 ; /* PORT 1 */ -__sfr __at 0x91 TMR3CN ; /* TIMER 3 CONTROL */ -__sfr __at 0x92 TMR3RLL ; /* TIMER 3 CAPTURE REGISTER - LOW BYTE */ -__sfr __at 0x93 TMR3RLH ; /* TIMER 3 CAPTURE REGISTER - HIGH BYTE */ -__sfr __at 0x94 TMR3L ; /* TIMER 3 - LOW BYTE */ -__sfr __at 0x95 TMR3H ; /* TIMER 3 - HIGH BYTE */ -__sfr __at 0x98 SCON ; /* SERIAL PORT CONTROL */ -__sfr __at 0x98 SCON0 ; /* SERIAL PORT CONTROL */ -__sfr __at 0x99 SBUF ; /* SERIAL PORT BUFFER */ -__sfr __at 0x99 SBUF0 ; /* SERIAL PORT BUFFER */ -__sfr __at 0x9A CPT1CN ; /* COMPARATOR 1 CONTROL */ -__sfr __at 0x9B CPT0CN ; /* COMPARATOR 0 CONTROL */ -__sfr __at 0x9C CPT1MD ; /* COMPARATOR 1 MODE SELECTION */ -__sfr __at 0x9D CPT0MD ; /* COMPARATOR 0 MODE SELECTION */ -__sfr __at 0x9E CPT1MX ; /* COMPARATOR 1 MUX SELECTION */ -__sfr __at 0x9F CPT0MX ; /* COMPARATOR 0 MUX SELECTION */ -__sfr __at 0xA0 P2 ; /* PORT 2 */ -__sfr __at 0xA1 SPI0CFG ; /* SPI0 CONFIGURATION */ -__sfr __at 0xA2 SPI0CKR ; /* SPI0 CLOCK RATE CONTROL */ -__sfr __at 0xA3 SPI0DAT ; /* SPI0 DATA */ -__sfr __at 0xA4 P0MDOUT ; /* PORT 0 OUTPUT MODE CONFIGURATION */ -__sfr __at 0xA5 P1MDOUT ; /* PORT 1 OUTPUT MODE CONFIGURATION */ -__sfr __at 0xA6 P2MDOUT ; /* PORT 2 OUTPUT MODE CONFIGURATION */ -__sfr __at 0xA7 P3MDOUT ; /* PORT 3 OUTPUT MODE CONFIGURATION */ -__sfr __at 0xA8 IE ; /* INTERRUPT ENABLE */ -__sfr __at 0xA9 CLKSEL ; /* SYSTEM CLOCK SELECT */ -__sfr __at 0xAA EMI0CN ; /* EXTERNAL MEMORY INTERFACE CONTROL */ -__sfr __at 0xAA _XPAGE ; /* XDATA/PDATA PAGE */ -__sfr __at 0xB0 P3 ; /* PORT 3 */ -__sfr __at 0xB1 OSCXCN ; /* EXTERNAL OSCILLATOR CONTROL */ -__sfr __at 0xB2 OSCICN ; /* INTERNAL OSCILLATOR CONTROL */ -__sfr __at 0xB3 OSCICL ; /* INTERNAL OSCILLATOR CALIBRATION */ -__sfr __at 0xB6 FLSCL ; /* FLASH MEMORY TIMING PRESCALER */ -__sfr __at 0xB7 FLKEY ; /* FLASH ACESS LIMIT */ -__sfr __at 0xB8 IP ; /* INTERRUPT PRIORITY */ -__sfr __at 0xBA AMX0N ; /* ADC 0 MUX NEGATIVE CHANNEL SELECTION */ -__sfr __at 0xBB AMX0P ; /* ADC 0 MUX POSITIVE CHANNEL SELECTION */ -__sfr __at 0xBC ADC0CF ; /* ADC 0 CONFIGURATION */ -__sfr __at 0xBD ADC0L ; /* ADC 0 DATA WORD LSB */ -__sfr __at 0xBE ADC0H ; /* ADC 0 DATA WORD MSB */ -__sfr __at 0xC0 SMB0CN ; /* SMBUS CONTROL */ -__sfr __at 0xC1 SMB0CF ; /* SMBUS CONFIGURATION */ -__sfr __at 0xC2 SMB0DAT ; /* SMBUS DATA */ -__sfr __at 0xC3 ADC0GTL ; /* ADC 0 GREATER-THAN LOW BYTE */ -__sfr __at 0xC4 ADC0GTH ; /* ADC 0 GREATER-THAN HIGH BYTE */ -__sfr __at 0xC5 ADC0LTL ; /* ADC 0 LESS-THAN LOW BYTE */ -__sfr __at 0xC6 ADC0LTH ; /* ADC 0 LESS-THAN HIGH BYTE */ -__sfr __at 0xC8 T2CON ; /* TIMER 2 CONTROL */ -__sfr __at 0xC8 TMR2CN ; /* TIMER 2 CONTROL */ -__sfr __at 0xCA RCAP2L ; /* TIMER 2 CAPTURE REGISTER - LOW BYTE */ -__sfr __at 0xCA TMR2RLL ; /* TIMER 2 CAPTURE REGISTER - LOW BYTE */ -__sfr __at 0xCB RCAP2H ; /* TIMER 2 CAPTURE REGISTER - HIGH BYTE */ -__sfr __at 0xCB TMR2RLH ; /* TIMER 2 CAPTURE REGISTER - HIGH BYTE */ -__sfr __at 0xCC TL2 ; /* TIMER 2 - LOW BYTE */ -__sfr __at 0xCC TMR2L ; /* TIMER 2 - LOW BYTE */ -__sfr __at 0xCD TH2 ; /* TIMER 2 - HIGH BYTE */ -__sfr __at 0xCD TMR2H ; /* TIMER 2 - HIGH BYTE */ -__sfr __at 0xD0 PSW ; /* PROGRAM STATUS WORD */ -__sfr __at 0xD1 REF0CN ; /* VOLTAGE REFERENCE 0 CONTROL */ -__sfr __at 0xD4 P0SKIP ; /* PORT 0 SKIP */ -__sfr __at 0xD5 P1SKIP ; /* PORT 1 SKIP */ -__sfr __at 0xD6 P2SKIP ; /* PORT 2 SKIP */ -__sfr __at 0xD8 PCA0CN ; /* PCA CONTROL */ -__sfr __at 0xD9 PCA0MD ; /* PCA MODE */ -__sfr __at 0xDA PCA0CPM0 ; /* PCA MODULE 0 MODE REGISTER */ -__sfr __at 0xDB PCA0CPM1 ; /* PCA MODULE 1 MODE REGISTER */ -__sfr __at 0xDC PCA0CPM2 ; /* PCA MODULE 2 MODE REGISTER */ -__sfr __at 0xDD PCA0CPM3 ; /* PCA MODULE 3 MODE REGISTER */ -__sfr __at 0xDE PCA0CPM4 ; /* PCA MODULE 4 MODE REGISTER */ -__sfr __at 0xE0 ACC ; /* ACCUMULATOR */ -__sfr __at 0xE1 XBR0 ; /* PORT MUX CONFIGURATION REGISTER 0 */ -__sfr __at 0xE2 XBR1 ; /* PORT MUX CONFIGURATION REGISTER 1 */ -__sfr __at 0xE4 IT01CF ; /* INT0/INT1 CONFIGURATION REGISTER */ -__sfr __at 0xE4 INT01CF ; /* INT0/INT1 CONFIGURATION REGISTER */ -__sfr __at 0xE6 EIE1 ; /* EXTERNAL INTERRUPT ENABLE 1 */ -__sfr __at 0xE8 ADC0CN ; /* ADC 0 CONTROL */ -__sfr __at 0xE9 PCA0CPL1 ; /* PCA CAPTURE 1 LOW */ -__sfr __at 0xEA PCA0CPH1 ; /* PCA CAPTURE 1 HIGH */ -__sfr __at 0xEB PCA0CPL2 ; /* PCA CAPTURE 2 LOW */ -__sfr __at 0xEC PCA0CPH2 ; /* PCA CAPTURE 2 HIGH */ -__sfr __at 0xED PCA0CPL3 ; /* PCA CAPTURE 3 LOW */ -__sfr __at 0xEE PCA0CPH3 ; /* PCA CAPTURE 3 HIGH */ -__sfr __at 0xEF RSTSRC ; /* RESET SOURCE */ -__sfr __at 0xF0 B ; /* B REGISTER */ -__sfr __at 0xF1 P0MODE ; /* PORT 0 INPUT MODE CONFIGURATION */ -__sfr __at 0xF1 P0MDIN ; /* PORT 0 INPUT MODE CONFIGURATION */ -__sfr __at 0xF2 P1MODE ; /* PORT 1 INPUT MODE CONFIGURATION */ -__sfr __at 0xF2 P1MDIN ; /* PORT 1 INPUT MODE CONFIGURATION */ -__sfr __at 0xF3 P2MODE ; /* PORT 2 INPUT MODE CONFIGURATION */ -__sfr __at 0xF3 P2MDIN ; /* PORT 2 INPUT MODE CONFIGURATION */ -__sfr __at 0xF4 P3MODE ; /* PORT 3 INPUT MODE CONFIGURATION */ -__sfr __at 0xF4 P3MDIN ; /* PORT 3 INPUT MODE CONFIGURATION */ -__sfr __at 0xF6 EIP1 ; /* EXTERNAL INTERRUPT PRIORITY REGISTER 1 */ -__sfr __at 0xF8 SPI0CN ; /* SPI0 CONTROL */ -__sfr __at 0xF9 PCA0L ; /* PCA COUNTER LOW */ -__sfr __at 0xFA PCA0H ; /* PCA COUNTER HIGH */ -__sfr __at 0xFB PCA0CPL0 ; /* PCA CAPTURE 0 LOW */ -__sfr __at 0xFC PCA0CPH0 ; /* PCA CAPTURE 0 HIGH */ -__sfr __at 0xFD PCA0CPL4 ; /* PCA CAPTURE 4 LOW */ -__sfr __at 0xFE PCA0CPH4 ; /* PCA CAPTURE 4 HIGH */ -__sfr __at 0xFF VDM0CN ; /* VDD MONITOR CONTROL */ +__sfr __at (0x80) P0 ; /* PORT 0 */ +__sfr __at (0x81) SP ; /* STACK POINTER */ +__sfr __at (0x82) DPL ; /* DATA POINTER - LOW BYTE */ +__sfr __at (0x83) DPH ; /* DATA POINTER - HIGH BYTE */ +__sfr __at (0x87) PCON ; /* POWER CONTROL */ +__sfr __at (0x88) TCON ; /* TIMER CONTROL */ +__sfr __at (0x89) TMOD ; /* TIMER MODE */ +__sfr __at (0x8A) TL0 ; /* TIMER 0 - LOW BYTE */ +__sfr __at (0x8B) TL1 ; /* TIMER 1 - LOW BYTE */ +__sfr __at (0x8C) TH0 ; /* TIMER 0 - HIGH BYTE */ +__sfr __at (0x8D) TH1 ; /* TIMER 1 - HIGH BYTE */ +__sfr __at (0x8E) CKCON ; /* CLOCK CONTROL */ +__sfr __at (0x8F) PSCTL ; /* PROGRAM STORE R/W CONTROL */ +__sfr __at (0x90) P1 ; /* PORT 1 */ +__sfr __at (0x91) TMR3CN ; /* TIMER 3 CONTROL */ +__sfr __at (0x92) TMR3RLL ; /* TIMER 3 CAPTURE REGISTER - LOW BYTE */ +__sfr __at (0x93) TMR3RLH ; /* TIMER 3 CAPTURE REGISTER - HIGH BYTE */ +__sfr __at (0x94) TMR3L ; /* TIMER 3 - LOW BYTE */ +__sfr __at (0x95) TMR3H ; /* TIMER 3 - HIGH BYTE */ +__sfr __at (0x98) SCON ; /* SERIAL PORT CONTROL */ +__sfr __at (0x98) SCON0 ; /* SERIAL PORT CONTROL */ +__sfr __at (0x99) SBUF ; /* SERIAL PORT BUFFER */ +__sfr __at (0x99) SBUF0 ; /* SERIAL PORT BUFFER */ +__sfr __at (0x9A) CPT1CN ; /* COMPARATOR 1 CONTROL */ +__sfr __at (0x9B) CPT0CN ; /* COMPARATOR 0 CONTROL */ +__sfr __at (0x9C) CPT1MD ; /* COMPARATOR 1 MODE SELECTION */ +__sfr __at (0x9D) CPT0MD ; /* COMPARATOR 0 MODE SELECTION */ +__sfr __at (0x9E) CPT1MX ; /* COMPARATOR 1 MUX SELECTION */ +__sfr __at (0x9F) CPT0MX ; /* COMPARATOR 0 MUX SELECTION */ +__sfr __at (0xA0) P2 ; /* PORT 2 */ +__sfr __at (0xA1) SPI0CFG ; /* SPI0 CONFIGURATION */ +__sfr __at (0xA2) SPI0CKR ; /* SPI0 CLOCK RATE CONTROL */ +__sfr __at (0xA3) SPI0DAT ; /* SPI0 DATA */ +__sfr __at (0xA4) P0MDOUT ; /* PORT 0 OUTPUT MODE CONFIGURATION */ +__sfr __at (0xA5) P1MDOUT ; /* PORT 1 OUTPUT MODE CONFIGURATION */ +__sfr __at (0xA6) P2MDOUT ; /* PORT 2 OUTPUT MODE CONFIGURATION */ +__sfr __at (0xA7) P3MDOUT ; /* PORT 3 OUTPUT MODE CONFIGURATION */ +__sfr __at (0xA8) IE ; /* INTERRUPT ENABLE */ +__sfr __at (0xA9) CLKSEL ; /* SYSTEM CLOCK SELECT */ +__sfr __at (0xAA) EMI0CN ; /* EXTERNAL MEMORY INTERFACE CONTROL */ +__sfr __at (0xAA) _XPAGE ; /* XDATA/PDATA PAGE */ +__sfr __at (0xB0) P3 ; /* PORT 3 */ +__sfr __at (0xB1) OSCXCN ; /* EXTERNAL OSCILLATOR CONTROL */ +__sfr __at (0xB2) OSCICN ; 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/* TIMER 2 CONTROL */ +__sfr __at (0xCA) RCAP2L ; /* TIMER 2 CAPTURE REGISTER - LOW BYTE */ +__sfr __at (0xCA) TMR2RLL ; /* TIMER 2 CAPTURE REGISTER - LOW BYTE */ +__sfr __at (0xCB) RCAP2H ; /* TIMER 2 CAPTURE REGISTER - HIGH BYTE */ +__sfr __at (0xCB) TMR2RLH ; /* TIMER 2 CAPTURE REGISTER - HIGH BYTE */ +__sfr __at (0xCC) TL2 ; /* TIMER 2 - LOW BYTE */ +__sfr __at (0xCC) TMR2L ; /* TIMER 2 - LOW BYTE */ +__sfr __at (0xCD) TH2 ; /* TIMER 2 - HIGH BYTE */ +__sfr __at (0xCD) TMR2H ; /* TIMER 2 - HIGH BYTE */ +__sfr __at (0xD0) PSW ; /* PROGRAM STATUS WORD */ +__sfr __at (0xD1) REF0CN ; /* VOLTAGE REFERENCE 0 CONTROL */ +__sfr __at (0xD4) P0SKIP ; /* PORT 0 SKIP */ +__sfr __at (0xD5) P1SKIP ; /* PORT 1 SKIP */ +__sfr __at (0xD6) P2SKIP ; /* PORT 2 SKIP */ +__sfr __at (0xD8) PCA0CN ; /* PCA CONTROL */ +__sfr __at (0xD9) PCA0MD ; /* PCA MODE */ +__sfr __at (0xDA) PCA0CPM0 ; /* PCA MODULE 0 MODE REGISTER */ +__sfr __at (0xDB) PCA0CPM1 ; /* PCA MODULE 1 MODE REGISTER */ +__sfr __at (0xDC) PCA0CPM2 ; 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/* PORT 0 INPUT MODE CONFIGURATION */ +__sfr __at (0xF1) P0MDIN ; /* PORT 0 INPUT MODE CONFIGURATION */ +__sfr __at (0xF2) P1MODE ; /* PORT 1 INPUT MODE CONFIGURATION */ +__sfr __at (0xF2) P1MDIN ; /* PORT 1 INPUT MODE CONFIGURATION */ +__sfr __at (0xF3) P2MODE ; /* PORT 2 INPUT MODE CONFIGURATION */ +__sfr __at (0xF3) P2MDIN ; /* PORT 2 INPUT MODE CONFIGURATION */ +__sfr __at (0xF4) P3MODE ; /* PORT 3 INPUT MODE CONFIGURATION */ +__sfr __at (0xF4) P3MDIN ; /* PORT 3 INPUT MODE CONFIGURATION */ +__sfr __at (0xF6) EIP1 ; /* EXTERNAL INTERRUPT PRIORITY REGISTER 1 */ +__sfr __at (0xF8) SPI0CN ; /* SPI0 CONTROL */ +__sfr __at (0xF9) PCA0L ; /* PCA COUNTER LOW */ +__sfr __at (0xFA) PCA0H ; /* PCA COUNTER HIGH */ +__sfr __at (0xFB) PCA0CPL0 ; /* PCA CAPTURE 0 LOW */ +__sfr __at (0xFC) PCA0CPH0 ; /* PCA CAPTURE 0 HIGH */ +__sfr __at (0xFD) PCA0CPL4 ; /* PCA CAPTURE 4 LOW */ +__sfr __at (0xFE) PCA0CPH4 ; /* PCA CAPTURE 4 HIGH */ +__sfr __at (0xFF) VDM0CN ; /* VDD MONITOR CONTROL */ /* WORD/DWORD Registers */ -__sfr16 __at 0x8C8A TMR0 ; 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INTERRUPT 0 TYPE */ -__sbit __at 0x89 IE0 ; /* TCON.1 - EXT. INTERRUPT 0 EDGE FLAG */ -__sbit __at 0x8A IT1 ; /* TCON.2 - EXT. INTERRUPT 1 TYPE */ -__sbit __at 0x8B IE1 ; /* TCON.3 - EXT. INTERRUPT 1 EDGE FLAG */ -__sbit __at 0x8C TR0 ; /* TCON.4 - TIMER 0 ON/OFF CONTROL */ -__sbit __at 0x8D TF0 ; /* TCON.5 - TIMER 0 OVERFLOW FLAG */ -__sbit __at 0x8E TR1 ; /* TCON.6 - TIMER 1 ON/OFF CONTROL */ -__sbit __at 0x8F TF1 ; /* TCON.7 - TIMER 1 OVERFLOW FLAG */ +__sbit __at (0x88) IT0 ; /* TCON.0 - EXT. INTERRUPT 0 TYPE */ +__sbit __at (0x89) IE0 ; /* TCON.1 - EXT. INTERRUPT 0 EDGE FLAG */ +__sbit __at (0x8A) IT1 ; /* TCON.2 - EXT. INTERRUPT 1 TYPE */ +__sbit __at (0x8B) IE1 ; /* TCON.3 - EXT. INTERRUPT 1 EDGE FLAG */ +__sbit __at (0x8C) TR0 ; /* TCON.4 - TIMER 0 ON/OFF CONTROL */ +__sbit __at (0x8D) TF0 ; /* TCON.5 - TIMER 0 OVERFLOW FLAG */ +__sbit __at (0x8E) TR1 ; /* TCON.6 - TIMER 1 ON/OFF CONTROL */ +__sbit __at (0x8F) TF1 ; /* TCON.7 - TIMER 1 OVERFLOW FLAG */ /* P1 0x90 */ -__sbit __at 0x90 P1_0 ; -__sbit __at 0x91 P1_1 ; -__sbit __at 0x92 P1_2 ; -__sbit __at 0x93 P1_3 ; -__sbit __at 0x94 P1_4 ; -__sbit __at 0x95 P1_5 ; -__sbit __at 0x96 P1_6 ; -__sbit __at 0x97 P1_7 ; +__sbit __at (0x90) P1_0 ; +__sbit __at (0x91) P1_1 ; +__sbit __at (0x92) P1_2 ; +__sbit __at (0x93) P1_3 ; +__sbit __at (0x94) P1_4 ; +__sbit __at (0x95) P1_5 ; +__sbit __at (0x96) P1_6 ; +__sbit __at (0x97) P1_7 ; /* SCON 0x98 */ -__sbit __at 0x98 RI ; /* SCON.0 - RECEIVE INTERRUPT FLAG */ -__sbit __at 0x98 RI0 ; /* SCON.0 - RECEIVE INTERRUPT FLAG */ -__sbit __at 0x99 TI ; /* SCON.1 - TRANSMIT INTERRUPT FLAG */ -__sbit __at 0x99 TI0 ; /* SCON.1 - TRANSMIT INTERRUPT FLAG */ -__sbit __at 0x9A RB8 ; /* SCON.2 - RECEIVE BIT 8 */ -__sbit __at 0x9A RB80 ; /* SCON.2 - RECEIVE BIT 8 */ -__sbit __at 0x9B TB8 ; /* SCON.3 - TRANSMIT BIT 8 */ -__sbit __at 0x9B TB80 ; /* SCON.3 - TRANSMIT BIT 8 */ -__sbit __at 0x9C REN ; /* SCON.4 - RECEIVE ENABLE */ -__sbit __at 0x9C REN0 ; /* SCON.4 - RECEIVE ENABLE */ -__sbit __at 0x9D SM2 ; /* SCON.5 - MULTIPROCESSOR COMMUNICATION ENABLE */ -__sbit __at 0x9D MCE0 ; /* SCON.5 - MULTIPROCESSOR COMMUNICATION ENABLE */ -__sbit __at 0x9F SM0 ; /* SCON.7 - SERIAL MODE CONTROL BIT 0 */ -__sbit __at 0x9F S0MODE ; /* SCON.7 - SERIAL MODE CONTROL BIT 0 */ +__sbit __at (0x98) RI ; /* SCON.0 - RECEIVE INTERRUPT FLAG */ +__sbit __at (0x98) RI0 ; /* SCON.0 - RECEIVE INTERRUPT FLAG */ +__sbit __at (0x99) TI ; /* SCON.1 - TRANSMIT INTERRUPT FLAG */ +__sbit __at (0x99) TI0 ; /* SCON.1 - TRANSMIT INTERRUPT FLAG */ +__sbit __at (0x9A) RB8 ; /* SCON.2 - RECEIVE BIT 8 */ +__sbit __at (0x9A) RB80 ; /* SCON.2 - RECEIVE BIT 8 */ +__sbit __at (0x9B) TB8 ; /* SCON.3 - TRANSMIT BIT 8 */ +__sbit __at (0x9B) TB80 ; /* SCON.3 - TRANSMIT BIT 8 */ +__sbit __at (0x9C) REN ; /* SCON.4 - RECEIVE ENABLE */ +__sbit __at (0x9C) REN0 ; /* SCON.4 - RECEIVE ENABLE */ +__sbit __at (0x9D) SM2 ; /* SCON.5 - MULTIPROCESSOR COMMUNICATION ENABLE */ +__sbit __at (0x9D) MCE0 ; /* SCON.5 - MULTIPROCESSOR COMMUNICATION ENABLE */ +__sbit __at (0x9F) SM0 ; /* SCON.7 - SERIAL MODE CONTROL BIT 0 */ +__sbit __at (0x9F) S0MODE ; /* SCON.7 - SERIAL MODE CONTROL BIT 0 */ /* P2 0xA0 */ -__sbit __at 0xA0 P2_0 ; -__sbit __at 0xA1 P2_1 ; -__sbit __at 0xA2 P2_2 ; -__sbit __at 0xA3 P2_3 ; -__sbit __at 0xA4 P2_4 ; -__sbit __at 0xA5 P2_5 ; -__sbit __at 0xA6 P2_6 ; -__sbit __at 0xA7 P2_7 ; +__sbit __at (0xA0) P2_0 ; +__sbit __at (0xA1) P2_1 ; +__sbit __at (0xA2) P2_2 ; +__sbit __at (0xA3) P2_3 ; +__sbit __at (0xA4) P2_4 ; +__sbit __at (0xA5) P2_5 ; +__sbit __at (0xA6) P2_6 ; +__sbit __at (0xA7) P2_7 ; /* IE 0xA8 */ -__sbit __at 0xA8 EX0 ; /* IE.0 - EXTERNAL INTERRUPT 0 ENABLE */ -__sbit __at 0xA9 ET0 ; /* IE.1 - TIMER 0 INTERRUPT ENABLE */ -__sbit __at 0xAA EX1 ; /* IE.2 - EXTERNAL INTERRUPT 1 ENABLE */ -__sbit __at 0xAB ET1 ; /* IE.3 - TIMER 1 INTERRUPT ENABLE */ -__sbit __at 0xAC ES ; /* IE.4 - SERIAL PORT INTERRUPT ENABLE */ -__sbit __at 0xAC ES0 ; /* IE.4 - SERIAL PORT INTERRUPT ENABLE */ -__sbit __at 0xAD ET2 ; /* IE.5 - TIMER 2 INTERRUPT ENABLE */ -__sbit __at 0xAE ESPI0 ; /* IE.6 - SPI0 INTERRUPT ENABLE */ -__sbit __at 0xAF EA ; /* IE.7 - GLOBAL INTERRUPT ENABLE */ +__sbit __at (0xA8) EX0 ; /* IE.0 - EXTERNAL INTERRUPT 0 ENABLE */ +__sbit __at (0xA9) ET0 ; /* IE.1 - TIMER 0 INTERRUPT ENABLE */ +__sbit __at (0xAA) EX1 ; /* IE.2 - EXTERNAL INTERRUPT 1 ENABLE */ +__sbit __at (0xAB) ET1 ; /* IE.3 - TIMER 1 INTERRUPT ENABLE */ +__sbit __at (0xAC) ES ; /* IE.4 - SERIAL PORT INTERRUPT ENABLE */ +__sbit __at (0xAC) ES0 ; /* IE.4 - SERIAL PORT INTERRUPT ENABLE */ +__sbit __at (0xAD) ET2 ; /* IE.5 - TIMER 2 INTERRUPT ENABLE */ +__sbit __at (0xAE) ESPI0 ; /* IE.6 - SPI0 INTERRUPT ENABLE */ +__sbit __at (0xAF) EA ; /* IE.7 - GLOBAL INTERRUPT ENABLE */ /* P3 0xB0 */ -__sbit __at 0xB0 P3_0 ; -__sbit __at 0xB1 P3_1 ; -__sbit __at 0xB2 P3_2 ; -__sbit __at 0xB3 P3_3 ; -__sbit __at 0xB4 P3_4 ; -__sbit __at 0xB5 P3_5 ; -__sbit __at 0xB6 P3_6 ; -__sbit __at 0xB7 P3_7 ; +__sbit __at (0xB0) P3_0 ; +__sbit __at (0xB1) P3_1 ; +__sbit __at (0xB2) P3_2 ; +__sbit __at (0xB3) P3_3 ; +__sbit __at (0xB4) P3_4 ; +__sbit __at (0xB5) P3_5 ; +__sbit __at (0xB6) P3_6 ; +__sbit __at (0xB7) P3_7 ; /* IP 0xB8 */ -__sbit __at 0xB8 PX0 ; /* IP.0 - EXTERNAL INTERRUPT 0 PRIORITY */ -__sbit __at 0xB9 PT0 ; /* IP.1 - TIMER 0 PRIORITY */ -__sbit __at 0xBA PX1 ; /* IP.2 - EXTERNAL INTERRUPT 1 PRIORITY */ -__sbit __at 0xBB PT1 ; /* IP.3 - TIMER 1 PRIORITY */ -__sbit __at 0xBC PS ; /* IP.4 - SERIAL PORT PRIORITY */ -__sbit __at 0xBC PS0 ; /* IP.4 - SERIAL PORT PRIORITY */ -__sbit __at 0xBD PT2 ; /* IP.5 - TIMER 2 PRIORITY */ -__sbit __at 0xBE PSPI0 ; /* IP.6 - SPI0 PRIORITY */ +__sbit __at (0xB8) PX0 ; /* IP.0 - EXTERNAL INTERRUPT 0 PRIORITY */ +__sbit __at (0xB9) PT0 ; /* IP.1 - TIMER 0 PRIORITY */ +__sbit __at (0xBA) PX1 ; /* IP.2 - EXTERNAL INTERRUPT 1 PRIORITY */ +__sbit __at (0xBB) PT1 ; /* IP.3 - TIMER 1 PRIORITY */ +__sbit __at (0xBC) PS ; /* IP.4 - SERIAL PORT PRIORITY */ +__sbit __at (0xBC) PS0 ; /* IP.4 - SERIAL PORT PRIORITY */ +__sbit __at (0xBD) PT2 ; /* IP.5 - TIMER 2 PRIORITY */ +__sbit __at (0xBE) PSPI0 ; /* IP.6 - SPI0 PRIORITY */ /* SMB0CN 0xC0 */ -__sbit __at 0xC0 SI ; /* SMB0CN.0 - SMBUS 0 INTERRUPT PENDING FLAG */ -__sbit __at 0xC1 ACK ; /* SMB0CN.1 - SMBUS 0 ACKNOWLEDGE FLAG */ -__sbit __at 0xC2 ARBLOST ; /* SMB0CN.2 - SMBUS 0 ARBITRATION LOST INDICATOR */ -__sbit __at 0xC3 ACKRQ ; /* SMB0CN.3 - SMBUS 0 ACKNOWLEDGE REQUEST */ -__sbit __at 0xC4 STO ; /* SMB0CN.4 - SMBUS 0 STOP FLAG */ -__sbit __at 0xC5 STA ; /* SMB0CN.5 - SMBUS 0 START FLAG */ -__sbit __at 0xC6 TXMODE ; /* SMB0CN.6 - SMBUS 0 TRANSMIT MODE INDICATOR */ -__sbit __at 0xC7 MASTER ; /* SMB0CN.7 - SMBUS 0 MASTER/SLAVE INDICATOR */ +__sbit __at (0xC0) SI ; /* SMB0CN.0 - SMBUS 0 INTERRUPT PENDING FLAG */ +__sbit __at (0xC1) ACK ; /* SMB0CN.1 - SMBUS 0 ACKNOWLEDGE FLAG */ +__sbit __at (0xC2) ARBLOST ; /* SMB0CN.2 - SMBUS 0 ARBITRATION LOST INDICATOR */ +__sbit __at (0xC3) ACKRQ ; /* SMB0CN.3 - SMBUS 0 ACKNOWLEDGE REQUEST */ +__sbit __at (0xC4) STO ; /* SMB0CN.4 - SMBUS 0 STOP FLAG */ +__sbit __at (0xC5) STA ; /* SMB0CN.5 - SMBUS 0 START FLAG */ +__sbit __at (0xC6) TXMODE ; /* SMB0CN.6 - SMBUS 0 TRANSMIT MODE INDICATOR */ +__sbit __at (0xC7) MASTER ; /* SMB0CN.7 - SMBUS 0 MASTER/SLAVE INDICATOR */ /* TMR2CN 0xC8 */ -__sbit __at 0xC8 T2XCLK ; /* TMR2CN.0 - TIMER 2 EXTERNAL CLOCK SELECT */ -__sbit __at 0xCA TR2 ; /* TMR2CN.2 - TIMER 2 ON/OFF CONTROL */ -__sbit __at 0xCB T2SPLIT ; /* TMR2CN.3 - TIMER 2 SPLIT MODE ENABLE */ -__sbit __at 0xCD TF2LEN ; /* TMR2CN.5 - TIMER 2 LOW BYTE INTERRUPT ENABLE */ -__sbit __at 0xCE TF2L ; /* TMR2CN.6 - TIMER 2 LOW BYTE OVERFLOW FLAG */ -__sbit __at 0xCF TF2 ; /* TMR2CN.7 - TIMER 2 OVERFLOW FLAG */ -__sbit __at 0xCF TF2H ; /* TMR2CN.7 - TIMER 2 HIGH BYTE OVERFLOW FLAG */ +__sbit __at (0xC8) T2XCLK ; /* TMR2CN.0 - TIMER 2 EXTERNAL CLOCK SELECT */ +__sbit __at (0xCA) TR2 ; /* TMR2CN.2 - TIMER 2 ON/OFF CONTROL */ +__sbit __at (0xCB) T2SPLIT ; /* TMR2CN.3 - TIMER 2 SPLIT MODE ENABLE */ +__sbit __at (0xCD) TF2LEN ; /* TMR2CN.5 - TIMER 2 LOW BYTE INTERRUPT ENABLE */ +__sbit __at (0xCE) TF2L ; /* TMR2CN.6 - TIMER 2 LOW BYTE OVERFLOW FLAG */ +__sbit __at (0xCF) TF2 ; /* TMR2CN.7 - TIMER 2 OVERFLOW FLAG */ +__sbit __at (0xCF) TF2H ; /* TMR2CN.7 - TIMER 2 HIGH BYTE OVERFLOW FLAG */ /* PSW 0xD0 */ -__sbit __at 0xD0 PARITY ; /* PSW.0 - ACCUMULATOR PARITY FLAG */ -__sbit __at 0xD1 F1 ; /* PSW.1 - FLAG 1 */ -__sbit __at 0xD2 OV ; /* PSW.2 - OVERFLOW FLAG */ -__sbit __at 0xD3 RS0 ; /* PSW.3 - REGISTER BANK SELECT 0 */ -__sbit __at 0xD4 RS1 ; /* PSW.4 - REGISTER BANK SELECT 1 */ -__sbit __at 0xD5 F0 ; /* PSW.5 - FLAG 0 */ -__sbit __at 0xD6 AC ; /* PSW.6 - AUXILIARY CARRY FLAG */ -__sbit __at 0xD7 CY ; /* PSW.7 - CARRY FLAG */ +__sbit __at (0xD0) PARITY ; /* PSW.0 - ACCUMULATOR PARITY FLAG */ +__sbit __at (0xD1) F1 ; /* PSW.1 - FLAG 1 */ +__sbit __at (0xD2) OV ; /* PSW.2 - OVERFLOW FLAG */ +__sbit __at (0xD3) RS0 ; /* PSW.3 - REGISTER BANK SELECT 0 */ +__sbit __at (0xD4) RS1 ; /* PSW.4 - REGISTER BANK SELECT 1 */ +__sbit __at (0xD5) F0 ; /* PSW.5 - FLAG 0 */ +__sbit __at (0xD6) AC ; /* PSW.6 - AUXILIARY CARRY FLAG */ +__sbit __at (0xD7) CY ; /* PSW.7 - CARRY FLAG */ /* PCA0CN 0xD8 */ -__sbit __at 0xD8 CCF0 ; /* PCA0CN.0 - PCA MODULE 0 CAPTURE/COMPARE FLAG */ -__sbit __at 0xD9 CCF1 ; /* PCA0CN.1 - PCA MODULE 1 CAPTURE/COMPARE FLAG */ -__sbit __at 0xDA CCF2 ; /* PCA0CN.2 - PCA MODULE 2 CAPTURE/COMPARE FLAG */ -__sbit __at 0xDB CCF3 ; /* PCA0CN.3 - PCA MODULE 3 CAPTURE/COMPARE FLAG */ -__sbit __at 0xDC CCF4 ; /* PCA0CN.4 - PCA MODULE 4 CAPTURE/COMPARE FLAG */ -__sbit __at 0xDE CR ; /* PCA0CN.6 - PCA COUNTER/TIMER RUN CONTROL */ -__sbit __at 0xDF CF ; /* PCA0CN.7 - PCA COUNTER/TIMER OVERFLOW FLAG */ +__sbit __at (0xD8) CCF0 ; /* PCA0CN.0 - PCA MODULE 0 CAPTURE/COMPARE FLAG */ +__sbit __at (0xD9) CCF1 ; /* PCA0CN.1 - PCA MODULE 1 CAPTURE/COMPARE FLAG */ +__sbit __at (0xDA) CCF2 ; /* PCA0CN.2 - PCA MODULE 2 CAPTURE/COMPARE FLAG */ +__sbit __at (0xDB) CCF3 ; /* PCA0CN.3 - PCA MODULE 3 CAPTURE/COMPARE FLAG */ +__sbit __at (0xDC) CCF4 ; /* PCA0CN.4 - PCA MODULE 4 CAPTURE/COMPARE FLAG */ +__sbit __at (0xDE) CR ; /* PCA0CN.6 - PCA COUNTER/TIMER RUN CONTROL */ +__sbit __at (0xDF) CF ; /* PCA0CN.7 - PCA COUNTER/TIMER OVERFLOW FLAG */ /* ADC0CN 0xE8 */ -__sbit __at 0xE8 AD0CM0 ; /* ADC0CN.0 - ADC 0 START OF CONV. MODE BIT 0 */ -__sbit __at 0xE9 AD0CM1 ; /* ADC0CN.1 - ADC 0 START OF CONV. MODE BIT 1 */ -__sbit __at 0xEA AD0CM2 ; /* ADC0CN.2 - ADC 0 START OF CONV. MODE BIT 2 */ -__sbit __at 0xEB AD0WINT ; /* ADC0CN.3 - ADC 0 WINDOW COMPARE INT. FLAG */ -__sbit __at 0xEC AD0BUSY ; /* ADC0CN.4 - ADC 0 BUSY FLAG */ -__sbit __at 0xED AD0INT ; /* ADC0CN.5 - ADC 0 CONV. COMPLETE INT. FLAG */ -__sbit __at 0xEE AD0TM ; /* ADC0CN.6 - ADC 0 TRACK MODE */ -__sbit __at 0xEF AD0EN ; /* ADC0CN.7 - ADC 0 ENABLE */ +__sbit __at (0xE8) AD0CM0 ; /* ADC0CN.0 - ADC 0 START OF CONV. MODE BIT 0 */ +__sbit __at (0xE9) AD0CM1 ; /* ADC0CN.1 - ADC 0 START OF CONV. MODE BIT 1 */ +__sbit __at (0xEA) AD0CM2 ; /* ADC0CN.2 - ADC 0 START OF CONV. MODE BIT 2 */ +__sbit __at (0xEB) AD0WINT ; /* ADC0CN.3 - ADC 0 WINDOW COMPARE INT. FLAG */ +__sbit __at (0xEC) AD0BUSY ; /* ADC0CN.4 - ADC 0 BUSY FLAG */ +__sbit __at (0xED) AD0INT ; /* ADC0CN.5 - ADC 0 CONV. COMPLETE INT. FLAG */ +__sbit __at (0xEE) AD0TM ; /* ADC0CN.6 - ADC 0 TRACK MODE */ +__sbit __at (0xEF) AD0EN ; /* ADC0CN.7 - ADC 0 ENABLE */ /* SPI0CN 0xF8 */ -__sbit __at 0xF8 SPIEN ; /* SPI0CN.0 - SPI0 ENABLE */ -__sbit __at 0xF9 TXBMT ; /* SPI0CN.1 - TRANSMIT BUFFER EMPTY */ -__sbit __at 0xFA NSSMD0 ; /* SPI0CN.2 - SLAVE SELECT MODE BIT 0 */ -__sbit __at 0xFB NSSMD1 ; /* SPI0CN.3 - SLAVE SELECT MODE BIT 1 */ -__sbit __at 0xFC RXOVRN ; /* SPI0CN.4 - RECEIVE OVERRUN FLAG */ -__sbit __at 0xFD MODF ; /* SPI0CN.5 - MODE FAULT FLAG */ -__sbit __at 0xFE WCOL ; /* SPI0CN.6 - WRITE COLLISION FLAG */ -__sbit __at 0xFF SPIF ; /* SPI0CN.7 - SPI0 INTERRUPT FLAG */ +__sbit __at (0xF8) SPIEN ; /* SPI0CN.0 - SPI0 ENABLE */ +__sbit __at (0xF9) TXBMT ; /* SPI0CN.1 - TRANSMIT BUFFER EMPTY */ +__sbit __at (0xFA) NSSMD0 ; /* SPI0CN.2 - SLAVE SELECT MODE BIT 0 */ +__sbit __at (0xFB) NSSMD1 ; /* SPI0CN.3 - SLAVE SELECT MODE BIT 1 */ +__sbit __at (0xFC) RXOVRN ; /* SPI0CN.4 - RECEIVE OVERRUN FLAG */ +__sbit __at (0xFD) MODF ; /* SPI0CN.5 - MODE FAULT FLAG */ +__sbit __at (0xFE) WCOL ; /* SPI0CN.6 - WRITE COLLISION FLAG */ +__sbit __at (0xFF) SPIF ; /* SPI0CN.7 - SPI0 INTERRUPT FLAG */ /* Predefined SFR Bit Masks */ -#define IDLE 0x01 /* PCON */ -#define STOP 0x02 /* PCON */ +#define PCON_IDLE 0x01 /* PCON */ +#define PCON_STOP 0x02 /* PCON */ #define T1M 0x08 /* CKCON */ #define PSWE 0x01 /* PSCTL */ #define PSEE 0x02 /* PSCTL */ diff --git a/device/include/mcs51/c8051f320.h b/device/include/mcs51/c8051f320.h index 9ab9b638..77ded177 100644 --- a/device/include/mcs51/c8051f320.h +++ b/device/include/mcs51/c8051f320.h @@ -23,282 +23,302 @@ /* BYTE Registers */ -__sfr __at 0x80 P0 ; /* PORT 0 */ -__sfr __at 0x81 SP ; /* STACK POINTER */ -__sfr __at 0x82 DPL ; /* DATA POINTER - LOW BYTE */ -__sfr __at 0x83 DPH ; /* DATA POINTER - HIGH BYTE */ -__sfr __at 0x87 PCON ; /* POWER CONTROL */ -__sfr __at 0x88 TCON ; /* TIMER CONTROL */ -__sfr __at 0x89 TMOD ; /* TIMER MODE */ -__sfr __at 0x8A TL0 ; /* TIMER 0 - LOW BYTE */ -__sfr __at 0x8B TL1 ; /* TIMER 1 - LOW BYTE */ -__sfr __at 0x8C TH0 ; /* TIMER 0 - HIGH BYTE */ -__sfr __at 0x8D TH1 ; /* TIMER 1 - HIGH BYTE */ -__sfr __at 0x8E CKCON ; /* CLOCK CONTROL */ -__sfr __at 0x8F PSCTL ; /* PROGRAM STORE R/W CONTROL */ -__sfr __at 0x90 P1 ; /* PORT 1 */ -__sfr __at 0x91 TMR3CN ; /* TIMER 3 CONTROL */ -__sfr __at 0x92 TMR3RLL ; /* TIMER 3 CAPTURE REGISTER - LOW BYTE */ -__sfr __at 0x93 TMR3RLH ; /* TIMER 3 CAPTURE REGISTER - HIGH BYTE */ -__sfr __at 0x94 TMR3L ; /* TIMER 3 - LOW BYTE */ -__sfr __at 0x95 TMR3H ; /* TIMER 3 - HIGH BYTE */ -__sfr __at 0x96 USB0ADR ; /* USB0 INDIRECT ADDRESS REGISTER */ -__sfr __at 0x97 USB0DAT ; /* USB0 DATA REGISTER */ -__sfr __at 0x98 SCON ; /* SERIAL PORT CONTROL */ -__sfr __at 0x98 SCON0 ; /* SERIAL PORT CONTROL */ -__sfr __at 0x99 SBUF ; /* SERIAL PORT BUFFER */ -__sfr __at 0x99 SBUF0 ; /* SERIAL PORT BUFFER */ -__sfr __at 0x9A CPT1CN ; /* COMPARATOR 1 CONTROL */ -__sfr __at 0x9B CPT0CN ; /* COMPARATOR 0 CONTROL */ -__sfr __at 0x9C CPT1MD ; /* COMPARATOR 1 MODE SELECTION */ -__sfr __at 0x9D CPT0MD ; /* COMPARATOR 0 MODE SELECTION */ -__sfr __at 0x9E CPT1MX ; /* COMPARATOR 1 MUX SELECTION */ -__sfr __at 0x9F CPT0MX ; /* COMPARATOR 0 MUX SELECTION */ -__sfr __at 0xA0 P2 ; /* PORT 2 */ -__sfr __at 0xA1 SPI0CFG ; /* SPI0 CONFIGURATION */ -__sfr __at 0xA2 SPI0CKR ; /* SPI0 CLOCK RATE CONTROL */ -__sfr __at 0xA3 SPI0DAT ; /* SPI0 DATA */ -__sfr __at 0xA4 P0MDOUT ; /* PORT 0 OUTPUT MODE CONFIGURATION */ -__sfr __at 0xA5 P1MDOUT ; /* PORT 1 OUTPUT MODE CONFIGURATION */ -__sfr __at 0xA6 P2MDOUT ; /* PORT 2 OUTPUT MODE CONFIGURATION */ -__sfr __at 0xA7 P3MDOUT ; /* PORT 3 OUTPUT MODE CONFIGURATION */ -__sfr __at 0xA8 IE ; /* INTERRUPT ENABLE */ -__sfr __at 0xA9 CLKSEL ; /* SYSTEM CLOCK SELECT */ -__sfr __at 0xAA EMI0CN ; /* EXTERNAL MEMORY INTERFACE CONTROL */ -__sfr __at 0xAA _XPAGE ; /* XDATA/PDATA PAGE */ -__sfr __at 0xB0 P3 ; /* PORT 3 */ -__sfr __at 0xB1 OSCXCN ; /* EXTERNAL OSCILLATOR CONTROL */ -__sfr __at 0xB2 OSCICN ; /* INTERNAL OSCILLATOR CONTROL */ -__sfr __at 0xB3 OSCICL ; /* INTERNAL OSCILLATOR CALIBRATION */ -__sfr __at 0xB6 FLSCL ; /* FLASH MEMORY TIMING PRESCALER */ -__sfr __at 0xB7 FLKEY ; /* FLASH ACESS LIMIT */ -__sfr __at 0xB8 IP ; /* INTERRUPT PRIORITY */ -__sfr __at 0xB9 CLKMUL ; /* CLOCK MULTIPLIER CONTROL REGISTER */ -__sfr __at 0xBA AMX0N ; /* ADC 0 MUX NEGATIVE CHANNEL SELECTION */ -__sfr __at 0xBB AMX0P ; /* ADC 0 MUX POSITIVE CHANNEL SELECTION */ -__sfr __at 0xBC ADC0CF ; /* ADC 0 CONFIGURATION */ -__sfr __at 0xBD ADC0L ; /* ADC 0 DATA WORD LSB */ -__sfr __at 0xBE ADC0H ; /* ADC 0 DATA WORD MSB */ -__sfr __at 0xC0 SMB0CN ; /* SMBUS CONTROL */ -__sfr __at 0xC1 SMB0CF ; /* SMBUS CONFIGURATION */ -__sfr __at 0xC2 SMB0DAT ; /* SMBUS DATA */ -__sfr __at 0xC3 ADC0GTL ; /* ADC 0 GREATER-THAN LOW BYTE */ -__sfr __at 0xC4 ADC0GTH ; /* ADC 0 GREATER-THAN HIGH BYTE */ -__sfr __at 0xC5 ADC0LTL ; /* ADC 0 LESS-THAN LOW BYTE */ -__sfr __at 0xC6 ADC0LTH ; /* ADC 0 LESS-THAN HIGH BYTE */ -__sfr __at 0xC8 T2CON ; /* TIMER 2 CONTROL */ -__sfr __at 0xC8 TMR2CN ; /* TIMER 2 CONTROL */ -__sfr __at 0xC9 REG0CN ; /* VOLTAGE REGULATOR CONTROL */ -__sfr __at 0xCA RCAP2L ; /* TIMER 2 CAPTURE REGISTER - LOW BYTE */ -__sfr __at 0xCA TMR2RLL ; /* TIMER 2 CAPTURE REGISTER - LOW BYTE */ -__sfr __at 0xCB RCAP2H ; /* TIMER 2 CAPTURE REGISTER - HIGH BYTE */ -__sfr __at 0xCB TMR2RLH ; /* TIMER 2 CAPTURE REGISTER - HIGH BYTE */ -__sfr __at 0xCC TL2 ; /* TIMER 2 - LOW BYTE */ -__sfr __at 0xCC TMR2L ; /* TIMER 2 - LOW BYTE */ -__sfr __at 0xCD TH2 ; /* TIMER 2 - HIGH BYTE */ -__sfr __at 0xCD TMR2H ; /* TIMER 2 - HIGH BYTE */ -__sfr __at 0xD0 PSW ; /* PROGRAM STATUS WORD */ -__sfr __at 0xD1 REF0CN ; /* VOLTAGE REFERENCE 0 CONTROL */ -__sfr __at 0xD4 P0SKIP ; /* PORT 0 SKIP */ -__sfr __at 0xD5 P1SKIP ; /* PORT 1 SKIP */ -__sfr __at 0xD6 P2SKIP ; /* PORT 2 SKIP */ -__sfr __at 0xD7 USB0XCN ; /* USB0 TRANSCEIVER CONTROL */ -__sfr __at 0xD8 PCA0CN ; /* PCA CONTROL */ -__sfr __at 0xD9 PCA0MD ; /* PCA MODE */ -__sfr __at 0xDA PCA0CPM0 ; /* PCA MODULE 0 MODE REGISTER */ -__sfr __at 0xDB PCA0CPM1 ; /* PCA MODULE 1 MODE REGISTER */ -__sfr __at 0xDC PCA0CPM2 ; /* PCA MODULE 2 MODE REGISTER */ -__sfr __at 0xDD PCA0CPM3 ; /* PCA MODULE 3 MODE REGISTER */ -__sfr __at 0xDE PCA0CPM4 ; /* PCA MODULE 4 MODE REGISTER */ -__sfr __at 0xE0 ACC ; /* ACCUMULATOR */ -__sfr __at 0xE1 XBR0 ; /* PORT MUX CONFIGURATION REGISTER 0 */ -__sfr __at 0xE2 XBR1 ; /* PORT MUX CONFIGURATION REGISTER 1 */ -__sfr __at 0xE4 IT01CF ; /* INT0/INT1 CONFIGURATION REGISTER */ -__sfr __at 0xE4 INT01CF ; /* INT0/INT1 CONFIGURATION REGISTER */ -__sfr __at 0xE6 EIE1 ; /* EXTERNAL INTERRUPT ENABLE 1 */ -__sfr __at 0xE7 EIE2 ; /* EXTERNAL INTERRUPT ENABLE 2 */ -__sfr __at 0xE8 ADC0CN ; /* ADC 0 CONTROL */ -__sfr __at 0xE9 PCA0CPL1 ; /* PCA CAPTURE 1 LOW */ -__sfr __at 0xEA PCA0CPH1 ; /* PCA CAPTURE 1 HIGH */ -__sfr __at 0xEB PCA0CPL2 ; /* PCA CAPTURE 2 LOW */ -__sfr __at 0xEC PCA0CPH2 ; /* PCA CAPTURE 2 HIGH */ -__sfr __at 0xED PCA0CPL3 ; /* PCA CAPTURE 3 LOW */ -__sfr __at 0xEE PCA0CPH3 ; /* PCA CAPTURE 3 HIGH */ -__sfr __at 0xEF RSTSRC ; /* RESET SOURCE */ -__sfr __at 0xF0 B ; /* B REGISTER */ -__sfr __at 0xF1 P0MODE ; /* PORT 0 INPUT MODE CONFIGURATION */ -__sfr __at 0xF1 P0MDIN ; /* PORT 0 INPUT MODE CONFIGURATION */ -__sfr __at 0xF2 P1MODE ; /* PORT 1 INPUT MODE CONFIGURATION */ -__sfr __at 0xF2 P1MDIN ; /* PORT 1 INPUT MODE CONFIGURATION */ -__sfr __at 0xF3 P2MODE ; /* PORT 2 INPUT MODE CONFIGURATION */ -__sfr __at 0xF3 P2MDIN ; /* PORT 2 INPUT MODE CONFIGURATION */ -__sfr __at 0xF4 P3MODE ; /* PORT 3 INPUT MODE CONFIGURATION */ -__sfr __at 0xF4 P3MDIN ; /* PORT 3 INPUT MODE CONFIGURATION */ -__sfr __at 0xF6 EIP1 ; /* EXTERNAL INTERRUPT PRIORITY REGISTER 1 */ -__sfr __at 0xF7 EIP2 ; /* EXTERNAL INTERRUPT PRIORITY REGISTER 2 */ -__sfr __at 0xF8 SPI0CN ; /* SPI0 CONTROL */ -__sfr __at 0xF9 PCA0L ; /* PCA COUNTER LOW */ -__sfr __at 0xFA PCA0H ; /* PCA COUNTER HIGH */ -__sfr __at 0xFB PCA0CPL0 ; /* PCA CAPTURE 0 LOW */ -__sfr __at 0xFC PCA0CPH0 ; /* PCA CAPTURE 0 HIGH */ -__sfr __at 0xFD PCA0CPL4 ; /* PCA CAPTURE 4 LOW */ -__sfr __at 0xFE PCA0CPH4 ; /* PCA CAPTURE 4 HIGH */ -__sfr __at 0xFF VDM0CN ; /* VDD MONITOR CONTROL */ +__sfr __at (0x80) P0 ; /* PORT 0 */ +__sfr __at (0x81) SP ; /* STACK POINTER */ +__sfr __at (0x82) DPL ; /* DATA POINTER - LOW BYTE */ +__sfr __at (0x83) DPH ; /* DATA POINTER - HIGH BYTE */ +__sfr __at (0x87) PCON ; /* POWER CONTROL */ +__sfr __at (0x88) TCON ; /* TIMER CONTROL */ +__sfr __at (0x89) TMOD ; /* TIMER MODE */ +__sfr __at (0x8A) TL0 ; /* TIMER 0 - LOW BYTE */ +__sfr __at (0x8B) TL1 ; /* TIMER 1 - LOW BYTE */ +__sfr __at (0x8C) TH0 ; /* TIMER 0 - HIGH BYTE */ +__sfr __at (0x8D) TH1 ; /* TIMER 1 - HIGH BYTE */ +__sfr __at (0x8E) CKCON ; /* CLOCK CONTROL */ +__sfr __at (0x8F) PSCTL ; /* PROGRAM STORE R/W CONTROL */ +__sfr __at (0x90) P1 ; /* PORT 1 */ +__sfr __at (0x91) TMR3CN ; /* TIMER 3 CONTROL */ +__sfr __at (0x92) TMR3RLL ; /* TIMER 3 CAPTURE REGISTER - LOW BYTE */ +__sfr __at (0x93) TMR3RLH ; /* TIMER 3 CAPTURE REGISTER - HIGH BYTE */ +__sfr __at (0x94) TMR3L ; /* TIMER 3 - LOW BYTE */ +__sfr __at (0x95) TMR3H ; /* TIMER 3 - HIGH BYTE */ +__sfr __at (0x96) USB0ADR ; /* USB0 INDIRECT ADDRESS REGISTER */ +__sfr __at (0x97) USB0DAT ; /* USB0 DATA REGISTER */ +__sfr __at (0x98) SCON ; /* SERIAL PORT CONTROL */ +__sfr __at (0x98) SCON0 ; /* SERIAL PORT CONTROL */ +__sfr __at (0x99) SBUF ; /* SERIAL PORT BUFFER */ +__sfr __at (0x99) SBUF0 ; /* SERIAL PORT BUFFER */ +__sfr __at (0x9A) CPT1CN ; /* COMPARATOR 1 CONTROL */ +__sfr __at (0x9B) CPT0CN ; /* COMPARATOR 0 CONTROL */ +__sfr __at (0x9C) CPT1MD ; /* COMPARATOR 1 MODE SELECTION */ +__sfr __at (0x9D) CPT0MD ; /* COMPARATOR 0 MODE SELECTION */ +__sfr __at (0x9E) CPT1MX ; /* COMPARATOR 1 MUX SELECTION */ +__sfr __at (0x9F) CPT0MX ; /* COMPARATOR 0 MUX SELECTION */ +__sfr __at (0xA0) P2 ; /* PORT 2 */ +__sfr __at (0xA1) SPI0CFG ; /* SPI0 CONFIGURATION */ +__sfr __at (0xA2) SPI0CKR ; /* SPI0 CLOCK RATE CONTROL */ +__sfr __at (0xA3) SPI0DAT ; /* SPI0 DATA */ +__sfr __at (0xA4) P0MDOUT ; /* PORT 0 OUTPUT MODE CONFIGURATION */ +__sfr __at (0xA5) P1MDOUT ; /* PORT 1 OUTPUT MODE CONFIGURATION */ +__sfr __at (0xA6) P2MDOUT ; /* PORT 2 OUTPUT MODE CONFIGURATION */ +__sfr __at (0xA7) P3MDOUT ; /* PORT 3 OUTPUT MODE CONFIGURATION */ +__sfr __at (0xA8) IE ; /* INTERRUPT ENABLE */ +__sfr __at (0xA9) CLKSEL ; /* SYSTEM CLOCK SELECT */ +__sfr __at (0xAA) EMI0CN ; /* EXTERNAL MEMORY INTERFACE CONTROL */ +__sfr __at (0xAA) _XPAGE ; /* XDATA/PDATA PAGE */ +__sfr __at (0xB0) P3 ; /* PORT 3 */ +__sfr __at (0xB1) OSCXCN ; /* EXTERNAL OSCILLATOR CONTROL */ +__sfr __at (0xB2) OSCICN ; /* INTERNAL OSCILLATOR CONTROL */ +__sfr __at (0xB3) OSCICL ; /* INTERNAL OSCILLATOR CALIBRATION */ +__sfr __at (0xB6) FLSCL ; /* FLASH MEMORY TIMING PRESCALER */ +__sfr __at (0xB7) FLKEY ; /* FLASH ACESS LIMIT */ +__sfr __at (0xB8) IP ; /* INTERRUPT PRIORITY */ +__sfr __at (0xB9) CLKMUL ; /* CLOCK MULTIPLIER CONTROL REGISTER */ +__sfr __at (0xBA) AMX0N ; /* ADC 0 MUX NEGATIVE CHANNEL SELECTION */ +__sfr __at (0xBB) AMX0P ; /* ADC 0 MUX POSITIVE CHANNEL SELECTION */ +__sfr __at (0xBC) ADC0CF ; /* ADC 0 CONFIGURATION */ +__sfr __at (0xBD) ADC0L ; /* ADC 0 DATA WORD LSB */ +__sfr __at (0xBE) ADC0H ; /* ADC 0 DATA WORD MSB */ +__sfr __at (0xC0) SMB0CN ; /* SMBUS CONTROL */ +__sfr __at (0xC1) SMB0CF ; /* SMBUS CONFIGURATION */ +__sfr __at (0xC2) SMB0DAT ; /* SMBUS DATA */ +__sfr __at (0xC3) ADC0GTL ; /* ADC 0 GREATER-THAN LOW BYTE */ +__sfr __at (0xC4) ADC0GTH ; /* ADC 0 GREATER-THAN HIGH BYTE */ +__sfr __at (0xC5) ADC0LTL ; /* ADC 0 LESS-THAN LOW BYTE */ +__sfr __at (0xC6) ADC0LTH ; /* ADC 0 LESS-THAN HIGH BYTE */ +__sfr __at (0xC8) T2CON ; /* TIMER 2 CONTROL */ +__sfr __at (0xC8) TMR2CN ; /* TIMER 2 CONTROL */ +__sfr __at (0xC9) REG0CN ; /* VOLTAGE REGULATOR CONTROL */ +__sfr __at (0xCA) RCAP2L ; /* TIMER 2 CAPTURE REGISTER - LOW BYTE */ +__sfr __at (0xCA) TMR2RLL ; /* TIMER 2 CAPTURE REGISTER - LOW BYTE */ +__sfr __at (0xCB) RCAP2H ; /* TIMER 2 CAPTURE REGISTER - HIGH BYTE */ +__sfr __at (0xCB) TMR2RLH ; /* TIMER 2 CAPTURE REGISTER - HIGH BYTE */ +__sfr __at (0xCC) TL2 ; /* TIMER 2 - LOW BYTE */ +__sfr __at (0xCC) TMR2L ; /* TIMER 2 - LOW BYTE */ +__sfr __at (0xCD) TH2 ; /* TIMER 2 - HIGH BYTE */ +__sfr __at (0xCD) TMR2H ; /* TIMER 2 - HIGH BYTE */ +__sfr __at (0xD0) PSW ; /* PROGRAM STATUS WORD */ +__sfr __at (0xD1) REF0CN ; /* VOLTAGE REFERENCE 0 CONTROL */ +__sfr __at (0xD4) P0SKIP ; /* PORT 0 SKIP */ +__sfr __at (0xD5) P1SKIP ; /* PORT 1 SKIP */ +__sfr __at (0xD6) P2SKIP ; /* PORT 2 SKIP */ +__sfr __at (0xD7) USB0XCN ; /* USB0 TRANSCEIVER CONTROL */ +__sfr __at (0xD8) PCA0CN ; /* PCA CONTROL */ +__sfr __at (0xD9) PCA0MD ; /* PCA MODE */ +__sfr __at (0xDA) PCA0CPM0 ; /* PCA MODULE 0 MODE REGISTER */ +__sfr __at (0xDB) PCA0CPM1 ; /* PCA MODULE 1 MODE REGISTER */ +__sfr __at (0xDC) PCA0CPM2 ; /* PCA MODULE 2 MODE REGISTER */ +__sfr __at (0xDD) PCA0CPM3 ; /* PCA MODULE 3 MODE REGISTER */ +__sfr __at (0xDE) PCA0CPM4 ; /* PCA MODULE 4 MODE REGISTER */ +__sfr __at (0xE0) ACC ; /* ACCUMULATOR */ +__sfr __at (0xE1) XBR0 ; /* PORT MUX CONFIGURATION REGISTER 0 */ +__sfr __at (0xE2) XBR1 ; /* PORT MUX CONFIGURATION REGISTER 1 */ +__sfr __at (0xE4) IT01CF ; /* INT0/INT1 CONFIGURATION REGISTER */ +__sfr __at (0xE4) INT01CF ; /* INT0/INT1 CONFIGURATION REGISTER */ +__sfr __at (0xE6) EIE1 ; /* EXTERNAL INTERRUPT ENABLE 1 */ +__sfr __at (0xE7) EIE2 ; /* EXTERNAL INTERRUPT ENABLE 2 */ +__sfr __at (0xE8) ADC0CN ; /* ADC 0 CONTROL */ +__sfr __at (0xE9) PCA0CPL1 ; /* PCA CAPTURE 1 LOW */ +__sfr __at (0xEA) PCA0CPH1 ; /* PCA CAPTURE 1 HIGH */ +__sfr __at (0xEB) PCA0CPL2 ; /* PCA CAPTURE 2 LOW */ +__sfr __at (0xEC) PCA0CPH2 ; /* PCA CAPTURE 2 HIGH */ +__sfr __at (0xED) PCA0CPL3 ; /* PCA CAPTURE 3 LOW */ +__sfr __at (0xEE) PCA0CPH3 ; /* PCA CAPTURE 3 HIGH */ +__sfr __at (0xEF) RSTSRC ; /* RESET SOURCE */ +__sfr __at (0xF0) B ; /* B REGISTER */ +__sfr __at (0xF1) P0MODE ; /* PORT 0 INPUT MODE CONFIGURATION */ +__sfr __at (0xF1) P0MDIN ; /* PORT 0 INPUT MODE CONFIGURATION */ +__sfr __at (0xF2) P1MODE ; /* PORT 1 INPUT MODE CONFIGURATION */ +__sfr __at (0xF2) P1MDIN ; /* PORT 1 INPUT MODE CONFIGURATION */ +__sfr __at (0xF3) P2MODE ; /* PORT 2 INPUT MODE CONFIGURATION */ +__sfr __at (0xF3) P2MDIN ; /* PORT 2 INPUT MODE CONFIGURATION */ +__sfr __at (0xF4) P3MODE ; /* PORT 3 INPUT MODE CONFIGURATION */ +__sfr __at (0xF4) P3MDIN ; /* PORT 3 INPUT MODE CONFIGURATION */ +__sfr __at (0xF6) EIP1 ; /* EXTERNAL INTERRUPT PRIORITY REGISTER 1 */ +__sfr __at (0xF7) EIP2 ; /* EXTERNAL INTERRUPT PRIORITY REGISTER 2 */ +__sfr __at (0xF8) SPI0CN ; /* SPI0 CONTROL */ +__sfr __at (0xF9) PCA0L ; /* PCA COUNTER LOW */ +__sfr __at (0xFA) PCA0H ; /* PCA COUNTER HIGH */ +__sfr __at (0xFB) PCA0CPL0 ; /* PCA CAPTURE 0 LOW */ +__sfr __at (0xFC) PCA0CPH0 ; /* PCA CAPTURE 0 HIGH */ +__sfr __at (0xFD) PCA0CPL4 ; /* PCA CAPTURE 4 LOW */ +__sfr __at (0xFE) PCA0CPH4 ; /* PCA CAPTURE 4 HIGH */ +__sfr __at (0xFF) VDM0CN ; /* VDD MONITOR CONTROL */ -/* BIT Registers */ - -/* P0 0x80 */ -__sbit __at 0x80 P0_0 ; -__sbit __at 0x81 P0_1 ; -__sbit __at 0x82 P0_2 ; -__sbit __at 0x83 P0_3 ; -__sbit __at 0x84 P0_4 ; -__sbit __at 0x85 P0_5 ; -__sbit __at 0x86 P0_6 ; -__sbit __at 0x87 P0_7 ; - -/* TCON 0x88 */ -__sbit __at 0x88 IT0 ; /* TCON.0 - EXT. INTERRUPT 0 TYPE */ -__sbit __at 0x89 IE0 ; /* TCON.1 - EXT. INTERRUPT 0 EDGE FLAG */ -__sbit __at 0x8A IT1 ; /* TCON.2 - EXT. INTERRUPT 1 TYPE */ -__sbit __at 0x8B IE1 ; /* TCON.3 - EXT. INTERRUPT 1 EDGE FLAG */ -__sbit __at 0x8C TR0 ; /* TCON.4 - TIMER 0 ON/OFF CONTROL */ -__sbit __at 0x8D TF0 ; /* TCON.5 - TIMER 0 OVERFLOW FLAG */ -__sbit __at 0x8E TR1 ; /* TCON.6 - TIMER 1 ON/OFF CONTROL */ -__sbit __at 0x8F TF1 ; /* TCON.7 - TIMER 1 OVERFLOW FLAG */ - -/* P1 0x90 */ -__sbit __at 0x90 P1_0 ; -__sbit __at 0x91 P1_1 ; -__sbit __at 0x92 P1_2 ; -__sbit __at 0x93 P1_3 ; -__sbit __at 0x94 P1_4 ; -__sbit __at 0x95 P1_5 ; -__sbit __at 0x96 P1_6 ; -__sbit __at 0x97 P1_7 ; - -/* SCON 0x98 */ -__sbit __at 0x98 RI ; /* SCON.0 - RECEIVE INTERRUPT FLAG */ -__sbit __at 0x98 RI0 ; /* SCON.0 - RECEIVE INTERRUPT FLAG */ -__sbit __at 0x99 TI ; /* SCON.1 - TRANSMIT INTERRUPT FLAG */ -__sbit __at 0x99 TI0 ; /* SCON.1 - TRANSMIT INTERRUPT FLAG */ -__sbit __at 0x9A RB8 ; /* SCON.2 - RECEIVE BIT 8 */ -__sbit __at 0x9A RB80 ; /* SCON.2 - RECEIVE BIT 8 */ -__sbit __at 0x9B TB8 ; /* SCON.3 - TRANSMIT BIT 8 */ -__sbit __at 0x9B TB80 ; /* SCON.3 - TRANSMIT BIT 8 */ -__sbit __at 0x9C REN ; /* SCON.4 - RECEIVE ENABLE */ -__sbit __at 0x9C REN0 ; /* SCON.4 - RECEIVE ENABLE */ -__sbit __at 0x9D SM2 ; /* SCON.5 - MULTIPROCESSOR COMMUNICATION ENABLE */ -__sbit __at 0x9D MCE0 ; /* SCON.5 - MULTIPROCESSOR COMMUNICATION ENABLE */ -__sbit __at 0x9F SM0 ; /* SCON.7 - SERIAL MODE CONTROL BIT 0 */ -__sbit __at 0x9F S0MODE ; /* SCON.7 - SERIAL MODE CONTROL BIT 0 */ - -/* P2 0xA0 */ -__sbit __at 0xA0 P2_0 ; -__sbit __at 0xA1 P2_1 ; -__sbit __at 0xA2 P2_2 ; -__sbit __at 0xA3 P2_3 ; -__sbit __at 0xA4 P2_4 ; -__sbit __at 0xA5 P2_5 ; -__sbit __at 0xA6 P2_6 ; -__sbit __at 0xA7 P2_7 ; +/* WORD/DWORD Registers */ -/* IE 0xA8 */ -__sbit __at 0xA8 EX0 ; /* IE.0 - EXTERNAL INTERRUPT 0 ENABLE */ -__sbit __at 0xA9 ET0 ; /* IE.1 - TIMER 0 INTERRUPT ENABLE */ -__sbit __at 0xAA EX1 ; /* IE.2 - EXTERNAL INTERRUPT 1 ENABLE */ -__sbit __at 0xAB ET1 ; /* IE.3 - TIMER 1 INTERRUPT ENABLE */ -__sbit __at 0xAC ES ; /* IE.4 - SERIAL PORT INTERRUPT ENABLE */ -__sbit __at 0xAC ES0 ; /* IE.4 - SERIAL PORT INTERRUPT ENABLE */ -__sbit __at 0xAD ET2 ; /* IE.5 - TIMER 2 INTERRUPT ENABLE */ -__sbit __at 0xAE ESPI0 ; /* IE.6 - SPI0 INTERRUPT ENABLE */ -__sbit __at 0xAF EA ; /* IE.7 - GLOBAL INTERRUPT ENABLE */ +__sfr16 __at (0x8C8A) TMR0 ; /* TIMER 0 COUNTER */ +__sfr16 __at (0x8D8B) TMR1 ; /* TIMER 1 COUNTER */ +__sfr16 __at (0xCDCC) TMR2 ; /* TIMER 2 COUNTER */ +__sfr16 __at (0xCBCA) RCAP2 ; /* TIMER 2 CAPTURE REGISTER WORD */ +__sfr16 __at (0xCBCA) TMR2RL ; /* TIMER 2 CAPTURE REGISTER WORD */ +__sfr16 __at (0x9594) TMR3 ; /* TIMER 3 COUNTER */ +__sfr16 __at (0x9392) TMR3RL ; /* TIMER 3 CAPTURE REGISTER WORD */ +__sfr16 __at (0xBEBD) ADC0 ; /* ADC 0 DATA WORD */ +__sfr16 __at (0xC4C3) ADC0GT ; /* ADC 0 GREATER-THAN REGISTER WORD */ +__sfr16 __at (0xC6C5) ADC0LT ; /* ADC 0 LESS-THAN REGISTER WORD */ +__sfr16 __at (0xFAF9) PCA0 ; /* PCA COUNTER */ +__sfr16 __at (0xFCFB) PCA0CP0 ; /* PCA CAPTURE 0 WORD */ +__sfr16 __at (0xEAE9) PCA0CP1 ; /* PCA CAPTURE 1 WORD */ +__sfr16 __at (0xECEB) PCA0CP2 ; /* PCA CAPTURE 2 WORD */ +__sfr16 __at (0xEEED) PCA0CP3 ; /* PCA CAPTURE 3 WORD */ +__sfr16 __at (0xFEFD) PCA0CP4 ; /* PCA CAPTURE 4 WORD */ -/* P3 0xB0 */ -__sbit __at 0xB0 P3_0 ; -__sbit __at 0xB1 P3_1 ; -__sbit __at 0xB2 P3_2 ; -__sbit __at 0xB3 P3_3 ; -__sbit __at 0xB4 P3_4 ; -__sbit __at 0xB5 P3_5 ; -__sbit __at 0xB6 P3_6 ; -__sbit __at 0xB7 P3_7 ; -/* IP 0xB8 */ -__sbit __at 0xB8 PX0 ; /* IP.0 - EXTERNAL INTERRUPT 0 PRIORITY */ -__sbit __at 0xB9 PT0 ; /* IP.1 - TIMER 0 PRIORITY */ -__sbit __at 0xBA PX1 ; /* IP.2 - EXTERNAL INTERRUPT 1 PRIORITY */ -__sbit __at 0xBB PT1 ; /* IP.3 - TIMER 1 PRIORITY */ -__sbit __at 0xBC PS ; /* IP.4 - SERIAL PORT PRIORITY */ -__sbit __at 0xBC PS0 ; /* IP.4 - SERIAL PORT PRIORITY */ -__sbit __at 0xBD PT2 ; /* IP.5 - TIMER 2 PRIORITY */ -__sbit __at 0xBE PSPI0 ; /* IP.6 - SPI0 PRIORITY */ - -/* SMB0CN 0xC0 */ -__sbit __at 0xC0 SI ; /* SMB0CN.0 - SMBUS 0 INTERRUPT PENDING FLAG */ -__sbit __at 0xC1 ACK ; /* SMB0CN.1 - SMBUS 0 ACKNOWLEDGE FLAG */ -__sbit __at 0xC2 ARBLOST ; /* SMB0CN.2 - SMBUS 0 ARBITRATION LOST INDICATOR */ -__sbit __at 0xC3 ACKRQ ; /* SMB0CN.3 - SMBUS 0 ACKNOWLEDGE REQUEST */ -__sbit __at 0xC4 STO ; /* SMB0CN.4 - SMBUS 0 STOP FLAG */ -__sbit __at 0xC5 STA ; /* SMB0CN.5 - SMBUS 0 START FLAG */ -__sbit __at 0xC6 TXMODE ; /* SMB0CN.6 - SMBUS 0 TRANSMIT MODE INDICATOR */ -__sbit __at 0xC7 MASTER ; /* SMB0CN.7 - SMBUS 0 MASTER/SLAVE INDICATOR */ - -/* TMR2CN 0xC8 */ -__sbit __at 0xC8 T2XCLK ; /* TMR2CN.0 - TIMER 2 EXTERNAL CLOCK SELECT */ -__sbit __at 0xCA TR2 ; /* TMR2CN.2 - TIMER 2 ON/OFF CONTROL */ -__sbit __at 0xCB T2SPLIT ; /* TMR2CN.3 - TIMER 2 SPLIT MODE ENABLE */ -__sbit __at 0xCC T2SOF ; /* TMR2CN.4 - TIMER 2 START_OF_FRAME CAPTURE ENA */ -__sbit __at 0xCD TF2LEN ; /* TMR2CN.5 - TIMER 2 LOW BYTE INTERRUPT ENABLE */ -__sbit __at 0xCE TF2L ; /* TMR2CN.6 - TIMER 2 LOW BYTE OVERFLOW FLAG */ -__sbit __at 0xCF TF2 ; /* TMR2CN.7 - TIMER 2 OVERFLOW FLAG */ -__sbit __at 0xCF TF2H ; /* TMR2CN.7 - TIMER 2 HIGH BYTE OVERFLOW FLAG */ - -/* PSW 0xD0 */ -__sbit __at 0xD0 PARITY ; /* PSW.0 - ACCUMULATOR PARITY FLAG */ -__sbit __at 0xD1 F1 ; /* PSW.1 - FLAG 1 */ -__sbit __at 0xD2 OV ; /* PSW.2 - OVERFLOW FLAG */ -__sbit __at 0xD3 RS0 ; /* PSW.3 - REGISTER BANK SELECT 0 */ -__sbit __at 0xD4 RS1 ; /* PSW.4 - REGISTER BANK SELECT 1 */ -__sbit __at 0xD5 F0 ; /* PSW.5 - FLAG 0 */ -__sbit __at 0xD6 AC ; /* PSW.6 - AUXILIARY CARRY FLAG */ -__sbit __at 0xD7 CY ; /* PSW.7 - CARRY FLAG */ - -/* PCA0CN 0xD8 */ -__sbit __at 0xD8 CCF0 ; /* PCA0CN.0 - PCA MODULE 0 CAPTURE/COMPARE FLAG */ -__sbit __at 0xD9 CCF1 ; /* PCA0CN.1 - PCA MODULE 1 CAPTURE/COMPARE FLAG */ -__sbit __at 0xDA CCF2 ; /* PCA0CN.2 - PCA MODULE 2 CAPTURE/COMPARE FLAG */ -__sbit __at 0xDB CCF3 ; /* PCA0CN.3 - PCA MODULE 3 CAPTURE/COMPARE FLAG */ -__sbit __at 0xDC CCF4 ; /* PCA0CN.4 - PCA MODULE 4 CAPTURE/COMPARE FLAG */ -__sbit __at 0xDE CR ; /* PCA0CN.6 - PCA COUNTER/TIMER RUN CONTROL */ -__sbit __at 0xDF CF ; /* PCA0CN.7 - PCA COUNTER/TIMER OVERFLOW FLAG */ - -/* ADC0CN 0xE8 */ -__sbit __at 0xE8 AD0CM0 ; /* ADC0CN.0 - ADC 0 START OF CONV. MODE BIT 0 */ -__sbit __at 0xE9 AD0CM1 ; /* ADC0CN.1 - ADC 0 START OF CONV. MODE BIT 1 */ -__sbit __at 0xEA AD0CM2 ; /* ADC0CN.2 - ADC 0 START OF CONV. MODE BIT 2 */ -__sbit __at 0xEB AD0WINT ; /* ADC0CN.3 - ADC 0 WINDOW COMPARE INT. FLAG */ -__sbit __at 0xEC AD0BUSY ; /* ADC0CN.4 - ADC 0 BUSY FLAG */ -__sbit __at 0xED AD0INT ; /* ADC0CN.5 - ADC 0 CONV. COMPLETE INT. FLAG */ -__sbit __at 0xEE AD0TM ; /* ADC0CN.6 - ADC 0 TRACK MODE */ -__sbit __at 0xEF AD0EN ; /* ADC0CN.7 - ADC 0 ENABLE */ +/* BIT Registers */ -/* SPI0CN 0xF8 */ -__sbit __at 0xF8 SPIEN ; /* SPI0CN.0 - SPI0 ENABLE */ -__sbit __at 0xF9 TXBMT ; /* SPI0CN.1 - TRANSMIT BUFFER EMPTY */ -__sbit __at 0xFA NSSMD0 ; /* SPI0CN.2 - SLAVE SELECT MODE BIT 0 */ -__sbit __at 0xFB NSSMD1 ; /* SPI0CN.3 - SLAVE SELECT MODE BIT 1 */ -__sbit __at 0xFC RXOVRN ; /* SPI0CN.4 - RECEIVE OVERRUN FLAG */ -__sbit __at 0xFD MODF ; /* SPI0CN.5 - MODE FAULT FLAG */ -__sbit __at 0xFE WCOL ; /* SPI0CN.6 - WRITE COLLISION FLAG */ -__sbit __at 0xFF SPIF ; /* SPI0CN.7 - SPI0 INTERRUPT FLAG */ +/* P0 0x80 */ +__sbit __at (0x80) P0_0 ; +__sbit __at (0x81) P0_1 ; +__sbit __at (0x82) P0_2 ; +__sbit __at (0x83) P0_3 ; +__sbit __at (0x84) P0_4 ; +__sbit __at (0x85) P0_5 ; +__sbit __at (0x86) P0_6 ; +__sbit __at (0x87) P0_7 ; + +/* TCON 0x88 */ +__sbit __at (0x88) IT0 ; /* TCON.0 - EXT. INTERRUPT 0 TYPE */ +__sbit __at (0x89) IE0 ; /* TCON.1 - EXT. INTERRUPT 0 EDGE FLAG */ +__sbit __at (0x8A) IT1 ; /* TCON.2 - EXT. INTERRUPT 1 TYPE */ +__sbit __at (0x8B) IE1 ; /* TCON.3 - EXT. INTERRUPT 1 EDGE FLAG */ +__sbit __at (0x8C) TR0 ; /* TCON.4 - TIMER 0 ON/OFF CONTROL */ +__sbit __at (0x8D) TF0 ; /* TCON.5 - TIMER 0 OVERFLOW FLAG */ +__sbit __at (0x8E) TR1 ; /* TCON.6 - TIMER 1 ON/OFF CONTROL */ +__sbit __at (0x8F) TF1 ; /* TCON.7 - TIMER 1 OVERFLOW FLAG */ + +/* P1 0x90 */ +__sbit __at (0x90) P1_0 ; +__sbit __at (0x91) P1_1 ; +__sbit __at (0x92) P1_2 ; +__sbit __at (0x93) P1_3 ; +__sbit __at (0x94) P1_4 ; +__sbit __at (0x95) P1_5 ; +__sbit __at (0x96) P1_6 ; +__sbit __at (0x97) P1_7 ; + +/* SCON 0x98 */ +__sbit __at (0x98) RI ; /* SCON.0 - RECEIVE INTERRUPT FLAG */ +__sbit __at (0x98) RI0 ; /* SCON.0 - RECEIVE INTERRUPT FLAG */ +__sbit __at (0x99) TI ; /* SCON.1 - TRANSMIT INTERRUPT FLAG */ +__sbit __at (0x99) TI0 ; /* SCON.1 - TRANSMIT INTERRUPT FLAG */ +__sbit __at (0x9A) RB8 ; /* SCON.2 - RECEIVE BIT 8 */ +__sbit __at (0x9A) RB80 ; /* SCON.2 - RECEIVE BIT 8 */ +__sbit __at (0x9B) TB8 ; /* SCON.3 - TRANSMIT BIT 8 */ +__sbit __at (0x9B) TB80 ; /* SCON.3 - TRANSMIT BIT 8 */ +__sbit __at (0x9C) REN ; /* SCON.4 - RECEIVE ENABLE */ +__sbit __at (0x9C) REN0 ; /* SCON.4 - RECEIVE ENABLE */ +__sbit __at (0x9D) SM2 ; /* SCON.5 - MULTIPROCESSOR COMMUNICATION ENABLE */ +__sbit __at (0x9D) MCE0 ; /* SCON.5 - MULTIPROCESSOR COMMUNICATION ENABLE */ +__sbit __at (0x9F) SM0 ; /* SCON.7 - SERIAL MODE CONTROL BIT 0 */ +__sbit __at (0x9F) S0MODE ; /* SCON.7 - SERIAL MODE CONTROL BIT 0 */ + +/* P2 0xA0 */ +__sbit __at (0xA0) P2_0 ; +__sbit __at (0xA1) P2_1 ; +__sbit __at (0xA2) P2_2 ; +__sbit __at (0xA3) P2_3 ; +__sbit __at (0xA4) P2_4 ; +__sbit __at (0xA5) P2_5 ; +__sbit __at (0xA6) P2_6 ; +__sbit __at (0xA7) P2_7 ; + +/* IE 0xA8 */ +__sbit __at (0xA8) EX0 ; /* IE.0 - EXTERNAL INTERRUPT 0 ENABLE */ +__sbit __at (0xA9) ET0 ; /* IE.1 - TIMER 0 INTERRUPT ENABLE */ +__sbit __at (0xAA) EX1 ; /* IE.2 - EXTERNAL INTERRUPT 1 ENABLE */ +__sbit __at (0xAB) ET1 ; /* IE.3 - TIMER 1 INTERRUPT ENABLE */ +__sbit __at (0xAC) ES ; /* IE.4 - SERIAL PORT INTERRUPT ENABLE */ +__sbit __at (0xAC) ES0 ; /* IE.4 - SERIAL PORT INTERRUPT ENABLE */ +__sbit __at (0xAD) ET2 ; /* IE.5 - TIMER 2 INTERRUPT ENABLE */ +__sbit __at (0xAE) ESPI0 ; /* IE.6 - SPI0 INTERRUPT ENABLE */ +__sbit __at (0xAF) EA ; /* IE.7 - GLOBAL INTERRUPT ENABLE */ + +/* P3 0xB0 */ +__sbit __at (0xB0) P3_0 ; +__sbit __at (0xB1) P3_1 ; +__sbit __at (0xB2) P3_2 ; +__sbit __at (0xB3) P3_3 ; +__sbit __at (0xB4) P3_4 ; +__sbit __at (0xB5) P3_5 ; +__sbit __at (0xB6) P3_6 ; +__sbit __at (0xB7) P3_7 ; + +/* IP 0xB8 */ +__sbit __at (0xB8) PX0 ; /* IP.0 - EXTERNAL INTERRUPT 0 PRIORITY */ +__sbit __at (0xB9) PT0 ; /* IP.1 - TIMER 0 PRIORITY */ +__sbit __at (0xBA) PX1 ; /* IP.2 - EXTERNAL INTERRUPT 1 PRIORITY */ +__sbit __at (0xBB) PT1 ; /* IP.3 - TIMER 1 PRIORITY */ +__sbit __at (0xBC) PS ; /* IP.4 - SERIAL PORT PRIORITY */ +__sbit __at (0xBC) PS0 ; /* IP.4 - SERIAL PORT PRIORITY */ +__sbit __at (0xBD) PT2 ; /* IP.5 - TIMER 2 PRIORITY */ +__sbit __at (0xBE) PSPI0 ; /* IP.6 - SPI0 PRIORITY */ + +/* SMB0CN 0xC0 */ +__sbit __at (0xC0) SI ; /* SMB0CN.0 - SMBUS 0 INTERRUPT PENDING FLAG */ +__sbit __at (0xC1) ACK ; /* SMB0CN.1 - SMBUS 0 ACKNOWLEDGE FLAG */ +__sbit __at (0xC2) ARBLOST ; /* SMB0CN.2 - SMBUS 0 ARBITRATION LOST INDICATOR */ +__sbit __at (0xC3) ACKRQ ; /* SMB0CN.3 - SMBUS 0 ACKNOWLEDGE REQUEST */ +__sbit __at (0xC4) STO ; /* SMB0CN.4 - SMBUS 0 STOP FLAG */ +__sbit __at (0xC5) STA ; /* SMB0CN.5 - SMBUS 0 START FLAG */ +__sbit __at (0xC6) TXMODE ; /* SMB0CN.6 - SMBUS 0 TRANSMIT MODE INDICATOR */ +__sbit __at (0xC7) MASTER ; /* SMB0CN.7 - SMBUS 0 MASTER/SLAVE INDICATOR */ + +/* TMR2CN 0xC8 */ +__sbit __at (0xC8) T2XCLK ; /* TMR2CN.0 - TIMER 2 EXTERNAL CLOCK SELECT */ +__sbit __at (0xCA) TR2 ; /* TMR2CN.2 - TIMER 2 ON/OFF CONTROL */ +__sbit __at (0xCB) T2SPLIT ; /* TMR2CN.3 - TIMER 2 SPLIT MODE ENABLE */ +__sbit __at (0xCC) T2SOF ; /* TMR2CN.4 - TIMER 2 START_OF_FRAME CAPTURE ENA */ +__sbit __at (0xCD) TF2LEN ; /* TMR2CN.5 - TIMER 2 LOW BYTE INTERRUPT ENABLE */ +__sbit __at (0xCE) TF2L ; /* TMR2CN.6 - TIMER 2 LOW BYTE OVERFLOW FLAG */ +__sbit __at (0xCF) TF2 ; /* TMR2CN.7 - TIMER 2 OVERFLOW FLAG */ +__sbit __at (0xCF) TF2H ; /* TMR2CN.7 - TIMER 2 HIGH BYTE OVERFLOW FLAG */ + +/* PSW 0xD0 */ +__sbit __at (0xD0) PARITY ; /* PSW.0 - ACCUMULATOR PARITY FLAG */ +__sbit __at (0xD1) F1 ; /* PSW.1 - FLAG 1 */ +__sbit __at (0xD2) OV ; /* PSW.2 - OVERFLOW FLAG */ +__sbit __at (0xD3) RS0 ; /* PSW.3 - REGISTER BANK SELECT 0 */ +__sbit __at (0xD4) RS1 ; /* PSW.4 - REGISTER BANK SELECT 1 */ +__sbit __at (0xD5) F0 ; /* PSW.5 - FLAG 0 */ +__sbit __at (0xD6) AC ; /* PSW.6 - AUXILIARY CARRY FLAG */ +__sbit __at (0xD7) CY ; /* PSW.7 - CARRY FLAG */ + +/* PCA0CN 0xD8 */ +__sbit __at (0xD8) CCF0 ; /* PCA0CN.0 - PCA MODULE 0 CAPTURE/COMPARE FLAG */ +__sbit __at (0xD9) CCF1 ; /* PCA0CN.1 - PCA MODULE 1 CAPTURE/COMPARE FLAG */ +__sbit __at (0xDA) CCF2 ; /* PCA0CN.2 - PCA MODULE 2 CAPTURE/COMPARE FLAG */ +__sbit __at (0xDB) CCF3 ; /* PCA0CN.3 - PCA MODULE 3 CAPTURE/COMPARE FLAG */ +__sbit __at (0xDC) CCF4 ; /* PCA0CN.4 - PCA MODULE 4 CAPTURE/COMPARE FLAG */ +__sbit __at (0xDE) CR ; /* PCA0CN.6 - PCA COUNTER/TIMER RUN CONTROL */ +__sbit __at (0xDF) CF ; /* PCA0CN.7 - PCA COUNTER/TIMER OVERFLOW FLAG */ + +/* ADC0CN 0xE8 */ +__sbit __at (0xE8) AD0CM0 ; /* ADC0CN.0 - ADC 0 START OF CONV. MODE BIT 0 */ +__sbit __at (0xE9) AD0CM1 ; /* ADC0CN.1 - ADC 0 START OF CONV. MODE BIT 1 */ +__sbit __at (0xEA) AD0CM2 ; /* ADC0CN.2 - ADC 0 START OF CONV. MODE BIT 2 */ +__sbit __at (0xEB) AD0WINT ; /* ADC0CN.3 - ADC 0 WINDOW COMPARE INT. FLAG */ +__sbit __at (0xEC) AD0BUSY ; /* ADC0CN.4 - ADC 0 BUSY FLAG */ +__sbit __at (0xED) AD0INT ; /* ADC0CN.5 - ADC 0 CONV. COMPLETE INT. FLAG */ +__sbit __at (0xEE) AD0TM ; /* ADC0CN.6 - ADC 0 TRACK MODE */ +__sbit __at (0xEF) AD0EN ; /* ADC0CN.7 - ADC 0 ENABLE */ + +/* SPI0CN 0xF8 */ +__sbit __at (0xF8) SPIEN ; /* SPI0CN.0 - SPI0 ENABLE */ +__sbit __at (0xF9) TXBMT ; /* SPI0CN.1 - TRANSMIT BUFFER EMPTY */ +__sbit __at (0xFA) NSSMD0 ; /* SPI0CN.2 - SLAVE SELECT MODE BIT 0 */ +__sbit __at (0xFB) NSSMD1 ; /* SPI0CN.3 - SLAVE SELECT MODE BIT 1 */ +__sbit __at (0xFC) RXOVRN ; /* SPI0CN.4 - RECEIVE OVERRUN FLAG */ +__sbit __at (0xFD) MODF ; /* SPI0CN.5 - MODE FAULT FLAG */ +__sbit __at (0xFE) WCOL ; /* SPI0CN.6 - WRITE COLLISION FLAG */ +__sbit __at (0xFF) SPIF ; /* SPI0CN.7 - SPI0 INTERRUPT FLAG */ /* Predefined SFR Bit Masks */ -#define IDLE 0x01 /* PCON */ -#define STOP 0x02 /* PCON */ +#define PCON_IDLE 0x01 /* PCON */ +#define PCON_STOP 0x02 /* PCON */ #define T1M 0x08 /* CKCON */ #define PSWE 0x01 /* PSCTL */ #define PSEE 0x02 /* PSCTL */ diff --git a/device/lib/printf_large.c b/device/lib/printf_large.c index e087f64d..ba43fd54 100644 --- a/device/lib/printf_large.c +++ b/device/lib/printf_large.c @@ -165,7 +165,7 @@ static int output_float (float f, unsigned char reqWidth, BOOL left, BOOL zero, BOOL sign, BOOL space) #endif { - char negative=0; + BOOL negative=0; unsigned long integerPart; float decimalPart; char fpBuffer[128]; @@ -229,14 +229,19 @@ static int output_float (float f, unsigned char reqWidth, // fill buffer with the decimalPart (in normal order) fpBD=fpBI; - if (i=reqDecimals /* that's an assignment */) { - do { + + for (i=reqDecimals; i>1; i--) { decimalPart *= 10.0; // truncate the float integerPart=decimalPart; fpBuffer[fpBD++]='0' + integerPart; decimalPart-=integerPart; - } while (--i); + } + if (i) { + decimalPart *= 10.0; + // truncate the float + integerPart = decimalPart + 0.5; + fpBuffer[fpBD++] = '0' + integerPart; } minWidth=fpBI; // we need at least these diff --git a/support/regression/ports/mcs51-xstack-auto/spec.mk b/support/regression/ports/mcs51-xstack-auto/spec.mk index a0d1ab5d..1b536c9f 100644 --- a/support/regression/ports/mcs51-xstack-auto/spec.mk +++ b/support/regression/ports/mcs51-xstack-auto/spec.mk @@ -52,7 +52,7 @@ $(LIBDIR): mkdir -p $(LIBDIR) $(LIBDIR)/%.rel: $(LIBSRCDIR)/%.c - -$(SDCC) -I../../device/include $(LIBSDCCFLAGS) -c $< -o $@ + -$(SDCC) -I../../device/include -I../../device/include/mcs51 $(LIBSDCCFLAGS) -c $< -o $@ .PHONY: lib-files lib-files: diff --git a/support/regression/tests/bug1057979.c b/support/regression/tests/bug1057979.c index e5632cb1..68882498 100644 --- a/support/regression/tests/bug1057979.c +++ b/support/regression/tests/bug1057979.c @@ -38,11 +38,19 @@ test_sprintf(void) sprintf( s, "%-3.3s", "ab" ); ASSERT( 0 == strcmp( s, "ab " ) ); +#if defined(SDCC__ds390) || defined(PORT_HOST) //and from bug 1358192 -#if defined(SDCC__ds390) sprintf( s, "%f", 10.1 ); LOG((s)); ASSERT( 0 == strcmp( s, "10.100000" ) ); + + //and from bug 1388703 + sprintf( s, "%4.1f", 1.36 ); + LOG((s)); + ASSERT( 0 == strcmp( s, " 1.4" ) ); + sprintf( s, "%4.1f", -1.37 ); + LOG((s)); + ASSERT( 0 == strcmp( s, "-1.4" ) ); #endif ASSERT( s[12]==0x12 ); -- 2.39.5