X-Git-Url: https://git.gag.com/?a=blobdiff_plain;f=telelco.sch;h=551eb204bc92a28ee7ef558f7ffc2a81c5458026;hb=90fc6fa108bc5f8642189b08816257c65949281e;hp=72ec537ff27a4c87b8ea1108440270b88803a2f6;hpb=511e8da7d2c54304207300131d13cfd9f2eebb27;p=hw%2Ftelelco

diff --git a/telelco.sch b/telelco.sch
index 72ec537..551eb20 100644
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 TeleLCO
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-T 55100 46800 5 10 0 1 0 0 1
-loadstatus=smt
 }
 N 54900 48100 54900 47700 4
 N 56700 46800 56700 47200 4
@@ -581,8 +254,6 @@ T 54050 46050 5 10 1 1 0 0 1
 value=15k
 T 53950 45850 5 10 0 0 0 0 1
 footprint=0402
-T 53950 45850 5 10 0 1 0 0 1
-loadstatus=smt
 }
 C 53950 44750 1 90 0 resistor.sym
 {
@@ -594,8 +265,6 @@ T 54050 44950 5 10 1 1 0 0 1
 value=27k
 T 53950 44750 5 10 0 0 0 0 1
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-T 53950 44750 5 10 0 1 0 0 1
-loadstatus=smt
 }
 N 53850 45850 53850 45650 4
 N 53850 45750 55450 45750 4
@@ -628,14 +297,14 @@ footprint=0402
 T 43200 43650 5 10 1 1 90 0 1
 value=2.2k
 }
-N 57600 53500 58900 53500 4
+N 59800 53500 61100 53500 4
 {
-T 58600 53600 5 10 1 1 0 0 1
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 }
-N 46800 63900 48100 63900 4
+N 44700 63900 45900 63900 4
 {
-T 46800 64000 5 10 1 1 0 0 1
+T 44700 64000 5 10 1 1 0 0 1
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 }
 C 61400 54000 1 180 1 led.sym
@@ -646,8 +315,6 @@ T 61300 53400 5 10 0 0 180 6 1
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 T 61400 54000 5 10 0 0 0 0 1
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-T 49600 45900 5 10 0 0 0 0 1
-loadstatus=throughhole
 T 61000 54000 5 10 1 1 0 0 1
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 }
@@ -661,8 +328,6 @@ T 61400 56400 5 10 0 0 0 0 1
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 T 60950 56350 5 10 1 1 0 0 1
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-T 49600 47900 5 10 0 0 0 0 1
-loadstatus=throughhole
 }
 C 61400 56800 1 180 1 led.sym
 {
@@ -674,8 +339,6 @@ T 61400 56800 5 10 0 0 0 0 1
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 T 60950 56750 5 10 1 1 0 0 1
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-T 49600 47900 5 10 0 0 0 0 1
-loadstatus=throughhole
 }
 C 61400 57200 1 180 1 led.sym
 {
@@ -687,8 +350,6 @@ T 61400 57200 5 10 0 0 0 0 1
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 T 60950 57150 5 10 1 1 0 0 1
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-T 49600 47900 5 10 0 0 0 0 1
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 }
 C 61400 57600 1 180 1 led.sym
 {
@@ -700,8 +361,6 @@ T 61400 57600 5 10 0 0 0 0 1
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-T 49600 47900 5 10 0 0 0 0 1
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 }
 C 60500 54000 1 180 0 resistor.sym
 {
@@ -713,8 +372,6 @@ T 59700 54000 5 10 1 1 0 0 1
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 T 60500 54000 5 10 0 0 180 0 1
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-T 60500 54000 5 10 0 0 180 0 1
-loadstatus=smt
 }
 C 60500 56400 1 180 0 resistor.sym
 {
@@ -726,8 +383,6 @@ T 59700 56400 5 10 1 1 0 0 1
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 T 60500 56400 5 10 0 0 180 0 1
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-T 60500 56400 5 10 0 0 180 0 1
-loadstatus=smt
 }
 C 60500 56800 1 180 0 resistor.sym
 {
@@ -739,8 +394,6 @@ T 59700 56800 5 10 1 1 0 0 1
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 T 60500 56800 5 10 0 0 180 0 1
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-T 60500 56800 5 10 0 0 180 0 1
-loadstatus=smt
 }
 C 60500 57200 1 180 0 resistor.sym
 {
@@ -752,8 +405,6 @@ T 59700 57200 5 10 1 1 0 0 1
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 T 60500 57200 5 10 0 0 180 0 1
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-T 60500 57200 5 10 0 0 180 0 1
-loadstatus=smt
 }
 C 60500 57600 1 180 0 resistor.sym
 {
@@ -765,8 +416,6 @@ T 59700 57600 5 10 1 1 0 0 1
 value=140
 T 60500 57600 5 10 0 0 180 0 1
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-T 60500 57600 5 10 0 0 180 0 1
-loadstatus=smt
 }
 N 57600 53900 59600 53900 4
 {
@@ -799,12 +448,6 @@ N 61800 56700 62000 56700 4
 N 61800 57100 62000 57100 4
 N 61800 57500 62000 57500 4
 C 61900 67100 1 0 0 gnd.sym
-L 75600 72400 65600 72400 3 0 0 0 -1 -1
-L 77600 72400 81600 72400 3 0 0 0 -1 -1
-T 78600 72600 9 20 1 0 0 0 1
-Pad Indicator
-T 69600 72600 9 20 1 0 0 0 1
-Box Indicator
 C 42300 55200 1 0 0 conn-4.sym
 {
 T 42600 56800 5 10 1 1 0 0 1
@@ -814,8 +457,6 @@ value=Debug
 T 42300 55200 5 10 0 0 0 0 1
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 T 42300 55200 5 10 0 0 0 0 1
-loadstatus=throughhole
-T 42300 55200 5 10 0 0 0 0 1
 device=CONNECTOR
 }
 C 42200 56200 1 0 0 gnd.sym
@@ -853,8 +494,6 @@ T 45500 46600 5 10 1 1 0 0 1
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 T 46300 46500 5 10 0 0 0 0 1
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-T 46300 46500 5 10 0 1 0 0 1
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 }
 N 46100 46500 46100 45700 4
 N 51800 48100 51800 47100 4
@@ -870,8 +509,6 @@ T 52900 47100 5 10 1 1 0 0 1
 value=LiPo
 T 52400 47600 5 10 0 0 0 0 1
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-T 52400 47600 5 10 0 0 0 0 1
-loadstatus=throughhole
 T 52400 47600 5 10 0 1 0 0 1
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 }
@@ -886,8 +523,6 @@ T 48495 48695 5 10 1 1 0 0 1
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 T 48195 45195 5 10 0 1 0 0 1
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-T 48200 47100 5 10 0 1 0 0 1
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 T 49400 48700 5 10 1 1 0 0 1
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 }
@@ -902,8 +537,6 @@ T 51100 46900 5 10 1 1 0 0 1
 value=2.49k
 T 51000 46600 5 10 0 1 0 0 1
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-T 51000 46600 5 10 0 1 0 0 1
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 }
 N 50600 47700 50900 47700 4
 N 50900 47700 50900 47500 4
@@ -920,8 +553,6 @@ T 51900 46300 5 10 1 1 0 0 1
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 T 52000 46200 5 10 0 0 0 0 1
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 }
 C 46700 47200 1 90 0 resistor.sym
 {
@@ -933,8 +564,6 @@ T 47000 47600 5 10 1 1 180 0 1
 value=1k
 T 46700 47200 5 10 0 0 90 0 1
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-T 46700 47200 5 10 0 0 90 0 1
-loadstatus=smt
 }
 C 48800 45700 1 90 0 resistor.sym
 {
@@ -946,8 +575,6 @@ T 49100 46100 5 10 1 1 180 0 1
 value=1k
 T 48800 45700 5 10 0 0 90 0 1
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-T 48800 45700 5 10 0 0 90 0 1
-loadstatus=smt
 }
 N 46900 47300 48200 47300 4
 N 47800 47300 47800 47100 4
@@ -962,8 +589,6 @@ refdes=J1
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 T 43845 59895 5 10 0 1 0 6 1
-loadstatus=throughhole
-T 43845 59895 5 10 0 1 0 6 1
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 T 43845 59895 5 10 0 1 0 6 1
 value=Header-5
@@ -1046,8 +671,6 @@ T 45800 61200 5 10 1 1 0 0 1
 value=22
 T 45200 61000 5 10 0 0 0 0 1
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-T 54400 47300 5 10 0 1 0 0 1
-loadstatus=smt
 }
 C 45200 60600 1 0 0 resistor.sym
 {
@@ -1059,8 +682,6 @@ T 45200 60600 5 10 0 0 0 0 1
 footprint=0402
 T 45800 60800 5 10 1 1 0 0 1
 value=22
-T 54400 47300 5 10 0 1 0 0 1
-loadstatus=smt
 }
 N 45200 61100 44200 61100 4
 {
@@ -1084,26 +705,22 @@ T 53400 72500 5 10 1 1 0 0 1
 value=1uF
 T 52800 72300 5 10 0 0 0 0 1
 footprint=0402
-T 44100 58725 5 10 0 1 0 0 1
-loadstatus=smt
 }
 C 52700 72200 1 0 0 gnd.sym
-N 57600 68700 59500 68700 4
-N 59500 68700 59500 69500 4
-N 59500 69500 60300 69500 4
-N 57600 63100 59000 63100 4
+N 57600 68700 63100 68700 4
+N 48100 53100 46700 53100 4
 {
-T 59000 63200 5 10 1 1 0 6 1
+T 46700 53200 5 10 1 1 0 0 1
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 }
-N 57600 63500 59000 63500 4
+N 48100 53500 46700 53500 4
 {
-T 59000 63600 5 10 1 1 0 6 1
+T 46700 53600 5 10 1 1 0 0 1
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 }
-N 57600 64300 59000 64300 4
+N 48100 53900 46700 53900 4
 {
-T 59000 64400 5 10 1 1 0 6 1
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 }
 N 57600 64700 59000 64700 4
@@ -1128,8 +745,6 @@ T 51400 72000 5 10 0 0 0 0 1
 footprint=0402
 T 50700 72200 5 10 1 1 0 0 1
 value=0.1uF
-T 44100 58725 5 10 0 1 0 0 1
-loadstatus=smt
 }
 C 50900 72000 1 90 0 capacitor.sym
 {
@@ -1143,8 +758,6 @@ T 50900 72000 5 10 0 0 0 0 1
 footprint=0402
 T 50200 72200 5 10 1 1 0 0 1
 value=0.1uF
-T 44100 58725 5 10 0 1 0 0 1
-loadstatus=smt
 }
 C 50400 72000 1 90 0 capacitor.sym
 {
@@ -1158,8 +771,6 @@ T 50400 72000 5 10 0 0 0 0 1
 footprint=0402
 T 49700 72200 5 10 1 1 0 0 1
 value=0.1uF
-T 44100 58725 5 10 0 1 0 0 1
-loadstatus=smt
 }
 C 49900 72000 1 90 0 capacitor.sym
 {
@@ -1173,8 +784,6 @@ T 49900 72000 5 10 0 0 0 0 1
 footprint=0402
 T 49200 72200 5 10 1 1 0 0 1
 value=0.1uF
-T 44100 58725 5 10 0 1 0 0 1
-loadstatus=smt
 }
 N 51200 72000 49700 72000 4
 C 51100 71700 1 0 0 gnd.sym
@@ -1214,101 +823,6 @@ N 53500 48100 53500 48800 4
 T 53600 48900 5 10 1 1 0 0 1
 netname=v_lipo
 }
-N 48100 57500 46800 57500 4
-{
-T 46850 57600 5 10 1 1 0 0 1
-netname=seg_pad_c
-}
-N 48100 57100 46800 57100 4
-{
-T 46850 57200 5 10 1 1 0 0 1
-netname=seg_pad_d
-}
-N 48100 55100 46800 55100 4
-{
-T 46850 55200 5 10 1 1 0 0 1
-netname=seg_box0_a
-}
-N 48100 54700 46800 54700 4
-{
-T 46850 54800 5 10 1 1 0 0 1
-netname=seg_box0_b
-}
-C 48100 51500 1 0 0 STM32L152-100.sym
-{
-T 41700 49900 5 10 0 0 0 0 1
-device=IC
-T 48500 71600 5 10 1 1 0 0 1
-refdes=U7
-T 48100 51500 5 10 0 0 0 0 1
-footprint=lqfp100
-T 48100 51500 5 10 0 0 0 0 1
-device=IC
-T 55700 71600 5 10 1 1 0 0 1
-value=STM32L152VCT6
-T 48100 51500 5 10 0 0 0 0 1
-loadstatus=smt
-}
-N 48100 54300 46800 54300 4
-{
-T 46850 54400 5 10 1 1 0 0 1
-netname=seg_box0_g
-}
-N 48100 53900 46800 53900 4
-{
-T 46850 54000 5 10 1 1 0 0 1
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-}
-N 48100 53500 46800 53500 4
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-}
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-T 46850 53200 5 10 1 1 0 0 1
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-}
-N 48100 55900 46800 55900 4
-{
-T 46850 56000 5 10 1 1 0 0 1
-netname=seg_pad_e
-}
-N 48100 59500 46800 59500 4
-{
-T 46800 59600 5 10 1 1 0 0 1
-netname=seg_pad_g
-}
-N 57600 71100 58900 71100 4
-{
-T 57600 71100 5 10 1 1 0 0 1
-netname=seg_box0_dp
-}
-N 57600 70700 58900 70700 4
-{
-T 57600 70700 5 10 1 1 0 0 1
-netname=seg_box0_c
-}
-N 57600 70300 58900 70300 4
-{
-T 57600 70300 5 10 1 1 0 0 1
-netname=seg_box0_d
-}
-N 57600 69900 58900 69900 4
-{
-T 57600 69900 5 10 1 1 0 0 1
-netname=seg_box0_e
-}
-N 57600 69500 58900 69500 4
-{
-T 57600 69500 5 10 1 1 0 0 1
-netname=seg_box1_a
-}
-N 57600 69100 58900 69100 4
-{
-T 57600 69100 5 10 1 1 0 0 1
-netname=seg_box1_b
-}
 C 57600 59800 1 0 0 nc-right.sym
 {
 T 57700 60300 5 10 0 0 0 0 1
@@ -1344,41 +858,6 @@ value=NoConnection
 T 57700 56500 5 10 0 0 0 0 1
 device=DRC_Directive
 }
-C 47600 61800 1 0 0 nc-left.sym
-{
-T 47600 62200 5 10 0 0 0 0 1
-value=NoConnection
-T 47600 62600 5 10 0 0 0 0 1
-device=DRC_Directive
-}
-C 47600 61400 1 0 0 nc-left.sym
-{
-T 47600 61800 5 10 0 0 0 0 1
-value=NoConnection
-T 47600 62200 5 10 0 0 0 0 1
-device=DRC_Directive
-}
-C 47600 68200 1 0 0 nc-left.sym
-{
-T 47600 68600 5 10 0 0 0 0 1
-value=NoConnection
-T 47600 69000 5 10 0 0 0 0 1
-device=DRC_Directive
-}
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-}
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-N 77500 67900 77600 67900 4
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-{
-T 70600 68600 5 10 1 1 0 0 1
-netname=seg_box0_g
-}
-N 71500 68600 71500 67900 4
-N 71500 67900 71600 67900 4
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 C 73700 49900 1 90 0 resistor.sym
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 C 75000 48800 1 90 0 capacitor.sym
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 C 73800 48800 1 90 0 capacitor.sym
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@@ -1587,8 +1042,6 @@ T 73800 49000 5 10 1 1 0 0 1
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-T 73800 48800 5 10 0 1 0 0 1
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-T 74300 51700 5 10 0 1 0 0 1
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 }
 C 76500 51000 1 0 0 capacitor.sym
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@@ -1627,8 +1078,6 @@ T 77100 50900 5 10 1 1 0 0 1
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-T 76500 51000 5 10 0 1 0 0 1
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 }
 C 78000 51900 1 90 0 capacitor.sym
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@@ -1642,8 +1091,6 @@ T 78000 52000 5 10 1 1 0 0 1
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 C 76500 51800 1 0 0 inductor.sym
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@@ -1657,8 +1104,6 @@ T 77000 52100 5 10 1 1 0 0 1
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 N 76500 51900 75200 51900 4
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-T 77800 51100 5 10 0 1 0 0 1
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 }
 C 78900 51100 1 0 0 inductor.sym
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@@ -1694,8 +1137,6 @@ T 79100 51000 5 10 1 1 0 0 1
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 C 76100 53800 1 90 0 inductor.sym
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-T 76100 53800 5 10 0 1 0 0 1
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 }
 C 79000 49900 1 90 0 capacitor.sym
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@@ -1724,8 +1163,6 @@ T 79500 50200 5 10 1 1 180 0 1
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-T 79000 49900 5 10 0 1 0 0 1
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 }
 C 78900 51600 1 0 0 capacitor.sym
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@@ -1765,8 +1202,6 @@ T 77100 54900 5 10 1 1 0 0 1
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 }
 C 76600 53100 1 0 0 inductor.sym
 {
@@ -1780,8 +1215,6 @@ T 77100 53300 5 10 1 1 0 0 1
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-T 76600 53100 5 10 0 1 0 0 1
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 }
 C 77900 52800 1 90 0 inductor.sym
 {
@@ -1795,8 +1228,6 @@ T 77900 52800 5 10 0 1 0 0 1
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 }
 C 76600 53600 1 0 0 capacitor.sym
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@@ -1810,8 +1241,6 @@ T 77100 54100 5 10 1 1 0 0 1
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 }
 N 76500 55400 76500 54700 4
 N 76600 55400 76500 55400 4
@@ -1840,8 +1269,6 @@ T 74000 54100 5 10 1 1 0 0 1
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-T 73400 53800 5 10 0 1 0 0 1
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 }
 C 75100 54000 1 90 0 capacitor.sym
 {
@@ -1855,8 +1282,6 @@ T 75100 54200 5 10 1 1 0 0 1
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 T 75100 54000 5 10 0 1 0 0 1
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-T 75100 54000 5 10 0 1 0 0 1
-loadstatus=smt
 }
 C 73400 55000 1 0 0 capacitor.sym
 {
@@ -1870,8 +1295,6 @@ T 74000 55300 5 10 1 1 0 0 1
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-T 73400 55000 5 10 0 1 0 0 1
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 }
 N 74900 54000 74300 54000 4
 N 74300 55200 74300 54800 4
@@ -1896,8 +1319,6 @@ T 75700 55700 5 10 1 1 0 0 1
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 T 75100 55400 5 10 0 1 0 0 1
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-T 75100 55400 5 10 0 1 0 0 1
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 }
 C 73300 55800 1 0 0 capacitor.sym
 {
@@ -1911,8 +1332,6 @@ T 73900 56100 5 10 1 1 0 0 1
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 T 73300 55800 5 10 0 1 0 0 1
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-T 73300 55800 5 10 0 1 0 0 1
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 }
 C 74300 56200 1 0 0 capacitor.sym
 {
@@ -1926,8 +1345,6 @@ T 74900 56500 5 10 1 1 0 0 1
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 T 74300 56200 5 10 0 1 0 0 1
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-T 74300 56200 5 10 0 1 0 0 1
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 }
 C 74300 57000 1 0 0 capacitor.sym
 {
@@ -1941,8 +1358,6 @@ T 74900 57300 5 10 1 1 0 0 1
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 T 74300 57000 5 10 0 1 0 0 1
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 N 73100 55600 75100 55600 4
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-T 76600 55200 5 10 0 1 0 0 1
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 }
 C 69000 51300 1 90 0 resistor.sym
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-T 69000 51300 5 10 0 1 0 0 1
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 }
 C 68300 55500 1 90 0 capacitor.sym
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@@ -2025,8 +1436,6 @@ T 68300 55500 5 10 0 0 90 0 1
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 C 68800 51000 1 0 0 gnd.sym
 N 69500 56400 68100 56400 4
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-T 68100 57500 5 10 0 1 0 0 1
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 C 67800 57200 1 0 0 gnd.sym
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@@ -2063,8 +1470,6 @@ T 67600 55900 5 10 0 0 90 0 1
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 }
 C 67300 55600 1 0 0 gnd.sym
 C 68100 52800 1 0 0 3.3V-plus.sym
@@ -2080,8 +1485,6 @@ T 68500 51900 5 10 0 0 90 0 1
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 }
 C 68200 51600 1 0 0 gnd.sym
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@@ -2097,8 +1500,6 @@ T 67600 52700 5 10 0 0 90 0 1
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 T 67300 52900 5 10 1 1 180 0 1
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-T 67600 52700 5 10 0 1 0 0 1
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 }
 C 67300 52400 1 0 0 gnd.sym
 N 69500 52800 68300 52800 4
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-T 76500 57200 5 10 0 1 0 0 1
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 }
 C 44400 43600 1 180 1 conn-6.sym
 {
@@ -2205,8 +1604,6 @@ T 61100 61600 5 10 0 0 0 0 1
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-Copyright 2018 by Bdale Garbee and Keith Packard
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